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TL138 EthEVM-A2 開發板 EMIFA 問題

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发表于 2016-8-9 09:15:17 | 显示全部楼层 回帖奖励 |倒序浏览 |阅读模式
創龍工程師, 您好:
   我購買TL138 EthEVM-A2 開發板, 目前用 demo code 雙核通訊都可正常運行, 經由DSP控制 EMIFA 使用CS2與外部FPGA做資料連結.
      使用光碟所提供的  EMIFA_FPGA 代碼, 目前外部是空接LA分析其 EMIF 發送的資料, 發現一個奇怪的問題!
1. 外部空接情況, 不論資料如何發送(0x0001 or  0x1ffff), 其D0 一直保持為低電壓;
2. D0外部上拉1K電阻後, 不論資料如何發送(0x0000), 其D0 一直保持為高電壓;

; {% \& _  N0 \
其餘 bus (D15 ~ D1), CS2, R/W, WE... 可正常控制, 唯有D0 !?
" C2 q* B( P* J# I. b
因為是參考創龍提供的源碼, 也試過調整時序(write-setup, strobe,hold/ Read-setup, strobe, hold) 幫助不大;
回讀PLLDIV3(0x01E1A120) =0x8003, 表示EMIF Clock 114MHz

7 Y$ a0 H) f' h, o/ I- }( {- e
void EMIFInit(void)
{
                //配置EMIFA相關复用引腳
                EMIFAPinMuxSetup();
               
                //配置數據總線16bit
                EMIFAAsyncDevDataBusWidthSelect(SOC_EMIFA_0_REGS,EMIFA_CHIP_SELECT_2,        EMIFA_DATA_BUSWITTH_16BIT);
               
                //選擇 Normal 模式
                EMIFAAsyncDevOpModeSelect(SOC_EMIFA_0_REGS,EMIFA_CHIP_SELECT_2, EMIFA_ASYNC_INTERFACE_NORMAL_MODE);
               
                //禁止 WAIT 引腳
                EMIFAExtendedWaitConfig(SOC_EMIFA_0_REGS,EMIFA_CHIP_SELECT_2, EMIFA_EXTENDED_WAIT_DISABLE);
               
                //配置 W_SETUP/R_SETUP   W_STROBE/R_STROBE    W_HOLD/R_HOLD        TA 等參數
                EMIFAWaitTimingConfig(SOC_EMIFA_0_REGS,EMIFA_CHIP_SELECT_2, EMIFA_ASYNC_WAITTIME_CONFIG(1, 2, 1, 1, 2, 1, 0 ));
}

# D/ ^& I4 A& f: I3 B( @0 k' M5 x
( o8 ^- J" X  b5 e1 s

' e# f3 ]9 |8 @, m7 v

  R0 ~& V6 ~) W: c0 o( b' g, T

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 楼主| 发表于 2016-8-10 14:05:15 | 显示全部楼层
您好, 很感謝你的回覆& h/ m# q$ b/ y/ Q" s. E& A
我使用你的方法, 把 EMIFA_D0 ~ D7 定義為 GP4[8] ~ GP[15], 所量測的波形 GP4[8]與其它GP4[9~ 15] 比對, 確實不太一樣.& `1 P# O0 E- a9 o7 ^' s

/ V  U6 X$ e) |2 `( Z我有針對 EMIFA_D0 查過底板, 只經由 RN6_22R 串接到 LAN9221-ABZJ, 故意去除RN6_22R, 也是有相同問題!  . k& L9 V, P8 ^8 B, K4 t
8 l3 w, x, M  X- z4 R4 N6 u  Q2 H
不知 EMIFA_D0 這腳位是否跟核心板 nand flash 或其它硬件有關?
/ `5 }  O9 F& p3 s0 f& \' R) o2 T( L7 Y3 R
在請您協助釐清, 謝謝~

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 楼主| 发表于 2016-8-17 12:11:07 | 显示全部楼层
創龍工程師, 您好 :- `; k: e/ F( x" A. S5 r: `# b& e
  使用 TL138 EthEVM-A2 開發板測試 EMIFA 功能, 改用單核(C6748)來測試GPIO4[8]~[15], GPIO[8] 也是有如上圖問題!!! ; }0 \0 h8 C( T$ m% |

, G' `) E6 Q7 Y2 m- i" J不知 EMIFA 異同步功能在 TL138 EthEVM-A2 開發板是否真能實現!? 或有其它高手能回應此狀況, 十分感謝~
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 楼主| 发表于 2016-9-12 10:30:48 | 显示全部楼层
Hi, Felix:4 z4 I) h! K  ^3 x  \; s2 U
  謝謝你的回覆, 上述的問題描述及GPIO測試, 因DSP初始化於 PIN ASSIGNE 已做內部 pull high, 所以其外部都處於空接的狀態, 直接用示波器及LA量測信號;
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