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[未解决] 数据一致性

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发表于 2018-6-13 23:42:32 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
工程师和各位发烧友大家好:我最近采购了创龙OMAPL138开发板用于音频信号处理,用了AIC3106+EDMA进行音频数据采集,然后处理(6748核心),在处理过程中碰到了一个问题,希望大家帮忙。问题如下:  ^5 T; n7 O" T1 G5 ~2 {0 I
我修改SlaveLinein这个例程中,从三缓冲换成两缓冲,通过EDMA3把数据保存在两个地方  # S2 X6 c0 \3 i0 d6 ]+ a& [
data[0][] 储存左声道数据data[1][]储存右声道数据, 然后data[0][]的数据复制到Mem_Copy_float(ConvIn+SYNCLEN-1,&data[0][0],2*BUFF_SZ);# d: t7 W0 u# G/ T0 B. A0 d
Convin数组里面,然后做本地信号localSync做卷积DSPF_sp_convol(ConvIn, LocalSync, ConvOut, SYNCLEN, CONVOUTLEN);
2 [4 q, }2 s3 X5 u8 q6 e! z, f) k6 [4 b) K& G
        CacheInv((unsigned int) (rxBuf0),sizeof(rxBuf0));
% h% v( F7 `! Z+ _& i        CacheInv((unsigned int) (rxBuf1),sizeof(rxBuf1));" U+ D6 H) \7 h* R

% F4 r1 d! W& J. z6 x#if (CHNUM==2)8 \7 {) G$ R  G0 o4 h8 j
                {
; K, f4 E0 `/ `* V' I; u' m4 d                    temp=((rxBuf1[4*i+1]<<8)+(rxBuf1[4*i]<<0)-OFFSET);                   //左声道         把8bit变成16bit
4 a9 R& ?; C# f% n# q: M3 l/ T                    data[0][i+BUFF_SZ]=1.0f*temp/32768.0f;                                         //转换成浮点- N1 B+ v0 {2 l
                    recdata_ch1[cnt]=1.0f*temp/32768.0f;                                             //保存数据不处理
+ e9 o. {6 K& n                    temp=((rxBuf1[4*i+3]<<8)+(rxBuf1[4*i+2]<<0)-OFFSET);              //右声道
3 [: P9 {1 V5 t+ m  U                    data[1][i+BUFF_SZ]=1.0f*temp/32768.0f;1 o% ?' c/ D% {* t8 j) c. s
                    recdata_ch2[cnt]=1.0f*temp/32768.0f;
- n* P' L% `  h) Z* }                    cnt++;
( ]) }' V$ j; Y6 U# K( }                }, b4 G$ {) ?/ M! K2 h& X

( r& W: l2 A6 k( c9 v  w  A* R$ r1 C. y# d6 ^" k6 i( F6 \- M
  f7 h% \9 H: @& W5 D; I0 J
而recdata_ch1和recdata_ch2的数组很大,在48k采样率下可以保存25秒的数据,recdata_ch1和recdata_ch2不参与任何计算,只保存数据,用于观察数据是否正确。+ y& Q5 n' g% G( @8 I
EDMA采样双缓冲模式,缓冲区长度160ms,每次缓冲满以后数据就复制到ConvIn,做一次卷积,做卷积的时间远远小于缓冲区的时间,这个保证数据不会丢失。3 k0 M. l+ w- `$ J( E1 i7 s
出现的问题是,如下图所示,在信号空白信号中出现微小的噪声,而两个微小噪声的周期刚好就是一个buffer长度160ms" f" z3 e' ~% }+ @) \, h

$ n0 {% W/ v) L+ ^! \& u( V6 C/ o1 U3 Z% S$ F. T

) d, c4 n3 o- T. W, `当我把卷积处理去掉的时候,信号是正确的,如下图所示
3 I; |- K9 v/ G1 R* h- H2 Y1 B5 O5 f* d! U# A5 C8 @

2 s4 q. N3 E6 n) U4 d+ ]! Y
2 X: p2 C; N0 K  d# a) j3 n1 B上述所有数据放在DDR2中,在main一开始启用cache  
8 X1 p2 |: \# B: X; I; c2 b CacheEnableMAR((unsigned int)0xC0000000,(unsigned int)0x10000000);
4 r) S4 g- C7 Y4 V$ c9 U' Z CacheEnable(L1PCFG_L1PMODE_32K | L1DCFG_L1DMODE_32K | L2CFG_L2MODE_256K);
* t8 M* [- e; J' r' t
$ c$ k( p) q1 P9 I5 p6 }* ]/ I+ Y% K
我估计是数据一致性的问题,但是,不知道要修改哪里,怎么修改,麻烦大神给一些提示或者指导。感激不尽。2 I& Z! q* l/ W% o9 ]

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沙发
 楼主| 发表于 2018-6-13 23:54:57 | 只看该作者
会不会是这样引起的,当DDR2的数据传输到缓存的时候,recdata_ch1的数据不会改变,经过DSPF_sp_convol()计算后,计算结果从缓存传回DDR2的时候,影响了recdata_ch1的数据?
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板凳
发表于 2018-6-19 15:34:23 | 只看该作者
您好,关于缓存一致性,建议您可以结合,我们提供的视频教程,进行深入学习
8 J, p2 i7 Q* `6 J' ~7 }; I1 q( {& g4 Z* J6 Z" V7 Q- Q  ?

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