MCASP自环配置。 - OMAP-L138 - 嵌入式开发者社区 - 51ele.net
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[未解决] MCASP自环配置。

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发表于 2018-11-7 13:28:07 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
我项目上用OMAPL138的板子MCASP的引脚都是链接的FPGA,所以在FPGA这端设置的MCASP自环。把axr0接收到的通过axr1发回去。
部分代码如下
input mcasp_afsx,
) m4 H0 \# b0 v% o7 I  ninput mcasp_ahclkx,$ t# S: S" g: b7 v, n8 N, O. K+ p
input mcasp_aclkx,$ h# `! F5 \6 y# k2 [. c) S2 D
input axr0,1 M2 u! W5 {; l& @/ C
7 _6 v$ ^7 T: n, `/ W" R
output mcasp_afsr,
3 w8 t: z' J/ V* O( n3 {# k! O+ zoutput mcasp_ahclkr,# B' ?! l! P# J6 r/ S* W% a
output mcasp_aclkr,/ t/ ]: p3 B' c9 f" B' T4 q
output axr1,
1 C0 U9 ]  [! Q. C1 O0 z; }
assign mcasp_afsr = mcasp_afsx;. }0 L6 ?4 o* G  q
assign mcasp_aclkr = mcasp_aclkx;
8 ~# A3 h( c# l4 P# K7 Z, ]assign mcasp_ahclkr = mcasp_ahclkx;2 F5 G0 K) X' F( M  Z
assign axr1 = axr0;

+ X2 C1 \5 a1 a5 S5 e( x' ^1 f
0 _+ l8 K7 O5 L) T& q
在OMAPL138这端,通过axr0接口发固定的数,axr1接收。
在配置MACASP的时候,发送全部取内部时钟,接收全部取外部时钟。
一直循环发送,但是接收不到。在FPGA端也没有看到时钟和信号的波形。
部分代码如下,关于edma3的部分未做变化。

" `3 W% _, z# V) f1 L2 x
static void McASPI2SConfigure(void)) Z4 t5 M3 U& {; N4 D
{" o" ?( z% [6 Q2 O4 h: \- T
McASPRxReset(SOC_MCASP_0_CTRL_REGS);
3 A: x5 w2 I) h8 |2 n) ^" W+ e, {McASPTxReset(SOC_MCASP_0_CTRL_REGS);
/* Enable the FIFOs for DMA transfer */. y5 H: K4 Q5 e" J
McASPReadFifoEnable(SOC_MCASP_0_FIFO_REGS, 1, 1);+ K8 s( |7 O  ~& e  j- c  @
McASPWriteFifoEnable(SOC_MCASP_0_FIFO_REGS, 1, 1);
/* Set I2S format in the transmitter/receiver format units */
& m( q9 ]0 f5 ~+ i, qMcASPRxFmtI2SSet(SOC_MCASP_0_CTRL_REGS, WORD_SIZE, SLOT_SIZE,/ W4 V4 _$ [' x2 b; f' Y4 [
MCASP_RX_MODE_DMA);" f2 X9 R* s- w9 T. X7 d
McASPTxFmtI2SSet(SOC_MCASP_0_CTRL_REGS, WORD_SIZE, SLOT_SIZE,
& M9 I0 l0 j% `0 XMCASP_TX_MODE_DMA);
/* Configure the frame sync. I2S shall work in TDM format with 2 slots */( t" `! c' V  S# Y( m$ l+ S/ R- Z9 I# v
McASPRxFrameSyncCfg(SOC_MCASP_0_CTRL_REGS, 2, MCASP_RX_FS_WIDTH_WORD,
5 W! p' b+ s2 s. ?2 ^) NMCASP_RX_FS_EXT_BEGIN_ON_FALL_EDGE);
% e3 {( f' I0 L* e0 h# VMcASPTxFrameSyncCfg(SOC_MCASP_0_CTRL_REGS, 2, MCASP_TX_FS_WIDTH_WORD,
0 O4 \* i$ h. j! C( VMCASP_TX_FS_INT_BEGIN_ON_RIS_EDGE);
/* configure the clock for receiver */
. H, I4 A; X3 [$ ~8 v6 C$ dMcASPRxClkCfg(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_EXTERNAL, 0, 0);! v& a/ @' {  S0 M: ~, P
McASPRxClkPolaritySet(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_POL_RIS_EDGE); & i( ?: E' [' }% V
McASPRxClkCheckConfig(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLKCHCK_DIV32,$ L' ]* J4 S4 N- T- Y3 q# g0 q6 g
0x00, 0xFF);
/* configure the clock for transmitter */6 Z+ ~/ o' W; D$ e3 S! g- D& `
McASPTxClkCfg(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_INTERNAL, 11, 1);6 \# ~+ a0 x( F9 E; u
McASPTxClkPolaritySet(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_POL_FALL_EDGE); 0 @, B7 j; ^% W1 K1 \
McASPTxClkCheckConfig(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLKCHCK_DIV32,; Z2 G0 |0 i2 p1 F9 ^. ~
0x00, 0xFF);/ r& O+ z- W; l( I- Y8 u" w$ s
, b0 a8 g( s. _) _/ K
/* Enable synchronization of RX and TX sections */ ) B+ a/ }/ z; q& x
McASPTxRxClkSyncEnable(SOC_MCASP_0_CTRL_REGS);
/* Enable the transmitter/receiver slots. I2S uses 2 slots */4 y) C* v# w9 T
McASPRxTimeSlotSet(SOC_MCASP_0_CTRL_REGS, I2S_SLOTS);" M+ U# q/ f) g& V" a, l& {
McASPTxTimeSlotSet(SOC_MCASP_0_CTRL_REGS, I2S_SLOTS);
/*
( B6 ~& L) V  {( Z7 |$ E** Set the serializers, Currently only one serializer is set as
6 _3 _' ^4 Y% b8 d** transmitter and one serializer as receiver.( k- k# S4 V/ V0 I
*/7 Z  r+ B5 E% T5 W  W! R0 l3 a# y
McASPSerializerRxSet(SOC_MCASP_0_CTRL_REGS, MCASP_XSER_RX);
: x& j3 Q; O' Y" D0 L$ M. _8 c4 @McASPSerializerTxSet(SOC_MCASP_0_CTRL_REGS, MCASP_XSER_TX);
/*7 k2 ~1 E' u1 o3 Z8 d% e* t
** Configure the McASP pins 4 X8 p, S: U* o- k1 i. v
** Input - Frame Sync, Clock and Serializer Rx2 E$ L/ J  k4 n* Z8 P6 ?9 g% v
** Output - Serializer Tx is connected to the input of the codec 9 i; b2 E% s. u7 Y3 h& M# q
*/
, V# K0 E; m& N- Y& eMcASPPinMcASPSet(SOC_MCASP_0_CTRL_REGS, 0xFFFFFFFF);. o5 ~, s- O& A+ X0 N! K7 v0 }' N
McASPPinDirOutputSet(SOC_MCASP_0_CTRL_REGS,MCASP_PIN_AXR(MCASP_XSER_TX));
+ w$ j! {/ G$ a4 |) F! {. [McASPPinDirInputSet(SOC_MCASP_0_CTRL_REGS, MCASP_PIN_AFSX
( q" M1 K4 o& M9 ?) L; A, n* G| MCASP_PIN_ACLKX
8 M# e* f  d8 f1 A4 ^4 V& z| MCASP_PIN_AHCLKX* I# e2 q) @! v+ Q
| MCASP_PIN_AXR(MCASP_XSER_RX));
/* Enable error interrupts for McASP */0 T) O+ ~2 ^2 Q6 ^$ B& `
McASPTxIntEnable(SOC_MCASP_0_CTRL_REGS, MCASP_TX_DMAERROR ' w3 K& d2 X0 `! E" ~
| MCASP_TX_CLKFAIL % w: Y: h8 G* E. L1 @  S
| MCASP_TX_SYNCERROR# {' i; K0 I! v* B9 B# r8 S# d
| MCASP_TX_UNDERRUN);
McASPRxIntEnable(SOC_MCASP_0_CTRL_REGS, MCASP_RX_DMAERROR - ~; @$ {* j5 ~, k
| MCASP_RX_CLKFAIL( t1 v3 B) d& |8 [* T$ q
| MCASP_RX_SYNCERROR
! O* O: ]$ R1 P9 t5 x| MCASP_RX_OVERRUN);4 ^3 E2 u! X" L) K
}
static void I2SDataTxRxActivate(void)
) k6 i- j* ~7 B5 M. `% }- i, K2 V{
7 L& s6 e5 A) V6 C/* Start the clocks */
9 o+ f% u; L0 F$ o( v$ _: dMcASPRxClkStart(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_EXTERNAL);3 ^# O) o, S5 X, ~8 l
McASPTxClkStart(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_INTERNAL);
/* Enable EDMA for the transfer */) V8 q0 C6 W5 K0 w  C0 i2 t
EDMA3EnableTransfer(SOC_EDMA30CC_0_REGS, EDMA3_CHA_MCASP0_RX,
* Q. e1 [; Y- ^: l+ w6 H8 V# DEDMA3_TRIG_MODE_EVENT);! ?' H' I; g# i' p
EDMA3EnableTransfer(SOC_EDMA30CC_0_REGS, * A1 X6 d# [! f
EDMA3_CHA_MCASP0_TX, EDMA3_TRIG_MODE_EVENT);
/* Activate the serializers */  p9 U8 _$ Z9 T  @% a
McASPRxSerActivate(SOC_MCASP_0_CTRL_REGS);. r7 N0 I  F3 p4 i  M& p- m
McASPTxSerActivate(SOC_MCASP_0_CTRL_REGS);
/* make sure that the XDATA bit is cleared to zero */" B; i1 a2 E! T( L1 ]
while(McASPTxStatusGet(SOC_MCASP_0_CTRL_REGS) & MCASP_TX_STAT_DATAREADY);
/* Activate the state machines */7 Y2 J2 p# I# Y: J* Z0 g: y
McASPRxEnable(SOC_MCASP_0_CTRL_REGS);1 z  b$ D9 V9 a# E2 ?, C
McASPTxEnable(SOC_MCASP_0_CTRL_REGS);
: V5 d& h0 k) ]: T0 u. a}
- N" r7 U$ r1 I
请问:问题出在哪了,时钟按照这样配是否有错。
另外我看XDATA一直是0,接收的rxbuf0,1,2里有一般全是FFFF一半全是0.

. Y3 G% [$ p4 y5 g9 X9 I2 T/ S
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