MCASP自环配置。 - OMAP-L138 - 嵌入式开发者社区 - 51ele.net
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[未解决] MCASP自环配置。

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发表于 2018-11-7 13:28:07 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
我项目上用OMAPL138的板子MCASP的引脚都是链接的FPGA,所以在FPGA这端设置的MCASP自环。把axr0接收到的通过axr1发回去。
部分代码如下
input mcasp_afsx,/ N5 W+ `9 Q7 a+ l1 ^7 [* @
input mcasp_ahclkx,
! _" s, E' h5 ^5 g1 m* ~3 g8 jinput mcasp_aclkx,
( K  _7 C: M/ W( W! }7 }5 S0 _input axr0,
* w5 k! |$ G, V$ U; C5 K8 A2 G7 b  Y8 p( j) ]
output mcasp_afsr,; x% X% K0 f7 [* l0 `% h
output mcasp_ahclkr,& U. ]* X! q" @4 v
output mcasp_aclkr,
4 R% }2 [1 [- G, p4 G( G8 Woutput axr1,9 ^1 M7 c+ ?6 h  O
assign mcasp_afsr = mcasp_afsx;
: ?3 l8 h: [. m- ^& oassign mcasp_aclkr = mcasp_aclkx;4 [9 u4 m( [: {5 t! x' C
assign mcasp_ahclkr = mcasp_ahclkx;, x- Z7 A, i$ j. ]' ?/ l! ^% t
assign axr1 = axr0;

& i5 a  p  I5 g* L
) L/ V' `, y$ F4 I9 H) R) j" t
在OMAPL138这端,通过axr0接口发固定的数,axr1接收。
在配置MACASP的时候,发送全部取内部时钟,接收全部取外部时钟。
一直循环发送,但是接收不到。在FPGA端也没有看到时钟和信号的波形。
部分代码如下,关于edma3的部分未做变化。
8 Z$ o/ Z, d. X
static void McASPI2SConfigure(void)' p; Y8 ^7 }3 X" n& x8 `5 Z
{
1 j" y0 R/ u% N5 h$ F3 DMcASPRxReset(SOC_MCASP_0_CTRL_REGS);
- X* f& Q1 K( D- Z+ ]/ pMcASPTxReset(SOC_MCASP_0_CTRL_REGS);
/* Enable the FIFOs for DMA transfer *// K  s" Q" h. l. D, `  h
McASPReadFifoEnable(SOC_MCASP_0_FIFO_REGS, 1, 1);
* w+ _& Z3 m8 [5 yMcASPWriteFifoEnable(SOC_MCASP_0_FIFO_REGS, 1, 1);
/* Set I2S format in the transmitter/receiver format units */
# u1 @7 u! _/ s# U9 S4 ^McASPRxFmtI2SSet(SOC_MCASP_0_CTRL_REGS, WORD_SIZE, SLOT_SIZE,
, b# e! d$ D9 e& vMCASP_RX_MODE_DMA);
- U6 B( S: d0 X" m7 \2 L1 HMcASPTxFmtI2SSet(SOC_MCASP_0_CTRL_REGS, WORD_SIZE, SLOT_SIZE,
3 |) S( k3 i/ [. F/ PMCASP_TX_MODE_DMA);
/* Configure the frame sync. I2S shall work in TDM format with 2 slots */
; e$ H  ^# D* r6 O5 G7 i( \. cMcASPRxFrameSyncCfg(SOC_MCASP_0_CTRL_REGS, 2, MCASP_RX_FS_WIDTH_WORD, * b8 a' H8 l$ z2 b
MCASP_RX_FS_EXT_BEGIN_ON_FALL_EDGE);% F  W7 `3 R8 u
McASPTxFrameSyncCfg(SOC_MCASP_0_CTRL_REGS, 2, MCASP_TX_FS_WIDTH_WORD,
) m1 X# ]; z) Q8 eMCASP_TX_FS_INT_BEGIN_ON_RIS_EDGE);
/* configure the clock for receiver */
4 ?: H) r* B) i4 w0 w9 Y: F4 f9 V; M  qMcASPRxClkCfg(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_EXTERNAL, 0, 0);, t8 z3 z8 t' P5 D3 j9 B) X4 y
McASPRxClkPolaritySet(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_POL_RIS_EDGE); ) l. J5 d6 u- w/ \
McASPRxClkCheckConfig(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLKCHCK_DIV32,
7 L! |9 B# z/ K0 \  `0x00, 0xFF);
/* configure the clock for transmitter */0 w2 P( X! _, d+ ~9 b9 \* i
McASPTxClkCfg(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_INTERNAL, 11, 1);* y( X/ G5 \! ]7 N: f( K& J3 h
McASPTxClkPolaritySet(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_POL_FALL_EDGE); % Y5 \& c4 j, O9 ?# e4 G
McASPTxClkCheckConfig(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLKCHCK_DIV32,
6 ?% G6 d# ~6 J6 P& ]- H. l  T5 Z0x00, 0xFF);
- k9 K/ I- X( n1 ^' U* Y
# C5 T* B4 K( q$ {/* Enable synchronization of RX and TX sections */
8 V2 t6 i( u1 V8 nMcASPTxRxClkSyncEnable(SOC_MCASP_0_CTRL_REGS);
/* Enable the transmitter/receiver slots. I2S uses 2 slots */! U, H4 c5 r: X. f7 ~9 M
McASPRxTimeSlotSet(SOC_MCASP_0_CTRL_REGS, I2S_SLOTS);
; V) w) j% p' w) ]; Q" mMcASPTxTimeSlotSet(SOC_MCASP_0_CTRL_REGS, I2S_SLOTS);
/*- o/ q9 S9 j7 k* q5 W- t5 J) ~
** Set the serializers, Currently only one serializer is set as
3 K% W! k- {4 O/ l** transmitter and one serializer as receiver.0 w. T( s: B. ], q& U
*/
0 o$ p  q. V8 C0 `0 C! QMcASPSerializerRxSet(SOC_MCASP_0_CTRL_REGS, MCASP_XSER_RX);7 H0 z: ]1 f3 a
McASPSerializerTxSet(SOC_MCASP_0_CTRL_REGS, MCASP_XSER_TX);
/*! N; V# W1 m) N
** Configure the McASP pins
: J% g+ M/ W- _6 G& ]** Input - Frame Sync, Clock and Serializer Rx4 B. {" }" g# k; V
** Output - Serializer Tx is connected to the input of the codec 2 x2 ?+ \. z9 w- E6 z. P
*/
( ]: C5 x% Z& n* L: B" o$ ^- QMcASPPinMcASPSet(SOC_MCASP_0_CTRL_REGS, 0xFFFFFFFF);
" s5 E1 s  f4 F% f+ @McASPPinDirOutputSet(SOC_MCASP_0_CTRL_REGS,MCASP_PIN_AXR(MCASP_XSER_TX));7 u# b5 p" u- ^" }" |1 w
McASPPinDirInputSet(SOC_MCASP_0_CTRL_REGS, MCASP_PIN_AFSX
1 E5 K3 m" Q0 l7 T/ z% y& ?8 g| MCASP_PIN_ACLKX
9 D5 Z( \: r, B' || MCASP_PIN_AHCLKX
0 [5 Z) ^+ H' o+ n' d3 F| MCASP_PIN_AXR(MCASP_XSER_RX));
/* Enable error interrupts for McASP */" V$ {' f7 S! i2 O2 U8 A
McASPTxIntEnable(SOC_MCASP_0_CTRL_REGS, MCASP_TX_DMAERROR
: n/ ~3 K' I& J2 [7 H5 g5 ?0 Y| MCASP_TX_CLKFAIL
  v( u' {3 Y* Z| MCASP_TX_SYNCERROR
& V5 j4 i9 n3 l- H9 `1 t| MCASP_TX_UNDERRUN);
McASPRxIntEnable(SOC_MCASP_0_CTRL_REGS, MCASP_RX_DMAERROR
3 a0 c# r0 R+ c6 c* L| MCASP_RX_CLKFAIL
8 c8 p$ {* h5 X5 `+ r  k4 Z) ?* j| MCASP_RX_SYNCERROR / M7 ?& Z( a3 Y
| MCASP_RX_OVERRUN);7 u7 l) X: r5 D& ]3 M  Q9 j
}
static void I2SDataTxRxActivate(void)1 @1 d: Z7 d% \$ J
{/ V% \+ i/ w5 w; G+ O6 `
/* Start the clocks */
$ e- [( {  z/ U6 q& }6 QMcASPRxClkStart(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_EXTERNAL);
6 h( m/ f: k7 i/ ]McASPTxClkStart(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_INTERNAL);
/* Enable EDMA for the transfer */
- x5 C8 z5 _! u* X% Y& yEDMA3EnableTransfer(SOC_EDMA30CC_0_REGS, EDMA3_CHA_MCASP0_RX,
; l; d% o) Z" _" _+ P7 v7 _8 dEDMA3_TRIG_MODE_EVENT);
/ ?1 K. I3 o+ d) l2 EEDMA3EnableTransfer(SOC_EDMA30CC_0_REGS,
' K) |" O% H: m" iEDMA3_CHA_MCASP0_TX, EDMA3_TRIG_MODE_EVENT);
/* Activate the serializers */- D- w$ I" `9 D" K  |- {) Z  h0 E
McASPRxSerActivate(SOC_MCASP_0_CTRL_REGS);- f# Z* ^/ V4 G# J7 e5 r* `; f
McASPTxSerActivate(SOC_MCASP_0_CTRL_REGS);
/* make sure that the XDATA bit is cleared to zero */; [% \# S8 n# P
while(McASPTxStatusGet(SOC_MCASP_0_CTRL_REGS) & MCASP_TX_STAT_DATAREADY);
/* Activate the state machines */
) a+ c8 Y% j# B( h  S, S/ k3 {; XMcASPRxEnable(SOC_MCASP_0_CTRL_REGS);/ B0 L9 z' |5 c5 P* m
McASPTxEnable(SOC_MCASP_0_CTRL_REGS);, I) Z& q. O9 u
}

# v0 A" U' v+ Z" \. X
请问:问题出在哪了,时钟按照这样配是否有错。
另外我看XDATA一直是0,接收的rxbuf0,1,2里有一般全是FFFF一半全是0.
# k- ]9 K9 A0 {; f- ^7 K, r3 T
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