MCASP自环配置。 - OMAP-L138 - 嵌入式开发者社区 - 51ele.net
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[未解决] MCASP自环配置。

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发表于 2018-11-7 13:28:07 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
我项目上用OMAPL138的板子MCASP的引脚都是链接的FPGA,所以在FPGA这端设置的MCASP自环。把axr0接收到的通过axr1发回去。
部分代码如下
input mcasp_afsx,1 ^4 [2 @1 n' K% a) }/ j) P: O
input mcasp_ahclkx,8 S% X2 P4 k, _
input mcasp_aclkx,* c9 s  J0 s5 r. ^
input axr0,) {# }# Q- Q5 {  N) N
1 V2 L! R1 O+ I1 j3 a* D5 A) v8 B
output mcasp_afsr,
& L, b# V  A' @- ^: xoutput mcasp_ahclkr,
" o. N% Z: ~1 A# Routput mcasp_aclkr," T/ _' z  P+ I
output axr1,+ W7 K( n3 {! g& o+ S* d: F8 C
assign mcasp_afsr = mcasp_afsx;# `3 l& p8 M! Q! ]
assign mcasp_aclkr = mcasp_aclkx;
5 P2 a' x$ g) q5 i4 j( w* qassign mcasp_ahclkr = mcasp_ahclkx;" o& @% E$ u8 e* e/ @2 O; Q7 c6 x8 z+ ]2 b
assign axr1 = axr0;
4 |6 A2 Y3 }! x% h

/ H- ]7 E: _1 A5 n; N% `
在OMAPL138这端,通过axr0接口发固定的数,axr1接收。
在配置MACASP的时候,发送全部取内部时钟,接收全部取外部时钟。
一直循环发送,但是接收不到。在FPGA端也没有看到时钟和信号的波形。
部分代码如下,关于edma3的部分未做变化。
8 w+ ?! S$ f9 B& p
static void McASPI2SConfigure(void)) n* k+ i- ?) e, Z4 G- w
{
- w' r5 Q5 k/ X/ a/ lMcASPRxReset(SOC_MCASP_0_CTRL_REGS);
" t& b% x/ U5 T( V/ I  AMcASPTxReset(SOC_MCASP_0_CTRL_REGS);
/* Enable the FIFOs for DMA transfer */
4 P% w: e: L5 g, E1 Q9 zMcASPReadFifoEnable(SOC_MCASP_0_FIFO_REGS, 1, 1);4 Q+ F4 H' b5 J, ?. X
McASPWriteFifoEnable(SOC_MCASP_0_FIFO_REGS, 1, 1);
/* Set I2S format in the transmitter/receiver format units */& x9 l/ y( T/ h* j# @+ b* J. w
McASPRxFmtI2SSet(SOC_MCASP_0_CTRL_REGS, WORD_SIZE, SLOT_SIZE," s6 P" X0 z: Y8 i& f7 v/ \1 C/ E
MCASP_RX_MODE_DMA);+ j7 i9 y* R( O2 {' ~) K- O9 A
McASPTxFmtI2SSet(SOC_MCASP_0_CTRL_REGS, WORD_SIZE, SLOT_SIZE,: e! N4 v2 w! c- s# j7 O- M, o
MCASP_TX_MODE_DMA);
/* Configure the frame sync. I2S shall work in TDM format with 2 slots */
  C% b6 _1 c% g5 o$ GMcASPRxFrameSyncCfg(SOC_MCASP_0_CTRL_REGS, 2, MCASP_RX_FS_WIDTH_WORD, % n! I. l: O3 v' M7 S0 T* q
MCASP_RX_FS_EXT_BEGIN_ON_FALL_EDGE);
: g% g8 ~5 n! D8 V3 `- D. ~6 w1 BMcASPTxFrameSyncCfg(SOC_MCASP_0_CTRL_REGS, 2, MCASP_TX_FS_WIDTH_WORD,   L& _+ D" w. x2 ]! t8 G5 P7 I6 X
MCASP_TX_FS_INT_BEGIN_ON_RIS_EDGE);
/* configure the clock for receiver */
' Z; T2 [; P* H: ]McASPRxClkCfg(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_EXTERNAL, 0, 0);  r) k- @  j+ m- o
McASPRxClkPolaritySet(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_POL_RIS_EDGE); 4 G% ~4 D* P$ c- ]
McASPRxClkCheckConfig(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLKCHCK_DIV32,
8 X! r/ \, q' }+ b4 V! {1 H0x00, 0xFF);
/* configure the clock for transmitter */
5 u; @' J* m, K% `4 V9 J+ @McASPTxClkCfg(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_INTERNAL, 11, 1);
1 D0 X3 I& O# w) U0 |" H7 g( eMcASPTxClkPolaritySet(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_POL_FALL_EDGE);
: ~' L4 Z/ j- w6 M8 x3 a8 jMcASPTxClkCheckConfig(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLKCHCK_DIV32,
+ q, k# o: Q4 [$ P5 }2 `) G0x00, 0xFF);
1 _7 t- W" v1 C  e9 [* p9 J. [! v7 C) F0 Q
/* Enable synchronization of RX and TX sections */
4 v' _* v8 ^; N* e: EMcASPTxRxClkSyncEnable(SOC_MCASP_0_CTRL_REGS);
/* Enable the transmitter/receiver slots. I2S uses 2 slots */
/ X+ c  E" }: |. PMcASPRxTimeSlotSet(SOC_MCASP_0_CTRL_REGS, I2S_SLOTS);% b5 }4 O* Z( w& I, B
McASPTxTimeSlotSet(SOC_MCASP_0_CTRL_REGS, I2S_SLOTS);
/*0 K; h3 ?2 O+ H8 b) B4 @+ v: J$ w
** Set the serializers, Currently only one serializer is set as
+ K$ b3 ~- M5 \# I. w, T, I** transmitter and one serializer as receiver./ ^+ p, s$ N& i7 ~/ V+ e
*/  h* K+ r- f9 M' \8 x8 I
McASPSerializerRxSet(SOC_MCASP_0_CTRL_REGS, MCASP_XSER_RX);# @' N6 a0 X& ~" i/ R
McASPSerializerTxSet(SOC_MCASP_0_CTRL_REGS, MCASP_XSER_TX);
/*! x4 r, [& b+ j9 P
** Configure the McASP pins
1 t8 |" p5 i: C( A% W# R  ]2 B** Input - Frame Sync, Clock and Serializer Rx1 K/ l0 }) B6 c, c4 [
** Output - Serializer Tx is connected to the input of the codec
2 z% I2 V4 W3 {  X4 y- h- `*/3 }# T" V+ J  V  z
McASPPinMcASPSet(SOC_MCASP_0_CTRL_REGS, 0xFFFFFFFF);
1 D/ |' F/ D* d: `2 s; DMcASPPinDirOutputSet(SOC_MCASP_0_CTRL_REGS,MCASP_PIN_AXR(MCASP_XSER_TX));
7 p; f7 a1 I1 }* JMcASPPinDirInputSet(SOC_MCASP_0_CTRL_REGS, MCASP_PIN_AFSX. G6 B: T6 I; r/ v
| MCASP_PIN_ACLKX
  x$ F  f6 p! j  N, |6 R# c| MCASP_PIN_AHCLKX9 y0 B. j  b3 Y9 H
| MCASP_PIN_AXR(MCASP_XSER_RX));
/* Enable error interrupts for McASP */
' q2 I) o, P6 L& H, ]; x/ wMcASPTxIntEnable(SOC_MCASP_0_CTRL_REGS, MCASP_TX_DMAERROR 8 p5 T+ w/ D1 g3 W
| MCASP_TX_CLKFAIL
0 g' i) u: j/ q/ G- M1 l| MCASP_TX_SYNCERROR
: I; y; F# A& y/ o3 _( N+ Q| MCASP_TX_UNDERRUN);
McASPRxIntEnable(SOC_MCASP_0_CTRL_REGS, MCASP_RX_DMAERROR
, D0 f* x# m$ i2 b| MCASP_RX_CLKFAIL
; S$ l3 w5 l2 \+ x+ @. M| MCASP_RX_SYNCERROR ; a; g' k& [' @1 J
| MCASP_RX_OVERRUN);' {2 S# Z. g" {0 Z0 o/ r# r4 a
}
static void I2SDataTxRxActivate(void)0 x/ l  j! N9 Q# M
{
% o9 F5 s7 Z7 ^8 U& P0 }8 P' e/* Start the clocks */
% s1 r7 U$ r3 bMcASPRxClkStart(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_EXTERNAL);
6 j4 S  [9 U- u% v: _+ z! z' ?: xMcASPTxClkStart(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_INTERNAL);
/* Enable EDMA for the transfer */
: \; B6 {6 a- vEDMA3EnableTransfer(SOC_EDMA30CC_0_REGS, EDMA3_CHA_MCASP0_RX,
1 B6 Q1 Z' Z1 V9 UEDMA3_TRIG_MODE_EVENT);
, i& ]& M! q' H8 ?6 x/ _6 I. gEDMA3EnableTransfer(SOC_EDMA30CC_0_REGS, 5 C0 h  D( b7 @. y4 g2 e
EDMA3_CHA_MCASP0_TX, EDMA3_TRIG_MODE_EVENT);
/* Activate the serializers */0 m+ N  r! {4 o- a" H8 s- R$ j1 q
McASPRxSerActivate(SOC_MCASP_0_CTRL_REGS);
; L4 j1 d7 n; c  fMcASPTxSerActivate(SOC_MCASP_0_CTRL_REGS);
/* make sure that the XDATA bit is cleared to zero */
) \' z1 x8 Y/ P# Y( a/ M- Dwhile(McASPTxStatusGet(SOC_MCASP_0_CTRL_REGS) & MCASP_TX_STAT_DATAREADY);
/* Activate the state machines */$ L, I6 H6 {4 y+ `) H
McASPRxEnable(SOC_MCASP_0_CTRL_REGS);
. g( w8 f* d) t8 {) O5 w; i" G3 Y$ RMcASPTxEnable(SOC_MCASP_0_CTRL_REGS);
0 }, j) z" b7 b3 P}

0 l) ~7 H# V6 m3 l# t- ]* R
请问:问题出在哪了,时钟按照这样配是否有错。
另外我看XDATA一直是0,接收的rxbuf0,1,2里有一般全是FFFF一半全是0.
: B% o- e8 {! K% ~# Z. a
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