MCASP自环配置。 - OMAP-L138 - 嵌入式开发者社区 - 51ele.net
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[未解决] MCASP自环配置。

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发表于 2018-11-7 13:28:07 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
我项目上用OMAPL138的板子MCASP的引脚都是链接的FPGA,所以在FPGA这端设置的MCASP自环。把axr0接收到的通过axr1发回去。
部分代码如下
input mcasp_afsx," e/ M: b. i2 z/ ]* k
input mcasp_ahclkx,5 |( Q1 v  c0 o, P, y$ g
input mcasp_aclkx,7 R! k# |7 J& @. c( s  T
input axr0,! |- K1 ^( a) |- n
  O. L3 B  @8 X# A) J) i5 \) B1 I: F
output mcasp_afsr,
  u  b5 v% P, j- B3 ooutput mcasp_ahclkr,
' d3 u5 @. ?+ d: r' j8 e3 b2 P6 Youtput mcasp_aclkr,- @$ i; I1 x0 q1 r4 b
output axr1,
# T4 R3 [* M0 P: M' L
assign mcasp_afsr = mcasp_afsx;# F( \/ [3 s+ N: [
assign mcasp_aclkr = mcasp_aclkx;
( M6 g  ^0 I( Y' p( b- ?/ Passign mcasp_ahclkr = mcasp_ahclkx;9 W' S' q5 `& I: v
assign axr1 = axr0;

; W+ n* G3 D! A4 l& B2 }# ~) Q, A! P6 m* f# n
在OMAPL138这端,通过axr0接口发固定的数,axr1接收。
在配置MACASP的时候,发送全部取内部时钟,接收全部取外部时钟。
一直循环发送,但是接收不到。在FPGA端也没有看到时钟和信号的波形。
部分代码如下,关于edma3的部分未做变化。
* z0 o4 i# Y: h1 |
static void McASPI2SConfigure(void)8 d- S; [8 t2 k$ v* S) x
{  G7 z: k$ m5 ^4 c9 k8 \
McASPRxReset(SOC_MCASP_0_CTRL_REGS);+ d8 ^2 O) m: B( A' E( c) g
McASPTxReset(SOC_MCASP_0_CTRL_REGS);
/* Enable the FIFOs for DMA transfer */
( h  b' J3 l% u4 w, nMcASPReadFifoEnable(SOC_MCASP_0_FIFO_REGS, 1, 1);3 o( e+ \9 Y5 V; p
McASPWriteFifoEnable(SOC_MCASP_0_FIFO_REGS, 1, 1);
/* Set I2S format in the transmitter/receiver format units */: g# B0 {+ P1 y+ ~  a5 @% F
McASPRxFmtI2SSet(SOC_MCASP_0_CTRL_REGS, WORD_SIZE, SLOT_SIZE,
' b  w  s" r: Q6 TMCASP_RX_MODE_DMA);
$ Y1 h. M3 @% X/ R7 N$ rMcASPTxFmtI2SSet(SOC_MCASP_0_CTRL_REGS, WORD_SIZE, SLOT_SIZE,
9 Q" K7 p' x- xMCASP_TX_MODE_DMA);
/* Configure the frame sync. I2S shall work in TDM format with 2 slots */
8 s1 ]7 Z" T, PMcASPRxFrameSyncCfg(SOC_MCASP_0_CTRL_REGS, 2, MCASP_RX_FS_WIDTH_WORD,   V( ]% y) k  e5 y5 h
MCASP_RX_FS_EXT_BEGIN_ON_FALL_EDGE);
8 j8 a0 e/ c0 u, rMcASPTxFrameSyncCfg(SOC_MCASP_0_CTRL_REGS, 2, MCASP_TX_FS_WIDTH_WORD, : Z! Q: d4 ^$ i, n8 t/ D
MCASP_TX_FS_INT_BEGIN_ON_RIS_EDGE);
/* configure the clock for receiver */: W2 L% E, F% p* V$ L7 W+ `
McASPRxClkCfg(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_EXTERNAL, 0, 0);6 o. H7 l8 Y2 s" u# k7 I
McASPRxClkPolaritySet(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_POL_RIS_EDGE);
7 O' f  \3 [6 d- w& V$ eMcASPRxClkCheckConfig(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLKCHCK_DIV32,+ Q% \, m' [$ l8 S$ W4 H# L/ Z7 X
0x00, 0xFF);
/* configure the clock for transmitter */% K% Z( C1 Y7 P
McASPTxClkCfg(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_INTERNAL, 11, 1);5 s- g7 G6 O* d) V: I" I& n; @
McASPTxClkPolaritySet(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_POL_FALL_EDGE);
. d8 |- A# w7 r, t- @McASPTxClkCheckConfig(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLKCHCK_DIV32,; c1 X2 v- L: L( Z2 O% U9 [
0x00, 0xFF);
% K& P5 V/ h) E$ }' W% `, h1 ~5 _/ m& X0 J, z, m
/* Enable synchronization of RX and TX sections */
8 H% m3 a6 `1 N( LMcASPTxRxClkSyncEnable(SOC_MCASP_0_CTRL_REGS);
/* Enable the transmitter/receiver slots. I2S uses 2 slots */
& Q! j8 `4 w+ ^& KMcASPRxTimeSlotSet(SOC_MCASP_0_CTRL_REGS, I2S_SLOTS);4 X1 \. G! s. K+ @, X! v2 n- v; ?, l5 X
McASPTxTimeSlotSet(SOC_MCASP_0_CTRL_REGS, I2S_SLOTS);
/*
/ F& t4 d2 K1 D8 }. }2 c' [' N** Set the serializers, Currently only one serializer is set as
! y/ h$ T8 r# B; I, o5 \** transmitter and one serializer as receiver.4 u9 ^* @6 ^# f) ]; h
*/5 R) d; o; h( l) G( q! w2 G
McASPSerializerRxSet(SOC_MCASP_0_CTRL_REGS, MCASP_XSER_RX);
7 J9 t. ~5 F' F( z& WMcASPSerializerTxSet(SOC_MCASP_0_CTRL_REGS, MCASP_XSER_TX);
/*1 t! n: {) y" M  y0 y% N7 @% u
** Configure the McASP pins
8 i  `* M8 i' W' A- S  X** Input - Frame Sync, Clock and Serializer Rx
% b" U5 d8 i( ]% ], s. |& a** Output - Serializer Tx is connected to the input of the codec * d9 Q) B* P9 R! A
*/: D8 i* J7 m& A3 {5 b
McASPPinMcASPSet(SOC_MCASP_0_CTRL_REGS, 0xFFFFFFFF);
7 N3 ?# F! o7 J, p4 PMcASPPinDirOutputSet(SOC_MCASP_0_CTRL_REGS,MCASP_PIN_AXR(MCASP_XSER_TX));% r* E5 p# }! N) C
McASPPinDirInputSet(SOC_MCASP_0_CTRL_REGS, MCASP_PIN_AFSX
* m) y( X: {5 K; }: P, O' o1 U) w| MCASP_PIN_ACLKX
: N9 Y% w9 A' N) \4 H  R3 S  y: j| MCASP_PIN_AHCLKX
$ W2 V) O2 ]: G. Y| MCASP_PIN_AXR(MCASP_XSER_RX));
/* Enable error interrupts for McASP */+ a0 p9 g8 V/ r# }0 i0 M
McASPTxIntEnable(SOC_MCASP_0_CTRL_REGS, MCASP_TX_DMAERROR ) u0 L! J) f4 _  [
| MCASP_TX_CLKFAIL 2 J6 L! ~" g6 _" }6 ]
| MCASP_TX_SYNCERROR$ _" g8 |; K) g  m+ \- w9 n" P
| MCASP_TX_UNDERRUN);
McASPRxIntEnable(SOC_MCASP_0_CTRL_REGS, MCASP_RX_DMAERROR   @/ l0 s6 h7 K6 @5 i7 {& u' P" Q0 {
| MCASP_RX_CLKFAIL2 R. D2 U: U! B2 S
| MCASP_RX_SYNCERROR
; G9 l! W' Q7 H1 T& C| MCASP_RX_OVERRUN);
, g2 Y" p* T7 h}
static void I2SDataTxRxActivate(void)7 O- P, k; k! f0 S% g- l# A6 p. V
{* [" G6 R  G. b% s- ^' [
/* Start the clocks */9 E2 ]1 `* n. K; a
McASPRxClkStart(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_EXTERNAL);5 w9 Z! k6 p2 M, O6 ~# {
McASPTxClkStart(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_INTERNAL);
/* Enable EDMA for the transfer */
6 P8 M& r" v) K$ J& WEDMA3EnableTransfer(SOC_EDMA30CC_0_REGS, EDMA3_CHA_MCASP0_RX,
0 W' U1 W0 F# rEDMA3_TRIG_MODE_EVENT);
, T" J2 b: o- A$ j0 {8 sEDMA3EnableTransfer(SOC_EDMA30CC_0_REGS,
6 C1 G+ j0 L$ ZEDMA3_CHA_MCASP0_TX, EDMA3_TRIG_MODE_EVENT);
/* Activate the serializers */
7 Q  G, r8 [) r- m7 |McASPRxSerActivate(SOC_MCASP_0_CTRL_REGS);; Y7 j7 ^5 s3 ?0 [; q9 v# |
McASPTxSerActivate(SOC_MCASP_0_CTRL_REGS);
/* make sure that the XDATA bit is cleared to zero */% V& d/ V. d# q% ]$ c. f
while(McASPTxStatusGet(SOC_MCASP_0_CTRL_REGS) & MCASP_TX_STAT_DATAREADY);
/* Activate the state machines */' d5 z: N  D4 ?  @+ ?6 z* I& {" S
McASPRxEnable(SOC_MCASP_0_CTRL_REGS);
* T- l: P  |1 E% A! I% a, }1 }! {7 ~McASPTxEnable(SOC_MCASP_0_CTRL_REGS);
) T3 Z; L. u6 c+ \1 e) Z3 H}

$ Q# v9 `! I- c* z0 A/ c) ^- [: k/ g
请问:问题出在哪了,时钟按照这样配是否有错。
另外我看XDATA一直是0,接收的rxbuf0,1,2里有一般全是FFFF一半全是0.

  ~3 C8 f6 C( h1 \3 X
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