MCASP自环配置。 - OMAP-L138 - 嵌入式开发者社区 - 51ele.net
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[未解决] MCASP自环配置。

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发表于 2018-11-7 13:28:07 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
我项目上用OMAPL138的板子MCASP的引脚都是链接的FPGA,所以在FPGA这端设置的MCASP自环。把axr0接收到的通过axr1发回去。
部分代码如下
input mcasp_afsx,2 L* v# V( I4 l7 s8 v
input mcasp_ahclkx,( C3 a( }, V/ a3 }
input mcasp_aclkx,
8 \, T7 [' l+ l/ @$ P  b6 ?input axr0,& c+ [8 {! o8 k5 i" y" \# {

6 g6 ~" D$ |! ?: k/ S! uoutput mcasp_afsr,
% k. Y& |6 [" X7 `) loutput mcasp_ahclkr,$ t" @1 u+ Q) E6 @( l
output mcasp_aclkr,: D% D$ t& R6 |3 U* B- {
output axr1," k8 m/ j7 c- m- H' _7 p
assign mcasp_afsr = mcasp_afsx;- V; P! u" m( K& k8 {
assign mcasp_aclkr = mcasp_aclkx;
7 K% q1 B2 S# v$ J/ Zassign mcasp_ahclkr = mcasp_ahclkx;5 Q; c" L) }+ t0 Q4 Q7 n
assign axr1 = axr0;
" |3 l( y; x# {
- p! a' G3 ~+ V' S# y/ M. `
在OMAPL138这端,通过axr0接口发固定的数,axr1接收。
在配置MACASP的时候,发送全部取内部时钟,接收全部取外部时钟。
一直循环发送,但是接收不到。在FPGA端也没有看到时钟和信号的波形。
部分代码如下,关于edma3的部分未做变化。
' r7 M6 h9 T, y
static void McASPI2SConfigure(void)( P: M# b  o6 Y8 t' C: N) s# j
{3 B) Y- |  {, v8 g# s" a% R
McASPRxReset(SOC_MCASP_0_CTRL_REGS);
$ q2 L) m/ N% t3 B( E& u+ |McASPTxReset(SOC_MCASP_0_CTRL_REGS);
/* Enable the FIFOs for DMA transfer */
3 ]8 Z, I. i9 j+ r6 w5 Z; fMcASPReadFifoEnable(SOC_MCASP_0_FIFO_REGS, 1, 1);
  ^/ U7 A; G: e3 IMcASPWriteFifoEnable(SOC_MCASP_0_FIFO_REGS, 1, 1);
/* Set I2S format in the transmitter/receiver format units */4 r7 k7 \  c* o& k) e" x& V
McASPRxFmtI2SSet(SOC_MCASP_0_CTRL_REGS, WORD_SIZE, SLOT_SIZE,9 n0 u* W  P* [! Z, o' o
MCASP_RX_MODE_DMA);% q* c( V6 |1 `
McASPTxFmtI2SSet(SOC_MCASP_0_CTRL_REGS, WORD_SIZE, SLOT_SIZE,& ]& P0 O, g5 y
MCASP_TX_MODE_DMA);
/* Configure the frame sync. I2S shall work in TDM format with 2 slots */" M; G* d+ l+ h1 j
McASPRxFrameSyncCfg(SOC_MCASP_0_CTRL_REGS, 2, MCASP_RX_FS_WIDTH_WORD,
! ]& M* s& e( g% SMCASP_RX_FS_EXT_BEGIN_ON_FALL_EDGE);
7 m" E1 h3 L% U  vMcASPTxFrameSyncCfg(SOC_MCASP_0_CTRL_REGS, 2, MCASP_TX_FS_WIDTH_WORD, $ k8 Q4 _' W; t  z7 X% J2 \
MCASP_TX_FS_INT_BEGIN_ON_RIS_EDGE);
/* configure the clock for receiver */
$ I+ l/ j6 M0 l% c) c4 {+ j& DMcASPRxClkCfg(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_EXTERNAL, 0, 0);* p$ I# u3 d2 _" M
McASPRxClkPolaritySet(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_POL_RIS_EDGE); 3 ?% m, Y+ z& Z& ~* L
McASPRxClkCheckConfig(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLKCHCK_DIV32,7 w5 X' s$ Z7 z7 d( k1 C+ P
0x00, 0xFF);
/* configure the clock for transmitter */  f  l4 D+ Q* \
McASPTxClkCfg(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_INTERNAL, 11, 1);
) {  @2 P, g# S& A( e) p+ b; R: D% nMcASPTxClkPolaritySet(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_POL_FALL_EDGE);
2 K& z+ w4 R8 j8 ^- a$ S! ]McASPTxClkCheckConfig(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLKCHCK_DIV32,( l( O4 e) m3 D5 U6 N5 ?4 H+ J9 O4 H
0x00, 0xFF);
" m$ I1 c0 F& o  O3 N* s6 F' K" }' P& h9 u+ m% r
/* Enable synchronization of RX and TX sections */
8 q/ [6 U4 [2 u% ?+ ^* LMcASPTxRxClkSyncEnable(SOC_MCASP_0_CTRL_REGS);
/* Enable the transmitter/receiver slots. I2S uses 2 slots */4 G' l* ~- _2 N4 v5 e& q
McASPRxTimeSlotSet(SOC_MCASP_0_CTRL_REGS, I2S_SLOTS);/ C1 f; v3 ~) k" z
McASPTxTimeSlotSet(SOC_MCASP_0_CTRL_REGS, I2S_SLOTS);
/*
& p- G' `- v- m7 F6 T. [' Y** Set the serializers, Currently only one serializer is set as
$ k( w( t) F1 o: a' X% P# h** transmitter and one serializer as receiver.
+ c* b. S) B8 K- s0 f  I4 S*/7 ]% d( N( P2 \; B
McASPSerializerRxSet(SOC_MCASP_0_CTRL_REGS, MCASP_XSER_RX);
" Z5 w# V# R0 {5 I& s. KMcASPSerializerTxSet(SOC_MCASP_0_CTRL_REGS, MCASP_XSER_TX);
/*
* e; y& o) d0 e** Configure the McASP pins
6 {- x  L: s7 g9 C$ s$ I** Input - Frame Sync, Clock and Serializer Rx
8 T5 T& r6 i* m** Output - Serializer Tx is connected to the input of the codec - H3 O1 e7 u) s* h1 S2 n
*/! o6 {+ ^" C: K* F, A1 I
McASPPinMcASPSet(SOC_MCASP_0_CTRL_REGS, 0xFFFFFFFF);
1 A& @3 h& h4 W  C* o6 _McASPPinDirOutputSet(SOC_MCASP_0_CTRL_REGS,MCASP_PIN_AXR(MCASP_XSER_TX));0 X/ H7 Q6 [$ {3 B1 r7 c' P7 Q
McASPPinDirInputSet(SOC_MCASP_0_CTRL_REGS, MCASP_PIN_AFSX
# ?7 n# u. `6 X( i| MCASP_PIN_ACLKX
" [- k* }- Z: O& f$ D| MCASP_PIN_AHCLKX
0 M( e4 Q# U$ s6 t- C0 F| MCASP_PIN_AXR(MCASP_XSER_RX));
/* Enable error interrupts for McASP */4 b  V/ {0 U  _4 }9 B
McASPTxIntEnable(SOC_MCASP_0_CTRL_REGS, MCASP_TX_DMAERROR
+ T+ E6 h& B! R- C$ @* b| MCASP_TX_CLKFAIL 8 \2 P# x, {, m3 p( u" c7 k
| MCASP_TX_SYNCERROR
4 i# r% _$ @5 l6 ^  t| MCASP_TX_UNDERRUN);
McASPRxIntEnable(SOC_MCASP_0_CTRL_REGS, MCASP_RX_DMAERROR ( j& j% f7 ?/ I) {7 H
| MCASP_RX_CLKFAIL
/ h9 I: m/ ^* ?6 e/ U/ K) F| MCASP_RX_SYNCERROR 1 ?3 f2 Y  C8 |
| MCASP_RX_OVERRUN);
" ~& C$ j1 m0 J& {}
static void I2SDataTxRxActivate(void)
+ Z, r5 l" @0 M) C% c{3 m% S2 q) g& B, f! `
/* Start the clocks */
# _/ i( T7 C5 g$ K7 \McASPRxClkStart(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_EXTERNAL);6 @, p  Q1 v( O9 }
McASPTxClkStart(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_INTERNAL);
/* Enable EDMA for the transfer */' _' y  U+ B! N* Z( g
EDMA3EnableTransfer(SOC_EDMA30CC_0_REGS, EDMA3_CHA_MCASP0_RX,
- g* I: S) c4 I4 y$ i! H; d; s! ^EDMA3_TRIG_MODE_EVENT);+ M- q3 g" x, t. e7 \3 [
EDMA3EnableTransfer(SOC_EDMA30CC_0_REGS,
0 r1 Q" u/ X9 i4 P/ S; i/ {8 CEDMA3_CHA_MCASP0_TX, EDMA3_TRIG_MODE_EVENT);
/* Activate the serializers */$ z1 t3 T. M" f; a0 {4 h7 A1 z
McASPRxSerActivate(SOC_MCASP_0_CTRL_REGS);
5 x- V( s9 P2 _* W) PMcASPTxSerActivate(SOC_MCASP_0_CTRL_REGS);
/* make sure that the XDATA bit is cleared to zero */6 X& _; _8 T# F9 ^1 M/ h7 B+ b; ]
while(McASPTxStatusGet(SOC_MCASP_0_CTRL_REGS) & MCASP_TX_STAT_DATAREADY);
/* Activate the state machines */
8 m, [/ J) u6 v2 d- A7 TMcASPRxEnable(SOC_MCASP_0_CTRL_REGS);) x( j4 ^$ O- b, O% l( L
McASPTxEnable(SOC_MCASP_0_CTRL_REGS);
" C6 h, O4 y. {; H}

: h( S8 i% `% q
请问:问题出在哪了,时钟按照这样配是否有错。
另外我看XDATA一直是0,接收的rxbuf0,1,2里有一般全是FFFF一半全是0.

# O$ e+ n) k3 l0 u0 h
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