MCASP自环配置。 - OMAP-L138 - 嵌入式开发者社区 - 51ele.net
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[未解决] MCASP自环配置。

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发表于 2018-11-7 13:28:07 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
我项目上用OMAPL138的板子MCASP的引脚都是链接的FPGA,所以在FPGA这端设置的MCASP自环。把axr0接收到的通过axr1发回去。
部分代码如下
input mcasp_afsx,! e2 \9 Z3 w! }
input mcasp_ahclkx,
: D6 N6 T  C) x' v) K* [input mcasp_aclkx,
& A" [& P4 z& \- Hinput axr0,- H  Z4 @  p: K9 a2 e5 M+ ]
; Q6 o2 L; {' ?8 _
output mcasp_afsr,- r1 n- p0 o: b$ f- m* \4 @2 x% l
output mcasp_ahclkr,
3 h( u: m) I& L( A/ f5 ^output mcasp_aclkr,6 ^8 K% \. w7 R9 ^0 X9 ]
output axr1,
4 a4 A, [9 S. W- u( \( ?, ^
assign mcasp_afsr = mcasp_afsx;
0 E7 t! x% C5 Nassign mcasp_aclkr = mcasp_aclkx;
* d+ l0 N  p' V+ N9 v5 ?assign mcasp_ahclkr = mcasp_ahclkx;6 X" H4 }7 [3 _- Z. U! p. i
assign axr1 = axr0;
" w8 k3 Y& Q, l

  M9 c. N7 E+ O& K& B; x' t
在OMAPL138这端,通过axr0接口发固定的数,axr1接收。
在配置MACASP的时候,发送全部取内部时钟,接收全部取外部时钟。
一直循环发送,但是接收不到。在FPGA端也没有看到时钟和信号的波形。
部分代码如下,关于edma3的部分未做变化。
) G8 h0 O' u% k8 Q) ]/ b
static void McASPI2SConfigure(void)0 s: n5 l% B" Y2 ^& I5 Q
{
0 ?7 y2 ~. G9 F# }' wMcASPRxReset(SOC_MCASP_0_CTRL_REGS);
( g6 K! s1 q3 q% y& X) VMcASPTxReset(SOC_MCASP_0_CTRL_REGS);
/* Enable the FIFOs for DMA transfer */  J9 i& b/ @7 l+ {% G2 i1 v
McASPReadFifoEnable(SOC_MCASP_0_FIFO_REGS, 1, 1);
) V' T( c. w' P2 d) ^; _McASPWriteFifoEnable(SOC_MCASP_0_FIFO_REGS, 1, 1);
/* Set I2S format in the transmitter/receiver format units */3 }) U% d1 N# c$ S
McASPRxFmtI2SSet(SOC_MCASP_0_CTRL_REGS, WORD_SIZE, SLOT_SIZE,
4 X8 U" y0 o' P' d# aMCASP_RX_MODE_DMA);1 _9 D5 x3 q" K& U, V# ?
McASPTxFmtI2SSet(SOC_MCASP_0_CTRL_REGS, WORD_SIZE, SLOT_SIZE,
7 z/ E7 v+ l+ W9 IMCASP_TX_MODE_DMA);
/* Configure the frame sync. I2S shall work in TDM format with 2 slots */
! _* j- ]2 Z; {  j0 F, E$ bMcASPRxFrameSyncCfg(SOC_MCASP_0_CTRL_REGS, 2, MCASP_RX_FS_WIDTH_WORD,
- j- s/ S/ Z/ ]/ S" f! T& M8 rMCASP_RX_FS_EXT_BEGIN_ON_FALL_EDGE);* D9 ?, g, G  B
McASPTxFrameSyncCfg(SOC_MCASP_0_CTRL_REGS, 2, MCASP_TX_FS_WIDTH_WORD,
5 s" D  i* Y( y1 H1 l( [MCASP_TX_FS_INT_BEGIN_ON_RIS_EDGE);
/* configure the clock for receiver */
7 I! r) I; d  [7 E' A& W5 E, BMcASPRxClkCfg(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_EXTERNAL, 0, 0);
% i; |8 M- }# BMcASPRxClkPolaritySet(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_POL_RIS_EDGE);
/ L; E! a) z1 y4 g. H" vMcASPRxClkCheckConfig(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLKCHCK_DIV32,+ C( B- r2 V7 ~5 x
0x00, 0xFF);
/* configure the clock for transmitter */* R3 C4 E8 x$ L- d3 ?, ]6 `1 B
McASPTxClkCfg(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_INTERNAL, 11, 1);& C) A4 \# _6 i+ z0 q
McASPTxClkPolaritySet(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_POL_FALL_EDGE); * }5 T9 t0 z3 @! C
McASPTxClkCheckConfig(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLKCHCK_DIV32,# ?* l0 x3 ]/ L4 l8 x3 L2 z
0x00, 0xFF);
# a/ N. M* \* A9 X/ j7 L0 J
5 L1 F5 ^" N4 i8 j5 h/* Enable synchronization of RX and TX sections */ & v( G+ U! Y+ e2 w6 S1 o  H" W+ J
McASPTxRxClkSyncEnable(SOC_MCASP_0_CTRL_REGS);
/* Enable the transmitter/receiver slots. I2S uses 2 slots */
1 f2 \0 j) e/ ]2 R8 x5 bMcASPRxTimeSlotSet(SOC_MCASP_0_CTRL_REGS, I2S_SLOTS);8 d+ p& J; W& l. i# {7 [
McASPTxTimeSlotSet(SOC_MCASP_0_CTRL_REGS, I2S_SLOTS);
/*
! E9 ^8 i! P3 E. o2 W. ^** Set the serializers, Currently only one serializer is set as* `$ z, |5 P7 {* `% E* H4 n0 S
** transmitter and one serializer as receiver.% `9 x. x! o+ ^) A! K8 N2 i2 }
*/) r* J' O+ F' v
McASPSerializerRxSet(SOC_MCASP_0_CTRL_REGS, MCASP_XSER_RX);: D6 ]' o* k" S* Q) _* |
McASPSerializerTxSet(SOC_MCASP_0_CTRL_REGS, MCASP_XSER_TX);
/*
7 c& M, ]# C- t9 }** Configure the McASP pins
' J% i, x  p; d** Input - Frame Sync, Clock and Serializer Rx
( Q  `* {( }' Q3 [6 ?; s** Output - Serializer Tx is connected to the input of the codec 9 K" A; ~0 ~. ~' M5 @, z
*/( N( p1 z* L; B9 ?. Y! N9 r7 g
McASPPinMcASPSet(SOC_MCASP_0_CTRL_REGS, 0xFFFFFFFF);
/ g& v7 g+ s3 f+ lMcASPPinDirOutputSet(SOC_MCASP_0_CTRL_REGS,MCASP_PIN_AXR(MCASP_XSER_TX));4 t7 I. ]* {$ L4 e1 q+ {6 t. r
McASPPinDirInputSet(SOC_MCASP_0_CTRL_REGS, MCASP_PIN_AFSX
/ L( B1 _7 m) y/ M6 U: f| MCASP_PIN_ACLKX+ L0 u4 v5 q% o7 a
| MCASP_PIN_AHCLKX6 ^+ P( U4 v% c+ J# q9 A2 P! ]; E
| MCASP_PIN_AXR(MCASP_XSER_RX));
/* Enable error interrupts for McASP */2 o! }* X, T; T* X4 d. o- J0 x
McASPTxIntEnable(SOC_MCASP_0_CTRL_REGS, MCASP_TX_DMAERROR
& h" r2 H- m0 Z. q5 X" `7 i7 L| MCASP_TX_CLKFAIL
$ ?" Z! T3 A7 c, l| MCASP_TX_SYNCERROR3 E" c4 l% q3 ?/ e
| MCASP_TX_UNDERRUN);
McASPRxIntEnable(SOC_MCASP_0_CTRL_REGS, MCASP_RX_DMAERROR   {  H3 d" W6 K5 y5 ~( O4 K
| MCASP_RX_CLKFAIL7 I" O5 r: {+ y3 ^" S
| MCASP_RX_SYNCERROR 2 k" `% o' \: q8 V) p5 T
| MCASP_RX_OVERRUN);9 w" u  u( v6 {! t0 I8 r; t
}
static void I2SDataTxRxActivate(void)
4 c! h! b9 i/ ~, {; _9 W{2 G+ r5 z8 G0 ~& ^. A4 H8 M
/* Start the clocks */' K. Q) c3 ]5 d5 j; e
McASPRxClkStart(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_EXTERNAL);
; `2 f0 R1 S2 P+ t( PMcASPTxClkStart(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_INTERNAL);
/* Enable EDMA for the transfer */
% J& ~! E4 {& `4 r- R  nEDMA3EnableTransfer(SOC_EDMA30CC_0_REGS, EDMA3_CHA_MCASP0_RX,
1 V. l7 n) `# K6 PEDMA3_TRIG_MODE_EVENT);$ D& m6 X" t+ }9 Q; m7 Z
EDMA3EnableTransfer(SOC_EDMA30CC_0_REGS,
$ C: o& E  a  a9 z- nEDMA3_CHA_MCASP0_TX, EDMA3_TRIG_MODE_EVENT);
/* Activate the serializers */" H( W# K" D+ _7 N/ G# O
McASPRxSerActivate(SOC_MCASP_0_CTRL_REGS);
7 P1 s) @9 t: tMcASPTxSerActivate(SOC_MCASP_0_CTRL_REGS);
/* make sure that the XDATA bit is cleared to zero */- T# H- x! V% C
while(McASPTxStatusGet(SOC_MCASP_0_CTRL_REGS) & MCASP_TX_STAT_DATAREADY);
/* Activate the state machines */
/ K2 r: r8 k7 J/ d  z! }& i8 H" XMcASPRxEnable(SOC_MCASP_0_CTRL_REGS);
# K$ d0 a; ?8 Q9 U9 Q% z1 e6 UMcASPTxEnable(SOC_MCASP_0_CTRL_REGS);5 s: q. ^9 }/ V3 O, F
}
/ @$ l- z* Q4 K3 n' s
请问:问题出在哪了,时钟按照这样配是否有错。
另外我看XDATA一直是0,接收的rxbuf0,1,2里有一般全是FFFF一半全是0.

; Y* L& V3 p: g  h; }
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