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程序upp通讯部分是从demo中uPP_B_TO_A移植过来。
& s1 i. \$ c0 m1 A! [+ d2 E1 l4 D/ s6 D* y0 N5 w
1.linux系统下由arm控制dsp通过upp往fpga发送数据，程序运行过程中，开始upp数据传输接受正常。1 h* ~- d) A' H# u& h# U c
! B A- m# T7 W* I1 o2.由arm控制dsp不停的启动，停止upp数据发送；在某一次发送时出现数据错位（通过fpga从数据总线抓取数据），然后fpga接受的数据都是错位的，重新加载dsp程序也无法恢复fpga接收正常数据，重启上电L138后再运行dsp程序upp的数据恢复正常。
2 p. v! B, b$ l2 V; w" a3 W' d# d$ O+ y3 x
3.通过dlb寄存器进行BA回环发现错误的数据情况如下（与通过fpga从数据总线抓取数据一致）：发送缓冲的数据顺序是1~128，但是回环到A通道，收到的数据是64~127,0~63。在测试过程中仿真器查看到UPQD0-2的值跟正常时一样，发送区数据顺序正确（在调试过程中查看寄存器及发送区地址，发送区是8字节对齐的，寄存器值没有发现异常） 。经过一段时间的测试，发现不是数据错位，而是0-63的数据是上次发送的值，二64-127的数据是本次的值。每次错误的字节数不一致，有时是前面112个数据都是上次的，有时只有16个数据是上次，64是最多的情况。5 i# s" t; h! ~+ x$ q ]
8 n F3 c) p- \6 x/ o
4.upp发送数据是通过fpga给dsp的gpio发送周期40us的方波，但是dsp以40us的间隔在gpio中断处理程序中往fpga送1行512字节的数据；
" ]! b) a" f, p7 @( ]6 e" _; a6 U5 @2 p, v
2 ]; m+ v! M1 q附：发送时钟设置为37.5M，传输为b通道16bit传输，实际测量upp发送的enable信号持续大概7us；中间fpga没送wait信号；UPTCR的发送设为64和256都试过，结果都会出现错位。9 x! D4 o& N9 `4 w. C# b) a6 \
部分定义如下2 f- p+ f0 N: \: I6 R
#define upp_line_size (128)
3 z1 W, ~& a3 O; t! H#define upp_line_count_s (1)
3 M7 z- Y$ p" [2 _3 C#define upp_line_count_r (1)' I1 h. m$ A! q/ b
#define upp_frame_size_s (upp_line_size * upp_line_count_s); u( O$ |' ~& a
#define upp_frame_size_r (upp_line_size * upp_line_count_r)5 l1 B* Y2 Z; Y3 X: B6 d4 U
#define upp_line_offset_s (upp_line_size)9 X9 q( S: A$ `# e' a" E
#define upp_line_offset_r (upp_line_size)
$ o/ f2 m# ?$ E0 h9 |. c5 k) ]; r) a7 d! `+ [8 b$ e/ d6 ~$ s1 g
#pragma DATA_ALIGN(upp_buffer_s, 8)
; F5 }" G1 b$ H#pragma DATA_ALIGN(upp_buffer_r, 8)
8 G4 l5 Y4 D, G0 _% u! F3 W' Bvolatile Uint32 upp_buffer_s[upp_frame_size_s];
3 ^2 i9 a+ Z: [volatile Uint32 upp_buffer_r[upp_frame_size_s];2 ~8 r$ H% Z, P/ ^
) S% |! @: R- v
请教：这可能是出现什么问题了。
3 I" N8 ?% I$ I! G# p
; Q9 k5 p: h- `, |% S7 P% k |
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发表于 2016-11-1 10:53:30
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