MCASP自环配置。 - OMAP-L138 - 嵌入式开发者社区 - 51ele.net
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[未解决] MCASP自环配置。

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发表于 2018-11-7 13:28:07 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
我项目上用OMAPL138的板子MCASP的引脚都是链接的FPGA,所以在FPGA这端设置的MCASP自环。把axr0接收到的通过axr1发回去。
部分代码如下
input mcasp_afsx,
9 G3 Z8 d" D( Hinput mcasp_ahclkx,
3 o" y! z3 k& z7 _3 y4 E6 Dinput mcasp_aclkx,, K: L; s, _( b2 {8 i9 ~
input axr0,
) ]  Z) B/ }9 y$ b1 b8 l* W
9 R8 K- h" O$ U( t8 |! qoutput mcasp_afsr,+ x8 y/ C1 J* K7 \* I: x; M6 y
output mcasp_ahclkr,* O% f3 C- L7 O
output mcasp_aclkr,
" r) `7 B/ o( T% f' {output axr1,
: ^$ f2 p3 k: w$ P
assign mcasp_afsr = mcasp_afsx;
5 Q. @- p  s( v- y! y' rassign mcasp_aclkr = mcasp_aclkx;
, K" ?" o7 N$ `" Rassign mcasp_ahclkr = mcasp_ahclkx;
: \, M; ~1 {9 L0 v$ {! Oassign axr1 = axr0;

- K  i% l& k4 n
6 R5 N7 ?: ^5 w" m' C& O1 N' h6 w
在OMAPL138这端,通过axr0接口发固定的数,axr1接收。
在配置MACASP的时候,发送全部取内部时钟,接收全部取外部时钟。
一直循环发送,但是接收不到。在FPGA端也没有看到时钟和信号的波形。
部分代码如下,关于edma3的部分未做变化。
4 V+ q6 o. P2 _
static void McASPI2SConfigure(void)! n; j- R( _3 D, G
{
$ n, J- {, o; c6 v& ~McASPRxReset(SOC_MCASP_0_CTRL_REGS);. ~5 ~2 z' s" _( b" }- k  T
McASPTxReset(SOC_MCASP_0_CTRL_REGS);
/* Enable the FIFOs for DMA transfer */( ^$ F7 Q7 S  @/ _" a) E+ W
McASPReadFifoEnable(SOC_MCASP_0_FIFO_REGS, 1, 1);0 C; J8 n& s" G# N1 e
McASPWriteFifoEnable(SOC_MCASP_0_FIFO_REGS, 1, 1);
/* Set I2S format in the transmitter/receiver format units */2 X3 R0 C" v0 D/ S. B0 l' c
McASPRxFmtI2SSet(SOC_MCASP_0_CTRL_REGS, WORD_SIZE, SLOT_SIZE,
" Q' r) p" Z& G- ^7 `5 g; R% VMCASP_RX_MODE_DMA);
9 o  k1 x* _4 v) O$ w# cMcASPTxFmtI2SSet(SOC_MCASP_0_CTRL_REGS, WORD_SIZE, SLOT_SIZE,2 Y2 @4 z& T9 x# K) r4 p% f" E
MCASP_TX_MODE_DMA);
/* Configure the frame sync. I2S shall work in TDM format with 2 slots */4 |( e( F$ E5 W0 v
McASPRxFrameSyncCfg(SOC_MCASP_0_CTRL_REGS, 2, MCASP_RX_FS_WIDTH_WORD, 9 j7 ?( i" b0 r: B# ^% U$ h% Q
MCASP_RX_FS_EXT_BEGIN_ON_FALL_EDGE);# T" ]9 q$ [! j
McASPTxFrameSyncCfg(SOC_MCASP_0_CTRL_REGS, 2, MCASP_TX_FS_WIDTH_WORD,
8 j: H8 c/ S' ^1 m$ b8 }! {MCASP_TX_FS_INT_BEGIN_ON_RIS_EDGE);
/* configure the clock for receiver */$ A) L, h- t4 R$ w9 o
McASPRxClkCfg(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_EXTERNAL, 0, 0);
! S: n& l# I: ]6 K0 I4 mMcASPRxClkPolaritySet(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_POL_RIS_EDGE);
5 ~! _. R( W/ e6 `. h9 gMcASPRxClkCheckConfig(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLKCHCK_DIV32,( U. U4 b8 z8 H
0x00, 0xFF);
/* configure the clock for transmitter */3 X: l9 [- \' ]8 U- c6 b: D6 g9 s
McASPTxClkCfg(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_INTERNAL, 11, 1);2 C' Q0 t3 x; X) P1 R3 l' V
McASPTxClkPolaritySet(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_POL_FALL_EDGE); ! X- h/ ?" J9 p$ G0 i; h6 h! l
McASPTxClkCheckConfig(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLKCHCK_DIV32,6 [. o8 U! f8 m$ Z! R
0x00, 0xFF);
% x0 g4 [4 a* {2 x0 S. @' e2 o1 o* S' z! c! i" y
/* Enable synchronization of RX and TX sections */
  M- o2 ~( `! [McASPTxRxClkSyncEnable(SOC_MCASP_0_CTRL_REGS);
/* Enable the transmitter/receiver slots. I2S uses 2 slots */
% X7 _) |; Q5 o4 N8 qMcASPRxTimeSlotSet(SOC_MCASP_0_CTRL_REGS, I2S_SLOTS);
: ~% l/ G* {7 EMcASPTxTimeSlotSet(SOC_MCASP_0_CTRL_REGS, I2S_SLOTS);
/*
; }- k: h0 r8 S4 a** Set the serializers, Currently only one serializer is set as" q1 ~5 C: m3 O8 K5 L" Z$ J
** transmitter and one serializer as receiver.# H" K9 W& i% O
*/
8 L, s+ w+ c, uMcASPSerializerRxSet(SOC_MCASP_0_CTRL_REGS, MCASP_XSER_RX);
  i( }# x) G4 N2 YMcASPSerializerTxSet(SOC_MCASP_0_CTRL_REGS, MCASP_XSER_TX);
/*
8 r/ ~9 l6 T% J/ _. P# Y7 t9 G** Configure the McASP pins
* c9 e8 c7 g, F$ W** Input - Frame Sync, Clock and Serializer Rx
- ?+ C8 Q% B5 x2 M8 z** Output - Serializer Tx is connected to the input of the codec 8 g' {& _- w! u9 S
*/) b/ d) g0 {; Q1 V
McASPPinMcASPSet(SOC_MCASP_0_CTRL_REGS, 0xFFFFFFFF);" |# B0 ]9 J1 V+ J, _; }* A
McASPPinDirOutputSet(SOC_MCASP_0_CTRL_REGS,MCASP_PIN_AXR(MCASP_XSER_TX));
( R( o6 k7 ]" kMcASPPinDirInputSet(SOC_MCASP_0_CTRL_REGS, MCASP_PIN_AFSX) H: Y3 Z$ b2 p! v) I0 }- X1 w  ]! `
| MCASP_PIN_ACLKX
4 e' I) J5 B3 n; ^| MCASP_PIN_AHCLKX
  V/ e  D9 G# ?4 x| MCASP_PIN_AXR(MCASP_XSER_RX));
/* Enable error interrupts for McASP */
) l7 Q( H1 S- n6 Y2 `McASPTxIntEnable(SOC_MCASP_0_CTRL_REGS, MCASP_TX_DMAERROR % D; a9 N) P+ f
| MCASP_TX_CLKFAIL - g0 E. l5 W0 b; y3 I& S: ^/ p
| MCASP_TX_SYNCERROR
2 t( ~& R: R& _| MCASP_TX_UNDERRUN);
McASPRxIntEnable(SOC_MCASP_0_CTRL_REGS, MCASP_RX_DMAERROR 6 E3 L8 t. H2 y3 R) T. W" p! D
| MCASP_RX_CLKFAIL
' O: B: p/ i/ Y| MCASP_RX_SYNCERROR : g, `/ R& Q# n: o  @7 @
| MCASP_RX_OVERRUN);
# r$ \" u6 G3 |% f" Z! n& O}
static void I2SDataTxRxActivate(void)# F4 X% T( i6 H% t7 {* g2 V. j2 e4 c6 O5 }
{
0 m. n+ p1 o" u3 s1 t4 _; z/* Start the clocks */0 [( ]5 I1 \% Q9 V$ A, c
McASPRxClkStart(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_EXTERNAL);4 ?/ n8 E; Q3 E: Z3 b; j% m
McASPTxClkStart(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_INTERNAL);
/* Enable EDMA for the transfer */9 w: k2 P7 b5 `$ T# n8 q* t4 x
EDMA3EnableTransfer(SOC_EDMA30CC_0_REGS, EDMA3_CHA_MCASP0_RX,) r) U/ c6 a8 D: Y
EDMA3_TRIG_MODE_EVENT);& M; {! q( Q' c
EDMA3EnableTransfer(SOC_EDMA30CC_0_REGS,
& |, k$ {1 {# Z8 l3 H$ hEDMA3_CHA_MCASP0_TX, EDMA3_TRIG_MODE_EVENT);
/* Activate the serializers */
9 x4 w1 r; `9 N4 w! LMcASPRxSerActivate(SOC_MCASP_0_CTRL_REGS);
$ \5 D* o. X( a/ j4 B  z' wMcASPTxSerActivate(SOC_MCASP_0_CTRL_REGS);
/* make sure that the XDATA bit is cleared to zero */
6 G: c1 ?& n+ P. U) [while(McASPTxStatusGet(SOC_MCASP_0_CTRL_REGS) & MCASP_TX_STAT_DATAREADY);
/* Activate the state machines */, O, F/ T: b( ]* U, k+ Y
McASPRxEnable(SOC_MCASP_0_CTRL_REGS);  i5 q( V+ T2 ~' Y! z. v
McASPTxEnable(SOC_MCASP_0_CTRL_REGS);
/ Q7 O9 w, p! }}
5 [* Y/ f3 t+ s4 B' m! I4 m7 u
请问:问题出在哪了,时钟按照这样配是否有错。
另外我看XDATA一直是0,接收的rxbuf0,1,2里有一般全是FFFF一半全是0.

/ k9 c% s: ?) \& {, W+ u
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