MCASP自环配置。 - OMAP-L138 - 嵌入式开发者社区 - 51ele.net
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[未解决] MCASP自环配置。

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发表于 2018-11-7 13:28:07 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
我项目上用OMAPL138的板子MCASP的引脚都是链接的FPGA,所以在FPGA这端设置的MCASP自环。把axr0接收到的通过axr1发回去。
部分代码如下
input mcasp_afsx,1 X* b! b! p$ M: m& Q" u5 s* N
input mcasp_ahclkx,
$ D5 A7 \9 n- C! R3 P, _" f' r3 [input mcasp_aclkx," J1 M, `  t3 D, N
input axr0,
) Q6 f* x' L- A. s: \1 _  W; B# _
% u, b  K9 w( L9 r8 I6 o$ t1 x! Goutput mcasp_afsr,( v7 ?7 P1 t' g# H5 N1 s
output mcasp_ahclkr,
; e5 B2 K( l% \( u9 joutput mcasp_aclkr,
; Q3 F& [9 u+ m( ?output axr1,
) J8 Y. T1 D% k
assign mcasp_afsr = mcasp_afsx;. S( {! t) ^; n2 y% Y
assign mcasp_aclkr = mcasp_aclkx;0 k# ?6 h2 `/ I: V! l3 H2 q
assign mcasp_ahclkr = mcasp_ahclkx;! q9 M( E- n* X, F
assign axr1 = axr0;

8 T9 \4 _6 {! ~3 I! L2 {5 {* O  J
在OMAPL138这端,通过axr0接口发固定的数,axr1接收。
在配置MACASP的时候,发送全部取内部时钟,接收全部取外部时钟。
一直循环发送,但是接收不到。在FPGA端也没有看到时钟和信号的波形。
部分代码如下,关于edma3的部分未做变化。

7 z& R+ x5 V- _
static void McASPI2SConfigure(void)- @6 S/ S# K- n# x+ x
{
1 D" U6 r& ~2 s+ W# x* n# [* lMcASPRxReset(SOC_MCASP_0_CTRL_REGS);
( c) c! K) y; P2 V1 d2 o+ lMcASPTxReset(SOC_MCASP_0_CTRL_REGS);
/* Enable the FIFOs for DMA transfer */
1 l+ A3 M  e( t4 H7 F1 M4 z/ vMcASPReadFifoEnable(SOC_MCASP_0_FIFO_REGS, 1, 1);
' q& J) A# i5 c3 `2 ~* Y8 h  UMcASPWriteFifoEnable(SOC_MCASP_0_FIFO_REGS, 1, 1);
/* Set I2S format in the transmitter/receiver format units */+ ?( }% O, L3 s$ u
McASPRxFmtI2SSet(SOC_MCASP_0_CTRL_REGS, WORD_SIZE, SLOT_SIZE,$ ^3 k/ Z4 c3 |8 N: Y
MCASP_RX_MODE_DMA);# ?4 q. c3 J: D) h8 I% e8 _  c- w
McASPTxFmtI2SSet(SOC_MCASP_0_CTRL_REGS, WORD_SIZE, SLOT_SIZE,
' Q9 k% G0 L  r1 KMCASP_TX_MODE_DMA);
/* Configure the frame sync. I2S shall work in TDM format with 2 slots */, t6 D1 c' `  i; V; a
McASPRxFrameSyncCfg(SOC_MCASP_0_CTRL_REGS, 2, MCASP_RX_FS_WIDTH_WORD, 8 r, L5 A7 S; S' u
MCASP_RX_FS_EXT_BEGIN_ON_FALL_EDGE);
) q- J( T/ r  }9 o9 R% A# DMcASPTxFrameSyncCfg(SOC_MCASP_0_CTRL_REGS, 2, MCASP_TX_FS_WIDTH_WORD, ( _3 q/ n- f, z5 n) Z2 D7 z
MCASP_TX_FS_INT_BEGIN_ON_RIS_EDGE);
/* configure the clock for receiver */  R/ \6 K  B. g* u' d0 S: Q. |
McASPRxClkCfg(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_EXTERNAL, 0, 0);
4 L& ~3 a# \+ v) K" M) bMcASPRxClkPolaritySet(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_POL_RIS_EDGE);
- u7 F- g( B6 O) `McASPRxClkCheckConfig(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLKCHCK_DIV32,  b; g6 N: _$ a- M( ?
0x00, 0xFF);
/* configure the clock for transmitter */
5 f: k* g: I( w& Z* y3 dMcASPTxClkCfg(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_INTERNAL, 11, 1);
& j) j9 j3 ~+ z3 y3 R/ oMcASPTxClkPolaritySet(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_POL_FALL_EDGE);
) t( U& ]8 n6 @; P7 |McASPTxClkCheckConfig(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLKCHCK_DIV32,
% T8 \# r2 {8 H9 i0x00, 0xFF);
" Q# l, Q0 ~2 H% v+ j9 v# q) e2 E- |3 y. ?
/* Enable synchronization of RX and TX sections */ 7 H, _2 R: I: L8 I
McASPTxRxClkSyncEnable(SOC_MCASP_0_CTRL_REGS);
/* Enable the transmitter/receiver slots. I2S uses 2 slots */* I, A" }& J& L
McASPRxTimeSlotSet(SOC_MCASP_0_CTRL_REGS, I2S_SLOTS);
( B  c! B) t  s) }7 _" EMcASPTxTimeSlotSet(SOC_MCASP_0_CTRL_REGS, I2S_SLOTS);
/*. |. i6 b; Q/ Y( m9 m- S: W
** Set the serializers, Currently only one serializer is set as
. W# h( W5 q" z. e4 r5 l** transmitter and one serializer as receiver., ]" j4 z( W# ?9 n4 a4 X
*/- E# h+ `; D& S
McASPSerializerRxSet(SOC_MCASP_0_CTRL_REGS, MCASP_XSER_RX);
& H' m& u$ R$ Y4 H, |# [5 rMcASPSerializerTxSet(SOC_MCASP_0_CTRL_REGS, MCASP_XSER_TX);
/*
- u8 g; F+ z* p/ C* K** Configure the McASP pins
4 U, F4 @/ |  e) ^, M** Input - Frame Sync, Clock and Serializer Rx
6 v1 _% {* W5 B** Output - Serializer Tx is connected to the input of the codec + N$ G$ C# p' u) V; L
*/1 y7 A* T) m! u6 F; w
McASPPinMcASPSet(SOC_MCASP_0_CTRL_REGS, 0xFFFFFFFF);
* y" A+ r: B: e- CMcASPPinDirOutputSet(SOC_MCASP_0_CTRL_REGS,MCASP_PIN_AXR(MCASP_XSER_TX));
5 r$ }$ L; v6 X, jMcASPPinDirInputSet(SOC_MCASP_0_CTRL_REGS, MCASP_PIN_AFSX
0 R( N' {$ A  u' M. S, B| MCASP_PIN_ACLKX; @) L# ]2 ~' W: S( C2 I
| MCASP_PIN_AHCLKX, i$ Z) r9 F' T1 T3 G
| MCASP_PIN_AXR(MCASP_XSER_RX));
/* Enable error interrupts for McASP */' N5 S6 l8 g6 g" g7 s. S
McASPTxIntEnable(SOC_MCASP_0_CTRL_REGS, MCASP_TX_DMAERROR
8 |7 @: C+ v- h5 M| MCASP_TX_CLKFAIL $ U/ O0 z$ j* U7 z8 Y' y$ [
| MCASP_TX_SYNCERROR
; n- Y6 U9 l: \' W: {: ?) N; V5 ~. d| MCASP_TX_UNDERRUN);
McASPRxIntEnable(SOC_MCASP_0_CTRL_REGS, MCASP_RX_DMAERROR
; m8 T6 K1 n; B  h% F( `( y| MCASP_RX_CLKFAIL: B: L4 c& T4 M3 L3 u* O
| MCASP_RX_SYNCERROR
& X. I, e( k! W4 X- M| MCASP_RX_OVERRUN);
* p: I/ m) D' x! J}
static void I2SDataTxRxActivate(void)7 Y- I) M$ j3 D
{# w# Q4 o' E0 }6 \# f1 Q; F
/* Start the clocks */- j9 L' P* b' o& n( A8 P4 [7 w
McASPRxClkStart(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_EXTERNAL);
8 e4 m1 _: ~7 ^  n0 Q  x7 C$ LMcASPTxClkStart(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_INTERNAL);
/* Enable EDMA for the transfer */2 K  Q* q9 K$ B" X( W1 P1 T7 n
EDMA3EnableTransfer(SOC_EDMA30CC_0_REGS, EDMA3_CHA_MCASP0_RX,, l8 A0 s4 O8 W3 V' z$ P
EDMA3_TRIG_MODE_EVENT);
/ q; w0 z% O8 {6 m* P& @EDMA3EnableTransfer(SOC_EDMA30CC_0_REGS, : P: i6 U. j, g2 P% {6 @
EDMA3_CHA_MCASP0_TX, EDMA3_TRIG_MODE_EVENT);
/* Activate the serializers */" f) b$ u# V4 q1 f
McASPRxSerActivate(SOC_MCASP_0_CTRL_REGS);
+ {: Y- X; a2 _, _* G. GMcASPTxSerActivate(SOC_MCASP_0_CTRL_REGS);
/* make sure that the XDATA bit is cleared to zero */+ D& i" O% [% A
while(McASPTxStatusGet(SOC_MCASP_0_CTRL_REGS) & MCASP_TX_STAT_DATAREADY);
/* Activate the state machines */
" X! o) h# h, v( m' ^" n1 a) x+ kMcASPRxEnable(SOC_MCASP_0_CTRL_REGS);0 Y4 e- o- o7 p$ ~: {2 |- n
McASPTxEnable(SOC_MCASP_0_CTRL_REGS);' y( Y, K' t9 t$ Q  i6 a# W
}

  L) h* q# u$ x" O
请问:问题出在哪了,时钟按照这样配是否有错。
另外我看XDATA一直是0,接收的rxbuf0,1,2里有一般全是FFFF一半全是0.

2 w% r, @% C+ w
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