MCASP自环配置。 - OMAP-L138 - 嵌入式开发者社区 - 51ele.net
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[未解决] MCASP自环配置。

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发表于 2018-11-7 13:28:07 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
我项目上用OMAPL138的板子MCASP的引脚都是链接的FPGA,所以在FPGA这端设置的MCASP自环。把axr0接收到的通过axr1发回去。
部分代码如下
input mcasp_afsx,( w' X. ?/ w) Y3 x% Y- t) a
input mcasp_ahclkx,7 p$ _0 s. d- x: v# l/ @
input mcasp_aclkx,
- l. }" b5 }% i& iinput axr0,
' P* F% T2 t9 ~" Q* S4 _% ]9 I1 m! A3 O
output mcasp_afsr,, O4 p5 z7 u, Y, y3 {( T& C
output mcasp_ahclkr,8 z- k& M1 _3 i4 s' F% t" P: ^5 ]
output mcasp_aclkr,
( Y) m7 s4 y6 f+ ?output axr1,: |7 p2 k% B5 i/ N; C1 q
assign mcasp_afsr = mcasp_afsx;
; K. ]7 \1 @7 |' U8 l! Kassign mcasp_aclkr = mcasp_aclkx;
# D! L$ ^9 A$ a4 {* _7 dassign mcasp_ahclkr = mcasp_ahclkx;# R5 w. J& X6 }5 w7 g& U, ?
assign axr1 = axr0;

3 N5 Z# j& n4 h6 P, c! h) {  L% Y
9 Y' |0 y9 G+ v4 p
在OMAPL138这端,通过axr0接口发固定的数,axr1接收。
在配置MACASP的时候,发送全部取内部时钟,接收全部取外部时钟。
一直循环发送,但是接收不到。在FPGA端也没有看到时钟和信号的波形。
部分代码如下,关于edma3的部分未做变化。

! y2 V$ M2 S8 E3 b
static void McASPI2SConfigure(void)6 J, o" q- g# q5 {+ b% Y! f; V7 p
{( u7 o$ Z  e* q( J* B
McASPRxReset(SOC_MCASP_0_CTRL_REGS);! g% `, q9 b( i' ~5 m: S7 [
McASPTxReset(SOC_MCASP_0_CTRL_REGS);
/* Enable the FIFOs for DMA transfer */
/ }' p* {9 ~$ `0 ]1 @# A: f6 ^McASPReadFifoEnable(SOC_MCASP_0_FIFO_REGS, 1, 1);7 O) S. `( h7 e# U4 ]
McASPWriteFifoEnable(SOC_MCASP_0_FIFO_REGS, 1, 1);
/* Set I2S format in the transmitter/receiver format units */3 g: v# M6 q0 z: |
McASPRxFmtI2SSet(SOC_MCASP_0_CTRL_REGS, WORD_SIZE, SLOT_SIZE,( {/ O4 V* S. D& d' V9 e
MCASP_RX_MODE_DMA);' b1 j4 C- ~. ^3 k
McASPTxFmtI2SSet(SOC_MCASP_0_CTRL_REGS, WORD_SIZE, SLOT_SIZE,
8 B1 {2 T! _1 M6 ?! PMCASP_TX_MODE_DMA);
/* Configure the frame sync. I2S shall work in TDM format with 2 slots */. Z- X+ R3 |9 s- u, c0 l1 f' a. r
McASPRxFrameSyncCfg(SOC_MCASP_0_CTRL_REGS, 2, MCASP_RX_FS_WIDTH_WORD, ' z# \1 y$ x$ j  \' U1 x& o
MCASP_RX_FS_EXT_BEGIN_ON_FALL_EDGE);% K. a- c8 v  i* O
McASPTxFrameSyncCfg(SOC_MCASP_0_CTRL_REGS, 2, MCASP_TX_FS_WIDTH_WORD, / I( V; k  _2 Q0 [
MCASP_TX_FS_INT_BEGIN_ON_RIS_EDGE);
/* configure the clock for receiver */: h8 v" a7 I/ ]5 Z1 I; g
McASPRxClkCfg(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_EXTERNAL, 0, 0);* r: I. K& v- j% C9 z
McASPRxClkPolaritySet(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_POL_RIS_EDGE); 1 b# J2 X% W0 d! K: W4 {3 l0 y
McASPRxClkCheckConfig(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLKCHCK_DIV32,
$ D4 _" W# s  c9 R% K/ l0x00, 0xFF);
/* configure the clock for transmitter */
. L& `( |; s% H/ \  tMcASPTxClkCfg(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_INTERNAL, 11, 1);4 E- l- Z5 \' M' `0 h
McASPTxClkPolaritySet(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_POL_FALL_EDGE);
: A( A) x" S0 U" _McASPTxClkCheckConfig(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLKCHCK_DIV32,
3 ~7 E6 ?0 D5 t0x00, 0xFF);
5 k* e( I* _5 @# v- o* b
. x4 @1 {/ f2 _: s) A/* Enable synchronization of RX and TX sections */
  O, B. q5 H: G4 B; c1 ~4 |4 kMcASPTxRxClkSyncEnable(SOC_MCASP_0_CTRL_REGS);
/* Enable the transmitter/receiver slots. I2S uses 2 slots */
  Z# j: [+ S$ A' p$ S$ o' T$ ~McASPRxTimeSlotSet(SOC_MCASP_0_CTRL_REGS, I2S_SLOTS);+ x( H6 v& d& I! B8 {# G
McASPTxTimeSlotSet(SOC_MCASP_0_CTRL_REGS, I2S_SLOTS);
/*
* _0 l% l; X; E: k; g** Set the serializers, Currently only one serializer is set as
) u* ^: d9 J! a1 Y/ N  F** transmitter and one serializer as receiver.
& a8 N' d2 m* n6 R. x3 {0 t*/1 e* X, L+ B0 I6 E0 [) e: N4 @
McASPSerializerRxSet(SOC_MCASP_0_CTRL_REGS, MCASP_XSER_RX);
0 B" A+ D+ B$ R4 R" }0 J3 XMcASPSerializerTxSet(SOC_MCASP_0_CTRL_REGS, MCASP_XSER_TX);
/*
/ _* [! w3 c/ l4 o  I" l** Configure the McASP pins
( G6 G, Y+ X* Q* \0 A* ~/ @** Input - Frame Sync, Clock and Serializer Rx6 \1 O+ Z% f# Z! P2 |
** Output - Serializer Tx is connected to the input of the codec
; @3 T; e) U" X# Z/ Z  r0 |*/
: G0 K; W$ m2 K# p, A0 {4 M& ?: sMcASPPinMcASPSet(SOC_MCASP_0_CTRL_REGS, 0xFFFFFFFF);* A0 r3 y3 j) f% Y1 ?. p
McASPPinDirOutputSet(SOC_MCASP_0_CTRL_REGS,MCASP_PIN_AXR(MCASP_XSER_TX));
" D5 {- v+ F5 U9 P1 }" Y9 K' BMcASPPinDirInputSet(SOC_MCASP_0_CTRL_REGS, MCASP_PIN_AFSX
6 }; `$ K" e' c$ v| MCASP_PIN_ACLKX8 a0 @& R! c- K/ }8 _, f0 I6 W
| MCASP_PIN_AHCLKX9 \( l( D3 Y, B% H4 ^  z/ K) A
| MCASP_PIN_AXR(MCASP_XSER_RX));
/* Enable error interrupts for McASP */
% k: H% B8 d, n. |" [McASPTxIntEnable(SOC_MCASP_0_CTRL_REGS, MCASP_TX_DMAERROR
& l# Y& g; _+ c2 _% m- S( p| MCASP_TX_CLKFAIL
5 m& x: _0 [. Y, r0 C! l+ C$ x| MCASP_TX_SYNCERROR
/ D  x- c9 F. Y$ \. h1 @! O| MCASP_TX_UNDERRUN);
McASPRxIntEnable(SOC_MCASP_0_CTRL_REGS, MCASP_RX_DMAERROR   q+ K) q0 X$ h. a
| MCASP_RX_CLKFAIL1 ?3 D- ~% [1 Z- s5 a/ b
| MCASP_RX_SYNCERROR
; P+ C: I+ \( @7 @" j. R| MCASP_RX_OVERRUN);
4 k( h8 u, [4 Z- u}
static void I2SDataTxRxActivate(void)
7 z7 g' g, y' X: A2 G{
# k8 W) I5 g; E4 j+ c; u$ |/* Start the clocks */" }) k" r) e" B% m8 i" u8 A
McASPRxClkStart(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_EXTERNAL);
4 P4 d! H9 T4 _4 K4 F. V# wMcASPTxClkStart(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_INTERNAL);
/* Enable EDMA for the transfer */0 g1 {. R4 j% H2 V) D
EDMA3EnableTransfer(SOC_EDMA30CC_0_REGS, EDMA3_CHA_MCASP0_RX,
0 D0 n8 d+ d, [EDMA3_TRIG_MODE_EVENT);
3 x0 k1 h8 |9 O8 yEDMA3EnableTransfer(SOC_EDMA30CC_0_REGS, * A$ d& j8 a! [6 }+ {8 j
EDMA3_CHA_MCASP0_TX, EDMA3_TRIG_MODE_EVENT);
/* Activate the serializers */
) w$ M8 L. d3 M: k! yMcASPRxSerActivate(SOC_MCASP_0_CTRL_REGS);: g! U; Z" G! ~0 N: O3 X+ z
McASPTxSerActivate(SOC_MCASP_0_CTRL_REGS);
/* make sure that the XDATA bit is cleared to zero */
" v4 t  }. h" k6 r) ]) swhile(McASPTxStatusGet(SOC_MCASP_0_CTRL_REGS) & MCASP_TX_STAT_DATAREADY);
/* Activate the state machines */0 G3 e# r+ z! @1 z+ i  e
McASPRxEnable(SOC_MCASP_0_CTRL_REGS);
! R6 \7 u& a3 P  M# f, g9 _McASPTxEnable(SOC_MCASP_0_CTRL_REGS);
8 P1 c8 |3 p2 J' Z9 F4 L}
5 Q8 y3 e( R+ X5 D3 P  c& N
请问:问题出在哪了,时钟按照这样配是否有错。
另外我看XDATA一直是0,接收的rxbuf0,1,2里有一般全是FFFF一半全是0.
* w1 f7 c" z. {! }% j
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