MCASP自环配置。 - OMAP-L138 - 嵌入式开发者社区 - 51ele.net
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[未解决] MCASP自环配置。

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发表于 2018-11-7 13:28:07 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
我项目上用OMAPL138的板子MCASP的引脚都是链接的FPGA,所以在FPGA这端设置的MCASP自环。把axr0接收到的通过axr1发回去。
部分代码如下
input mcasp_afsx,; P. h4 p5 w, R& t0 B
input mcasp_ahclkx,
* d+ F3 N: ~& {% \input mcasp_aclkx,. @" A' ~' ^: K+ d, Z# d) `5 U8 i
input axr0," d. I* `4 d8 ?" Y, x- v

' }- J7 F( Y7 O2 o) @output mcasp_afsr,* H% l9 b, W+ Z- \
output mcasp_ahclkr,: j% {3 l. e1 W, Y0 D5 L
output mcasp_aclkr,, M6 E) a# Y' F7 Q. B- I
output axr1,
8 ]9 j/ ?0 j6 }: i) t( ]' E3 b: w
assign mcasp_afsr = mcasp_afsx;9 t( \+ q( p7 L9 Y+ }. m
assign mcasp_aclkr = mcasp_aclkx;8 Z6 }, a& W6 ~+ b% n# q' t& q" g
assign mcasp_ahclkr = mcasp_ahclkx;
" o1 ?: G6 B8 h$ A/ jassign axr1 = axr0;
% N" w+ O4 }. _! a
7 J5 f. w6 z7 }
在OMAPL138这端,通过axr0接口发固定的数,axr1接收。
在配置MACASP的时候,发送全部取内部时钟,接收全部取外部时钟。
一直循环发送,但是接收不到。在FPGA端也没有看到时钟和信号的波形。
部分代码如下,关于edma3的部分未做变化。

3 g$ M: T# O, a: d$ V; p1 `/ t
static void McASPI2SConfigure(void)
7 V- G0 }" O& ^{0 a9 a! w- M3 B; Z& t" H
McASPRxReset(SOC_MCASP_0_CTRL_REGS);
2 t! ]$ A; o# ~  E+ [1 qMcASPTxReset(SOC_MCASP_0_CTRL_REGS);
/* Enable the FIFOs for DMA transfer */: i0 K+ `3 E5 ?. d9 Y# o
McASPReadFifoEnable(SOC_MCASP_0_FIFO_REGS, 1, 1);6 [) A- v. S* [3 a0 k
McASPWriteFifoEnable(SOC_MCASP_0_FIFO_REGS, 1, 1);
/* Set I2S format in the transmitter/receiver format units */0 Y& K) |, m/ g6 U- l
McASPRxFmtI2SSet(SOC_MCASP_0_CTRL_REGS, WORD_SIZE, SLOT_SIZE,
# w- Y& G4 X5 D  O$ O+ mMCASP_RX_MODE_DMA);
9 a& Z7 B% |2 y6 k' dMcASPTxFmtI2SSet(SOC_MCASP_0_CTRL_REGS, WORD_SIZE, SLOT_SIZE,* u' ^! c4 ?) z. w
MCASP_TX_MODE_DMA);
/* Configure the frame sync. I2S shall work in TDM format with 2 slots */
7 V* ?# b6 S- r/ JMcASPRxFrameSyncCfg(SOC_MCASP_0_CTRL_REGS, 2, MCASP_RX_FS_WIDTH_WORD,
  W' l; F6 l, A, b1 YMCASP_RX_FS_EXT_BEGIN_ON_FALL_EDGE);
: c& e: Z2 D5 ?* V8 BMcASPTxFrameSyncCfg(SOC_MCASP_0_CTRL_REGS, 2, MCASP_TX_FS_WIDTH_WORD,
( G0 |/ D2 z' N9 @! Z& eMCASP_TX_FS_INT_BEGIN_ON_RIS_EDGE);
/* configure the clock for receiver */
. V' p; h# K- ~7 K, R. YMcASPRxClkCfg(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_EXTERNAL, 0, 0);
6 q: Z( i5 ^7 W% W6 ?McASPRxClkPolaritySet(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_POL_RIS_EDGE); 3 r' n: u) C4 m& f
McASPRxClkCheckConfig(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLKCHCK_DIV32,
2 x3 a) d9 g2 I) }! }9 J  N4 d0x00, 0xFF);
/* configure the clock for transmitter */
" X+ J" Y' w+ p* hMcASPTxClkCfg(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_INTERNAL, 11, 1);
- g* [; s. @9 O  b* p$ \/ GMcASPTxClkPolaritySet(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_POL_FALL_EDGE);
/ Y' L% R8 V7 ?# d: ^McASPTxClkCheckConfig(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLKCHCK_DIV32,/ v: S: Y' K1 [: {
0x00, 0xFF);( w$ K& ~# b9 I$ C$ Y' n

0 B/ k5 o9 D& x* P5 J/* Enable synchronization of RX and TX sections */
+ ?7 ]+ \, m$ t1 `( w4 }6 C/ bMcASPTxRxClkSyncEnable(SOC_MCASP_0_CTRL_REGS);
/* Enable the transmitter/receiver slots. I2S uses 2 slots */
* C8 `- _2 t4 ^! o  x* d  s: \McASPRxTimeSlotSet(SOC_MCASP_0_CTRL_REGS, I2S_SLOTS);) g/ B5 X! I* C
McASPTxTimeSlotSet(SOC_MCASP_0_CTRL_REGS, I2S_SLOTS);
/*' d: R% M' W8 f* S+ d, s5 m, ?
** Set the serializers, Currently only one serializer is set as9 [3 Z; \" V- b. T. v4 n9 o
** transmitter and one serializer as receiver.
  K& Z# J  J6 c7 h5 l" j' S*/9 s, H# K% x6 z* P7 j" P
McASPSerializerRxSet(SOC_MCASP_0_CTRL_REGS, MCASP_XSER_RX);+ _' I' h0 a& r% h5 z$ [- r
McASPSerializerTxSet(SOC_MCASP_0_CTRL_REGS, MCASP_XSER_TX);
/*
# K, Y# v  b3 g; d1 X4 @' e** Configure the McASP pins
1 t# ?) }; J0 A** Input - Frame Sync, Clock and Serializer Rx; F9 e7 p. Y, ^; \  }6 F1 N3 U; R6 D7 f
** Output - Serializer Tx is connected to the input of the codec - `# Z% i3 r# a; r$ u
*/# e2 t5 [9 S" @0 }3 o! K/ d
McASPPinMcASPSet(SOC_MCASP_0_CTRL_REGS, 0xFFFFFFFF);6 t6 J5 ^- e# f/ v: v$ ?
McASPPinDirOutputSet(SOC_MCASP_0_CTRL_REGS,MCASP_PIN_AXR(MCASP_XSER_TX));
' T# I9 Y, R0 m9 Y9 z4 z: DMcASPPinDirInputSet(SOC_MCASP_0_CTRL_REGS, MCASP_PIN_AFSX- D* K+ p" [. W5 M
| MCASP_PIN_ACLKX' N' k& f3 N" O6 ^) R# p
| MCASP_PIN_AHCLKX
' V& a) v+ w4 [+ ?* A! U| MCASP_PIN_AXR(MCASP_XSER_RX));
/* Enable error interrupts for McASP */
) }7 E7 G$ i6 [( O$ r1 m  ZMcASPTxIntEnable(SOC_MCASP_0_CTRL_REGS, MCASP_TX_DMAERROR . E. y3 H8 @8 @
| MCASP_TX_CLKFAIL 8 v2 z1 v/ q1 f% z
| MCASP_TX_SYNCERROR% f/ q0 x* i/ i( K' p
| MCASP_TX_UNDERRUN);
McASPRxIntEnable(SOC_MCASP_0_CTRL_REGS, MCASP_RX_DMAERROR
2 F* E( Y9 M% K9 q% E0 G% R| MCASP_RX_CLKFAIL
3 _5 Q  Y. [9 I& }| MCASP_RX_SYNCERROR ( W6 A5 E7 b) ~3 X) d
| MCASP_RX_OVERRUN);7 p+ a( S& c5 i" g
}
static void I2SDataTxRxActivate(void)) }  C% ?5 Z' p& U6 A( M& E
{
0 e" Q$ |* F% Q, `( q( B- j/* Start the clocks */
$ v8 l. q. T, S) g, h+ @McASPRxClkStart(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_EXTERNAL);
1 ]9 t2 r. ?0 [; U4 OMcASPTxClkStart(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_INTERNAL);
/* Enable EDMA for the transfer */
- i+ e5 V  \2 z' O, a+ E( m# @5 fEDMA3EnableTransfer(SOC_EDMA30CC_0_REGS, EDMA3_CHA_MCASP0_RX,+ r1 L9 }2 Z# h" O  l! w
EDMA3_TRIG_MODE_EVENT);% G" m: ]2 R* r) v1 t3 o$ ?
EDMA3EnableTransfer(SOC_EDMA30CC_0_REGS, $ K* }( g; a! ~' }; J
EDMA3_CHA_MCASP0_TX, EDMA3_TRIG_MODE_EVENT);
/* Activate the serializers */0 c' Q% r! F( j& [
McASPRxSerActivate(SOC_MCASP_0_CTRL_REGS);$ u0 O9 _3 j6 V* w5 N
McASPTxSerActivate(SOC_MCASP_0_CTRL_REGS);
/* make sure that the XDATA bit is cleared to zero */
+ q* L& j  D' P5 fwhile(McASPTxStatusGet(SOC_MCASP_0_CTRL_REGS) & MCASP_TX_STAT_DATAREADY);
/* Activate the state machines */
; q  ?$ ?6 |7 lMcASPRxEnable(SOC_MCASP_0_CTRL_REGS);( D9 p  N6 [; T/ ]0 `& E7 O" |
McASPTxEnable(SOC_MCASP_0_CTRL_REGS);
8 S' l/ x/ U! f* K' S}

9 p: R- x" V0 I7 ^3 U
请问:问题出在哪了,时钟按照这样配是否有错。
另外我看XDATA一直是0,接收的rxbuf0,1,2里有一般全是FFFF一半全是0.

3 Q6 q' \* L5 F1 Y6 E/ E  i
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