MCASP自环配置。 - OMAP-L138 - 嵌入式开发者社区 - 51ele.net
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[未解决] MCASP自环配置。

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发表于 2018-11-7 13:28:07 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
我项目上用OMAPL138的板子MCASP的引脚都是链接的FPGA,所以在FPGA这端设置的MCASP自环。把axr0接收到的通过axr1发回去。
部分代码如下
input mcasp_afsx,6 i6 |6 n& A9 |6 }( M0 V
input mcasp_ahclkx,
: X! Y1 _# E6 O' J- u6 Y& Uinput mcasp_aclkx,
; O) I1 q- r" ^) x" m, winput axr0,, h! J1 u* [0 ~* \; i
, p. @5 b6 O4 _" W
output mcasp_afsr,
7 w. \) n- S* V: N4 N1 koutput mcasp_ahclkr,, y$ e$ Y+ D1 ]& v! M1 B. W
output mcasp_aclkr,) ~2 z. g2 R' }
output axr1," t9 t1 A0 Z0 N$ ]6 R3 v8 c
assign mcasp_afsr = mcasp_afsx;
, K" G: @4 g3 }& S+ }assign mcasp_aclkr = mcasp_aclkx;1 Z* T4 ]7 j; f+ l* Z
assign mcasp_ahclkr = mcasp_ahclkx;& x# h' l) W+ c9 W: s; ~+ x+ J
assign axr1 = axr0;

1 |* t$ `. l  ^- ]* _( P, f
1 O) N% Y$ R9 r
在OMAPL138这端,通过axr0接口发固定的数,axr1接收。
在配置MACASP的时候,发送全部取内部时钟,接收全部取外部时钟。
一直循环发送,但是接收不到。在FPGA端也没有看到时钟和信号的波形。
部分代码如下,关于edma3的部分未做变化。

; Q# D0 N, ?0 O( k! g. E/ Q
static void McASPI2SConfigure(void)
1 r, m/ a+ d5 m' T{* _: i6 g& o3 I$ [/ b# W# |# t: l
McASPRxReset(SOC_MCASP_0_CTRL_REGS);$ n# m" o# T+ f& y
McASPTxReset(SOC_MCASP_0_CTRL_REGS);
/* Enable the FIFOs for DMA transfer */
* T# T, z- T0 K' a# }7 n" T' BMcASPReadFifoEnable(SOC_MCASP_0_FIFO_REGS, 1, 1);# w4 y" d( Q) L
McASPWriteFifoEnable(SOC_MCASP_0_FIFO_REGS, 1, 1);
/* Set I2S format in the transmitter/receiver format units */8 Q; k0 Z* _3 h
McASPRxFmtI2SSet(SOC_MCASP_0_CTRL_REGS, WORD_SIZE, SLOT_SIZE,* T3 @3 l1 [- V% B
MCASP_RX_MODE_DMA);8 P5 E$ K, ]7 q- E( i" V, n
McASPTxFmtI2SSet(SOC_MCASP_0_CTRL_REGS, WORD_SIZE, SLOT_SIZE,0 W% e+ D5 f1 K6 {& H5 p' x' {; A
MCASP_TX_MODE_DMA);
/* Configure the frame sync. I2S shall work in TDM format with 2 slots */
; }, R% n# e# t- J  `' g6 ]/ TMcASPRxFrameSyncCfg(SOC_MCASP_0_CTRL_REGS, 2, MCASP_RX_FS_WIDTH_WORD,
+ n% P, d  \3 e2 Y, eMCASP_RX_FS_EXT_BEGIN_ON_FALL_EDGE);
' N: |8 u7 l& _+ J8 D( h1 oMcASPTxFrameSyncCfg(SOC_MCASP_0_CTRL_REGS, 2, MCASP_TX_FS_WIDTH_WORD, ! J2 W9 M0 U" g8 u! _
MCASP_TX_FS_INT_BEGIN_ON_RIS_EDGE);
/* configure the clock for receiver */( I% N- Y) q, h" D) r1 r+ ~
McASPRxClkCfg(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_EXTERNAL, 0, 0);
; C" X! D* B, \7 TMcASPRxClkPolaritySet(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_POL_RIS_EDGE); * Q" g+ Y* `$ u9 p; C& m6 Y  m
McASPRxClkCheckConfig(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLKCHCK_DIV32,
3 k6 g" r1 o9 y* e7 b7 n( F0x00, 0xFF);
/* configure the clock for transmitter */
8 E+ f1 B; @* \: z# a6 rMcASPTxClkCfg(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_INTERNAL, 11, 1);
4 s2 T; D9 S, E# i! p( JMcASPTxClkPolaritySet(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_POL_FALL_EDGE);
7 R: T3 w. I! ~8 z4 B$ L: U$ MMcASPTxClkCheckConfig(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLKCHCK_DIV32,5 K" }: I7 U4 ?
0x00, 0xFF);
. e' m; [0 Y* t! N& i/ ?
$ \2 x! ]  G! \. Z& p/* Enable synchronization of RX and TX sections */
7 o# }4 T4 Z9 QMcASPTxRxClkSyncEnable(SOC_MCASP_0_CTRL_REGS);
/* Enable the transmitter/receiver slots. I2S uses 2 slots */, G  P" }  ]! e& u, `, z- F
McASPRxTimeSlotSet(SOC_MCASP_0_CTRL_REGS, I2S_SLOTS);5 z* u2 |$ V) X8 t! A
McASPTxTimeSlotSet(SOC_MCASP_0_CTRL_REGS, I2S_SLOTS);
/*
& y3 r" Z) b* ?* Q- S$ j0 n** Set the serializers, Currently only one serializer is set as
8 N  w. O5 G4 A/ {2 J2 Y** transmitter and one serializer as receiver.
5 N, h' f0 f/ ~& q; D' a*/
, H* H, Y8 I& X% PMcASPSerializerRxSet(SOC_MCASP_0_CTRL_REGS, MCASP_XSER_RX);) p% P& ~$ r8 D
McASPSerializerTxSet(SOC_MCASP_0_CTRL_REGS, MCASP_XSER_TX);
/*
) f0 N! o  F) B% f) ]' r** Configure the McASP pins / F. j) F4 b$ M' P9 D1 [
** Input - Frame Sync, Clock and Serializer Rx; q, ^$ L( Z! _3 I6 a; D0 y/ u9 g1 R
** Output - Serializer Tx is connected to the input of the codec
% g; L% p- \) m9 z2 J*/, @) r& h* X1 ~2 O4 X- E* B7 w# P
McASPPinMcASPSet(SOC_MCASP_0_CTRL_REGS, 0xFFFFFFFF);4 d. M2 z2 I+ X' U4 M$ f  _- y
McASPPinDirOutputSet(SOC_MCASP_0_CTRL_REGS,MCASP_PIN_AXR(MCASP_XSER_TX));
# d- `9 S+ @. A! q, s' y1 `) mMcASPPinDirInputSet(SOC_MCASP_0_CTRL_REGS, MCASP_PIN_AFSX: ]1 N/ e2 k8 F7 Z
| MCASP_PIN_ACLKX: x) C( [* e" o3 K
| MCASP_PIN_AHCLKX: a# S7 h3 r, L
| MCASP_PIN_AXR(MCASP_XSER_RX));
/* Enable error interrupts for McASP */
6 p6 B; d+ t/ v/ U6 P4 G% eMcASPTxIntEnable(SOC_MCASP_0_CTRL_REGS, MCASP_TX_DMAERROR 0 y8 T# W/ g  X9 l+ ]
| MCASP_TX_CLKFAIL ( f1 ^0 y+ e/ m; e: s+ f2 H2 L3 ?
| MCASP_TX_SYNCERROR
5 t2 i8 D% u* g. x6 m  B| MCASP_TX_UNDERRUN);
McASPRxIntEnable(SOC_MCASP_0_CTRL_REGS, MCASP_RX_DMAERROR
8 Q$ f6 a; p# W' z; _% z| MCASP_RX_CLKFAIL
) E0 |# M) d5 f7 h4 n! f( I/ `  ]8 a6 R$ Z| MCASP_RX_SYNCERROR , i% J! {- `" c# K3 m% q
| MCASP_RX_OVERRUN);
( `* v! g+ W2 n) m! H1 Y1 l}
static void I2SDataTxRxActivate(void); \, ^# J! f- o( \* ?
{' \. h' d* s, s2 o1 ?/ u
/* Start the clocks */6 b$ E5 |& d0 e  b9 i) V8 @/ a/ ]
McASPRxClkStart(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_EXTERNAL);
7 T8 U. s& k1 L& h& m* UMcASPTxClkStart(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_INTERNAL);
/* Enable EDMA for the transfer */
8 C+ k4 u% {* v. eEDMA3EnableTransfer(SOC_EDMA30CC_0_REGS, EDMA3_CHA_MCASP0_RX,
0 l: b8 ]- `5 R( R, s1 HEDMA3_TRIG_MODE_EVENT);
* F6 ^' i" q% l) LEDMA3EnableTransfer(SOC_EDMA30CC_0_REGS,
/ z( d0 b# N- G& S: t6 mEDMA3_CHA_MCASP0_TX, EDMA3_TRIG_MODE_EVENT);
/* Activate the serializers */' X/ A0 R2 T9 u7 y' o* I
McASPRxSerActivate(SOC_MCASP_0_CTRL_REGS);
( s' M. A0 i. M6 d9 |4 L3 u% fMcASPTxSerActivate(SOC_MCASP_0_CTRL_REGS);
/* make sure that the XDATA bit is cleared to zero */! m  v0 q8 g/ x  X, q
while(McASPTxStatusGet(SOC_MCASP_0_CTRL_REGS) & MCASP_TX_STAT_DATAREADY);
/* Activate the state machines */2 e/ g& V& w' I2 n/ P/ U) q
McASPRxEnable(SOC_MCASP_0_CTRL_REGS);
* a6 d6 K/ \$ J: j+ ]7 P: V8 r0 oMcASPTxEnable(SOC_MCASP_0_CTRL_REGS);4 ?: C) l  B( v( Y+ L! n8 G
}
$ h$ {% n/ D& Q3 j! P* g
请问:问题出在哪了,时钟按照这样配是否有错。
另外我看XDATA一直是0,接收的rxbuf0,1,2里有一般全是FFFF一半全是0.

/ f" C* C) A1 J( L
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