MCASP自环配置。 - OMAP-L138 - 嵌入式开发者社区 - 51ele.net
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[未解决] MCASP自环配置。

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发表于 2018-11-7 13:28:07 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
我项目上用OMAPL138的板子MCASP的引脚都是链接的FPGA,所以在FPGA这端设置的MCASP自环。把axr0接收到的通过axr1发回去。
部分代码如下
input mcasp_afsx,1 |0 T! X6 g/ y1 H
input mcasp_ahclkx,
/ ?# m: r* c; R  @! ]- }5 vinput mcasp_aclkx,
6 j4 J/ M7 F$ ^, u/ G5 @8 Finput axr0,- p: f/ C3 t. o7 Z( L* @

! v' T9 K/ h  K  Ioutput mcasp_afsr,. O4 g* B* i0 A1 o( f' I& z
output mcasp_ahclkr,
+ A' c8 h+ \* routput mcasp_aclkr,
$ R+ z( M( z$ r' L' goutput axr1,
# d9 a5 o3 M, f2 ~9 S5 u
assign mcasp_afsr = mcasp_afsx;
$ A9 S8 c, W) F: k. l4 k! A1 massign mcasp_aclkr = mcasp_aclkx;) M1 K" N5 t' B0 j: Q
assign mcasp_ahclkr = mcasp_ahclkx;6 @7 ^1 K# w1 c5 I- x! w' D
assign axr1 = axr0;

. J6 Q) \9 p, ]* v
: |8 j( Q5 ^- O' a& H
在OMAPL138这端,通过axr0接口发固定的数,axr1接收。
在配置MACASP的时候,发送全部取内部时钟,接收全部取外部时钟。
一直循环发送,但是接收不到。在FPGA端也没有看到时钟和信号的波形。
部分代码如下,关于edma3的部分未做变化。
  b$ p1 ?) t: V3 b- N/ T7 w
static void McASPI2SConfigure(void)* ]# A- x% ~0 F/ c
{
6 X7 H$ I8 x( x: C( T  {* }McASPRxReset(SOC_MCASP_0_CTRL_REGS);
$ Q9 E+ O3 `3 o. v" f2 B4 t, _McASPTxReset(SOC_MCASP_0_CTRL_REGS);
/* Enable the FIFOs for DMA transfer */
1 O- ?1 v4 n! \* q, E; x9 jMcASPReadFifoEnable(SOC_MCASP_0_FIFO_REGS, 1, 1);& P1 G6 V  w% \+ v8 ]6 L
McASPWriteFifoEnable(SOC_MCASP_0_FIFO_REGS, 1, 1);
/* Set I2S format in the transmitter/receiver format units */! l& L0 Z9 Y- k0 l  \7 G7 ]+ o  j
McASPRxFmtI2SSet(SOC_MCASP_0_CTRL_REGS, WORD_SIZE, SLOT_SIZE,
" Y2 k0 R! T; ~- t7 s* j1 HMCASP_RX_MODE_DMA);( [/ W/ h* j, E
McASPTxFmtI2SSet(SOC_MCASP_0_CTRL_REGS, WORD_SIZE, SLOT_SIZE,
) k  a( f$ m. \/ [, @/ L5 U; q2 JMCASP_TX_MODE_DMA);
/* Configure the frame sync. I2S shall work in TDM format with 2 slots */
  }4 f% f! d4 ]& AMcASPRxFrameSyncCfg(SOC_MCASP_0_CTRL_REGS, 2, MCASP_RX_FS_WIDTH_WORD, # [! m- ]* N  }6 g1 F
MCASP_RX_FS_EXT_BEGIN_ON_FALL_EDGE);
6 F6 ]1 s3 H: Z+ g, S( EMcASPTxFrameSyncCfg(SOC_MCASP_0_CTRL_REGS, 2, MCASP_TX_FS_WIDTH_WORD, ( A1 T9 u/ m; W3 V9 L. o
MCASP_TX_FS_INT_BEGIN_ON_RIS_EDGE);
/* configure the clock for receiver */
" ~# m& c2 s& {! AMcASPRxClkCfg(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_EXTERNAL, 0, 0);5 Z8 G% B4 ]5 w: L3 T
McASPRxClkPolaritySet(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_POL_RIS_EDGE);
8 d& V* n" c& g% pMcASPRxClkCheckConfig(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLKCHCK_DIV32,
, w# W2 U; A! \3 ~: J" Y( o0x00, 0xFF);
/* configure the clock for transmitter */9 N: P& w. O7 _( j9 [7 S
McASPTxClkCfg(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_INTERNAL, 11, 1);: X0 W( _( P1 D  h+ S# V
McASPTxClkPolaritySet(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_POL_FALL_EDGE);
: G  J  X: K" TMcASPTxClkCheckConfig(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLKCHCK_DIV32,
$ E! g8 ~" ]- C# w1 @! m0x00, 0xFF);
5 a1 Z; t- W+ t% I3 R: c# G- P4 T8 s2 Q3 D
/* Enable synchronization of RX and TX sections */ ! B  Q( x5 v/ f* I
McASPTxRxClkSyncEnable(SOC_MCASP_0_CTRL_REGS);
/* Enable the transmitter/receiver slots. I2S uses 2 slots */
% h# v" E: H$ S' h/ F* z( X& xMcASPRxTimeSlotSet(SOC_MCASP_0_CTRL_REGS, I2S_SLOTS);# k/ {7 k0 P' n1 V. M5 V
McASPTxTimeSlotSet(SOC_MCASP_0_CTRL_REGS, I2S_SLOTS);
/*
& x2 O. f) g8 A" g** Set the serializers, Currently only one serializer is set as
! V  o- v  i, X9 I9 z2 }: B** transmitter and one serializer as receiver.4 j+ d: b" z3 x7 O  y0 Z. B: k/ s
*/
" E0 z( i$ U# M% q; G' C9 K0 @+ KMcASPSerializerRxSet(SOC_MCASP_0_CTRL_REGS, MCASP_XSER_RX);
6 [% v- i. t  l6 @4 zMcASPSerializerTxSet(SOC_MCASP_0_CTRL_REGS, MCASP_XSER_TX);
/*
1 T8 b+ W- [+ O' Z# a** Configure the McASP pins
; M, ]. a, P" \** Input - Frame Sync, Clock and Serializer Rx( @! u" _  C0 A
** Output - Serializer Tx is connected to the input of the codec $ [# H( U0 W$ {* T" |! x
*/
* @2 e2 W# O; {. W! fMcASPPinMcASPSet(SOC_MCASP_0_CTRL_REGS, 0xFFFFFFFF);
/ F0 E0 s: |! T3 r; LMcASPPinDirOutputSet(SOC_MCASP_0_CTRL_REGS,MCASP_PIN_AXR(MCASP_XSER_TX));! c* G  V$ \/ ]$ f, |7 x
McASPPinDirInputSet(SOC_MCASP_0_CTRL_REGS, MCASP_PIN_AFSX
* y; n! ^+ b, P+ r| MCASP_PIN_ACLKX
3 e) o. r5 ~' g  D| MCASP_PIN_AHCLKX2 O( X/ c0 n  X9 l6 P/ }' E" J% I! w
| MCASP_PIN_AXR(MCASP_XSER_RX));
/* Enable error interrupts for McASP */# _+ h, u% n3 S9 Z+ o
McASPTxIntEnable(SOC_MCASP_0_CTRL_REGS, MCASP_TX_DMAERROR
+ Q0 w( v, m! l4 h1 y, @| MCASP_TX_CLKFAIL 8 D% j9 Y( l7 N& e- N
| MCASP_TX_SYNCERROR/ I- b. w: `! {4 K0 C+ B: B+ o; h
| MCASP_TX_UNDERRUN);
McASPRxIntEnable(SOC_MCASP_0_CTRL_REGS, MCASP_RX_DMAERROR
+ o8 ]5 y: q( F* x; e. z| MCASP_RX_CLKFAIL  ]  P) i, Y4 x( r  V/ H
| MCASP_RX_SYNCERROR
6 o/ B# Q" C/ |, t1 V2 @0 K/ P- ~& [| MCASP_RX_OVERRUN);  |1 U) s( j9 `4 ?, k
}
static void I2SDataTxRxActivate(void)& @+ j" s! D8 C7 j
{
' ^3 S0 \: y- y( O- }/* Start the clocks */
  s' Q: Y: X7 M$ HMcASPRxClkStart(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_EXTERNAL);! t( q8 H1 k( M) N
McASPTxClkStart(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_INTERNAL);
/* Enable EDMA for the transfer */; {& R: c4 w5 }
EDMA3EnableTransfer(SOC_EDMA30CC_0_REGS, EDMA3_CHA_MCASP0_RX,# @/ {+ ?/ [0 Q: g! H8 i
EDMA3_TRIG_MODE_EVENT);6 u% Q% u6 D" ], y9 r% ]
EDMA3EnableTransfer(SOC_EDMA30CC_0_REGS,
* \3 \/ N% G; n  h5 i  REDMA3_CHA_MCASP0_TX, EDMA3_TRIG_MODE_EVENT);
/* Activate the serializers *// J" |0 h9 M' e
McASPRxSerActivate(SOC_MCASP_0_CTRL_REGS);
6 Y% I, P  g& @8 ]( N2 ZMcASPTxSerActivate(SOC_MCASP_0_CTRL_REGS);
/* make sure that the XDATA bit is cleared to zero */
3 u- {1 ]4 w! x6 ?# zwhile(McASPTxStatusGet(SOC_MCASP_0_CTRL_REGS) & MCASP_TX_STAT_DATAREADY);
/* Activate the state machines */
  q9 i6 B- V' _3 ]; ^" QMcASPRxEnable(SOC_MCASP_0_CTRL_REGS);
2 q+ ]  V6 Y. A9 L8 K, oMcASPTxEnable(SOC_MCASP_0_CTRL_REGS);+ T/ \/ q) X; ^5 N  X1 x6 x
}

( v4 z5 i* P& p9 H
请问:问题出在哪了,时钟按照这样配是否有错。
另外我看XDATA一直是0,接收的rxbuf0,1,2里有一般全是FFFF一半全是0.

8 R1 a1 E) I, R% m* ~
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