MCASP自环配置。 - OMAP-L138 - 嵌入式开发者社区 - 51ele.net
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[未解决] MCASP自环配置。

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发表于 2018-11-7 13:28:07 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
我项目上用OMAPL138的板子MCASP的引脚都是链接的FPGA,所以在FPGA这端设置的MCASP自环。把axr0接收到的通过axr1发回去。
部分代码如下
input mcasp_afsx,3 O$ o% o( x+ m
input mcasp_ahclkx,3 g9 a1 W; @( k
input mcasp_aclkx,
, e& w7 q9 O$ a6 V# s/ M( {input axr0,
4 B4 R% x" o! C+ h2 N( s: `5 V. z/ Y  ]3 \
output mcasp_afsr,2 O- \9 @! ~: m: _0 z2 E
output mcasp_ahclkr,
, ]1 l) \  K) p; p$ ]output mcasp_aclkr,3 O) [4 V3 w2 a, N. N: j$ c: h% X
output axr1,7 H, y, R- ^, @/ r9 Q
assign mcasp_afsr = mcasp_afsx;1 Y8 S( C* E6 f: o- o+ P' S
assign mcasp_aclkr = mcasp_aclkx;4 j7 Q0 N6 h; H; k7 W
assign mcasp_ahclkr = mcasp_ahclkx;9 h* p% K$ E3 U( N
assign axr1 = axr0;
+ B0 u3 h6 j  a% S

  c) g* ?- @& O5 G# b* l
在OMAPL138这端,通过axr0接口发固定的数,axr1接收。
在配置MACASP的时候,发送全部取内部时钟,接收全部取外部时钟。
一直循环发送,但是接收不到。在FPGA端也没有看到时钟和信号的波形。
部分代码如下,关于edma3的部分未做变化。
! C$ V0 ^8 g/ Y. U- M
static void McASPI2SConfigure(void)
, B! P1 M7 Z+ d1 p+ g6 P{
& j0 y; r; ]* b8 N& oMcASPRxReset(SOC_MCASP_0_CTRL_REGS);0 O1 H* `% d5 ~3 ]5 D
McASPTxReset(SOC_MCASP_0_CTRL_REGS);
/* Enable the FIFOs for DMA transfer */
6 m2 ~6 {# q3 s. F' q7 EMcASPReadFifoEnable(SOC_MCASP_0_FIFO_REGS, 1, 1);
& v/ q* S+ K. H2 W6 x. P8 OMcASPWriteFifoEnable(SOC_MCASP_0_FIFO_REGS, 1, 1);
/* Set I2S format in the transmitter/receiver format units */
6 k- r; x/ y, {: }5 J8 o9 kMcASPRxFmtI2SSet(SOC_MCASP_0_CTRL_REGS, WORD_SIZE, SLOT_SIZE,4 w6 P% o' Z3 g: G! x
MCASP_RX_MODE_DMA);
$ D' x' }3 ~7 J* c% i! p  @McASPTxFmtI2SSet(SOC_MCASP_0_CTRL_REGS, WORD_SIZE, SLOT_SIZE,6 ], i) W' ?+ C6 c& j' ~
MCASP_TX_MODE_DMA);
/* Configure the frame sync. I2S shall work in TDM format with 2 slots */
) u  c( V" W: L) k4 K7 nMcASPRxFrameSyncCfg(SOC_MCASP_0_CTRL_REGS, 2, MCASP_RX_FS_WIDTH_WORD, ; l, r0 S0 E" S9 p% {
MCASP_RX_FS_EXT_BEGIN_ON_FALL_EDGE);
, g% V1 {6 a2 V/ {, bMcASPTxFrameSyncCfg(SOC_MCASP_0_CTRL_REGS, 2, MCASP_TX_FS_WIDTH_WORD, 0 |5 z; w" X' Y
MCASP_TX_FS_INT_BEGIN_ON_RIS_EDGE);
/* configure the clock for receiver *// M1 m" t) M* o3 Z4 H& [$ S- O" j$ _
McASPRxClkCfg(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_EXTERNAL, 0, 0);7 e3 J# g: `/ L* R/ a5 W
McASPRxClkPolaritySet(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_POL_RIS_EDGE); & e- u/ H- O  `
McASPRxClkCheckConfig(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLKCHCK_DIV32,/ `3 v2 \3 I1 G4 y# ?/ P1 f
0x00, 0xFF);
/* configure the clock for transmitter */" w/ l/ s  k7 {, `# q/ F
McASPTxClkCfg(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_INTERNAL, 11, 1);
. P6 `0 {9 J3 N3 J1 gMcASPTxClkPolaritySet(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_POL_FALL_EDGE);
$ X. l) l3 |, ?: S' g' L4 SMcASPTxClkCheckConfig(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLKCHCK_DIV32,
5 t; {* D: k- W! T; L: D5 q0x00, 0xFF);+ g# N! ?' u! `! H. E9 J4 s0 F
) A/ m" X/ }+ R* |5 @/ i
/* Enable synchronization of RX and TX sections */
2 v) T. Y5 W' d7 l9 oMcASPTxRxClkSyncEnable(SOC_MCASP_0_CTRL_REGS);
/* Enable the transmitter/receiver slots. I2S uses 2 slots */
, N, f+ T4 r9 ]0 pMcASPRxTimeSlotSet(SOC_MCASP_0_CTRL_REGS, I2S_SLOTS);
. X" m7 ?9 ]; i* Z3 I' [6 @. U- LMcASPTxTimeSlotSet(SOC_MCASP_0_CTRL_REGS, I2S_SLOTS);
/*, U7 k+ t2 o& v6 s( C' a
** Set the serializers, Currently only one serializer is set as
- I7 N$ c! a4 I% x** transmitter and one serializer as receiver., e9 E: P2 D; p8 |2 ~: p( t5 G" R& a
*/
. K1 k" e1 R, n5 @McASPSerializerRxSet(SOC_MCASP_0_CTRL_REGS, MCASP_XSER_RX);/ ]( Y) P+ S0 r" A
McASPSerializerTxSet(SOC_MCASP_0_CTRL_REGS, MCASP_XSER_TX);
/*# i8 P. K# _' _& I" Z- A6 T
** Configure the McASP pins
- {0 q0 h+ A! O4 U, }4 s** Input - Frame Sync, Clock and Serializer Rx, V) S6 x% M( g- v* A) [
** Output - Serializer Tx is connected to the input of the codec 7 K" n* x% u$ d  G+ A
*/
; Q3 |5 X3 \; Q) J% b( K5 vMcASPPinMcASPSet(SOC_MCASP_0_CTRL_REGS, 0xFFFFFFFF);
8 l' }% k; e" f7 a* r4 S, i$ yMcASPPinDirOutputSet(SOC_MCASP_0_CTRL_REGS,MCASP_PIN_AXR(MCASP_XSER_TX));# s6 J: ]# l( b! e4 R" T
McASPPinDirInputSet(SOC_MCASP_0_CTRL_REGS, MCASP_PIN_AFSX
" z/ T# o. b3 z/ X! F# L- S| MCASP_PIN_ACLKX
+ G1 ?4 f# t( ~& k3 N) P0 H| MCASP_PIN_AHCLKX' L  R5 b/ z9 @$ Z1 J, _
| MCASP_PIN_AXR(MCASP_XSER_RX));
/* Enable error interrupts for McASP */
- `: q, t- P, |% m/ y) ]! yMcASPTxIntEnable(SOC_MCASP_0_CTRL_REGS, MCASP_TX_DMAERROR
4 j8 M' g. N- y% a' q: x0 n0 E$ d  || MCASP_TX_CLKFAIL 0 U8 w# q7 o, Z3 c2 V0 b
| MCASP_TX_SYNCERROR2 q. d9 R. I; ~! u
| MCASP_TX_UNDERRUN);
McASPRxIntEnable(SOC_MCASP_0_CTRL_REGS, MCASP_RX_DMAERROR : J- |6 M7 A. e: A
| MCASP_RX_CLKFAIL
( e$ q  R; E: K| MCASP_RX_SYNCERROR 5 L" M9 H- W- Y" g* q
| MCASP_RX_OVERRUN);
; A2 \4 {# [" y( J2 t3 c}
static void I2SDataTxRxActivate(void)
' O4 n) M8 \% j, B$ j3 P{
* E- p; X( q4 D3 e" d2 C% ]/* Start the clocks */' W5 V# p! R, U8 n& G) A& d
McASPRxClkStart(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_EXTERNAL);$ H$ x$ u* C2 D
McASPTxClkStart(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_INTERNAL);
/* Enable EDMA for the transfer */
1 @3 n" A$ q. o. G8 OEDMA3EnableTransfer(SOC_EDMA30CC_0_REGS, EDMA3_CHA_MCASP0_RX,  M; Y, D6 V) Y% g- i) P4 h
EDMA3_TRIG_MODE_EVENT);9 f/ V# b& H' T; d! I4 H
EDMA3EnableTransfer(SOC_EDMA30CC_0_REGS,   l5 N2 e( Q! o' ]# H, h
EDMA3_CHA_MCASP0_TX, EDMA3_TRIG_MODE_EVENT);
/* Activate the serializers */: \1 g; D1 b2 M1 g1 ]) l
McASPRxSerActivate(SOC_MCASP_0_CTRL_REGS);
5 G: H# Y8 y2 A9 t$ a1 oMcASPTxSerActivate(SOC_MCASP_0_CTRL_REGS);
/* make sure that the XDATA bit is cleared to zero */
+ Y1 s: A, \, s2 i2 vwhile(McASPTxStatusGet(SOC_MCASP_0_CTRL_REGS) & MCASP_TX_STAT_DATAREADY);
/* Activate the state machines */' s9 D2 t3 d. E5 U7 w
McASPRxEnable(SOC_MCASP_0_CTRL_REGS);: G( d5 j* b" x, [) H: c9 A
McASPTxEnable(SOC_MCASP_0_CTRL_REGS);/ J  ~, ~2 s2 l4 ^# F7 d
}

1 ~. m) w: s" O: Q" N5 Q
请问:问题出在哪了,时钟按照这样配是否有错。
另外我看XDATA一直是0,接收的rxbuf0,1,2里有一般全是FFFF一半全是0.

7 t6 C% \7 T" w+ y3 A' q9 p
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