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程序upp通讯部分是从demo中uPP_B_TO_A移植过来。
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7 u& o/ U& a3 ~- m7 B$ Y1.linux系统下由arm控制dsp通过upp往fpga发送数据,程序运行过程中,开始upp数据传输接受正常。0 U) R4 h. I3 G0 `2 t
+ T- z! n" j/ W9 D8 d* ^8 t. R2.由arm控制dsp不停的启动,停止upp数据发送;在某一次发送时出现数据错位(通过fpga从数据总线抓取数据),然后fpga接受的数据都是错位的,重新加载dsp程序也无法恢复fpga接收正常数据,重启上电L138后再运行dsp程序upp的数据恢复正常。
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3.通过dlb寄存器进行BA回环发现错误的数据情况如下(与通过fpga从数据总线抓取数据一致):发送缓冲的数据顺序是1~128,但是回环到A通道,收到的数据是64~127,0~63。在测试过程中仿真器查看到UPQD0-2的值跟正常时一样,发送区数据顺序正确(在调试过程中查看寄存器及发送区地址,发送区是8字节对齐的,寄存器值没有发现异常) 。经过一段时间的测试,发现不是数据错位,而是0-63的数据是上次发送的值,二64-127的数据是本次的值。每次错误的字节数不一致,有时是前面112个数据都是上次的,有时只有16个数据是上次,64是最多的情况。
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6 o. b" T Y p) z+ x: z' D4.upp发送数据是通过fpga给dsp的gpio发送周期40us的方波,但是dsp以40us的间隔在gpio中断处理程序中往fpga送1行512字节的数据;
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附:发送时钟设置为37.5M,传输为b通道16bit传输,实际测量upp发送的enable信号持续大概7us;中间fpga没送wait信号;UPTCR的发送设为64和256都试过,结果都会出现错位。 g/ T! v! c/ V9 b6 ~. h0 Z
部分定义如下
8 ?3 ~3 O. F& W4 N- \# R#define upp_line_size (128)
2 R; Q4 M. Q7 `# T#define upp_line_count_s (1)$ T% r. v0 O$ q, P- Y, R- _. c
#define upp_line_count_r (1)
) `- ^$ [& ]2 F5 Q+ F0 g4 o* W#define upp_frame_size_s (upp_line_size * upp_line_count_s)
& a/ _" g* J Z- S#define upp_frame_size_r (upp_line_size * upp_line_count_r)
+ ]' i$ n% P( L#define upp_line_offset_s (upp_line_size) F+ y, K; O+ T; p8 ?& i- i
#define upp_line_offset_r (upp_line_size)
5 c- n, `- G) \$ N
7 b J- a' K1 s) I#pragma DATA_ALIGN(upp_buffer_s, 8)
- s/ Z) u2 P' Z. o5 o) h/ D#pragma DATA_ALIGN(upp_buffer_r, 8)
@2 o/ Q2 o/ G2 S8 _volatile Uint32 upp_buffer_s[upp_frame_size_s];! M8 e( a( O" l }. i# [9 G
volatile Uint32 upp_buffer_r[upp_frame_size_s];
$ ]5 x- y/ p: \" T% ?# a2 i/ c- d
; [; q& i6 b8 G" K: U; C0 r. t% U请教:这可能是出现什么问题了。
# b6 t8 _9 B( e: K; S% m9 @0 ]' D) W8 s2 y4 `" B( Q2 t. B
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