MCASP自环配置。 - OMAP-L138 - 嵌入式开发者社区 - 51ele.net
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[未解决] MCASP自环配置。

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发表于 2018-11-7 13:28:07 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
我项目上用OMAPL138的板子MCASP的引脚都是链接的FPGA,所以在FPGA这端设置的MCASP自环。把axr0接收到的通过axr1发回去。
部分代码如下
input mcasp_afsx,% Z3 ]0 Z9 d8 {9 @# r1 n$ F/ P
input mcasp_ahclkx,
0 p& _& R# `. x- hinput mcasp_aclkx,
; j" C0 ?5 g% D% l2 L: Y2 |input axr0,; }% ?# [; B7 e  R/ {( J

5 R- G9 s. a$ K+ `# `. x) n9 joutput mcasp_afsr,
; _1 [. V" r4 n( i  c5 |8 Koutput mcasp_ahclkr," F- ^- c; o" ]
output mcasp_aclkr,
7 S5 @  z5 q0 Joutput axr1,
: K( z  }% F% c+ ]) i4 G. v
assign mcasp_afsr = mcasp_afsx;$ Y* Y: n' M/ G# R1 X
assign mcasp_aclkr = mcasp_aclkx;* ?; n; ~# {1 ?2 u0 Z* h
assign mcasp_ahclkr = mcasp_ahclkx;
" l# Y3 d  E. ]4 A% f3 X; e3 Wassign axr1 = axr0;
- I) r- K( ^# t3 X# x
! a: L/ n3 I& Y# n8 P! E
在OMAPL138这端,通过axr0接口发固定的数,axr1接收。
在配置MACASP的时候,发送全部取内部时钟,接收全部取外部时钟。
一直循环发送,但是接收不到。在FPGA端也没有看到时钟和信号的波形。
部分代码如下,关于edma3的部分未做变化。

% R7 @0 Y, i' |  F' L- j9 X
static void McASPI2SConfigure(void)
% E1 @# ^$ V2 j. N) ?{; `3 G: e. \0 c3 c
McASPRxReset(SOC_MCASP_0_CTRL_REGS);
1 H( w9 E$ c- P2 }0 U; a( AMcASPTxReset(SOC_MCASP_0_CTRL_REGS);
/* Enable the FIFOs for DMA transfer *// ^+ M# K4 r/ L# v
McASPReadFifoEnable(SOC_MCASP_0_FIFO_REGS, 1, 1);$ e6 l  @" D4 j
McASPWriteFifoEnable(SOC_MCASP_0_FIFO_REGS, 1, 1);
/* Set I2S format in the transmitter/receiver format units */9 p* d. u& K: u$ n( |
McASPRxFmtI2SSet(SOC_MCASP_0_CTRL_REGS, WORD_SIZE, SLOT_SIZE,
, B4 H. M2 b; n9 \0 b6 B) g' G, yMCASP_RX_MODE_DMA);* f( g$ _) Z! m2 P
McASPTxFmtI2SSet(SOC_MCASP_0_CTRL_REGS, WORD_SIZE, SLOT_SIZE,
& T2 J; s2 k' yMCASP_TX_MODE_DMA);
/* Configure the frame sync. I2S shall work in TDM format with 2 slots */! ]$ C  r$ J# _  G1 G
McASPRxFrameSyncCfg(SOC_MCASP_0_CTRL_REGS, 2, MCASP_RX_FS_WIDTH_WORD, $ {  L1 G4 H. k- b. z8 u2 o
MCASP_RX_FS_EXT_BEGIN_ON_FALL_EDGE);
: D# ?, V. d0 ^0 bMcASPTxFrameSyncCfg(SOC_MCASP_0_CTRL_REGS, 2, MCASP_TX_FS_WIDTH_WORD, - N. \- N9 Y  _3 V( a
MCASP_TX_FS_INT_BEGIN_ON_RIS_EDGE);
/* configure the clock for receiver */
7 t7 k% t/ W. \/ f9 W0 `8 w$ oMcASPRxClkCfg(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_EXTERNAL, 0, 0);
" k; g; D- @  UMcASPRxClkPolaritySet(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_POL_RIS_EDGE);
/ g7 \! M/ t3 r$ Q0 |5 R* PMcASPRxClkCheckConfig(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLKCHCK_DIV32,# f+ }) V+ a) Z0 \7 i. i/ Z1 c# e
0x00, 0xFF);
/* configure the clock for transmitter */+ I( C; k+ Z1 F& F3 c- o" _
McASPTxClkCfg(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_INTERNAL, 11, 1);0 r9 L/ P' k8 z3 g/ n
McASPTxClkPolaritySet(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_POL_FALL_EDGE); / ?+ [3 Q$ ?  p; M+ c8 z
McASPTxClkCheckConfig(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLKCHCK_DIV32,* T) v6 }, A- J/ e' A; `2 C4 S
0x00, 0xFF);. v# H" m9 u2 G% T6 B

7 l6 H0 s6 s8 c( u/* Enable synchronization of RX and TX sections */
" d- o+ j+ q0 E( d" Y8 ~, J) EMcASPTxRxClkSyncEnable(SOC_MCASP_0_CTRL_REGS);
/* Enable the transmitter/receiver slots. I2S uses 2 slots */
3 h( A. @- J* M- Z" R4 q6 OMcASPRxTimeSlotSet(SOC_MCASP_0_CTRL_REGS, I2S_SLOTS);
2 C. B' }% s' s' q7 mMcASPTxTimeSlotSet(SOC_MCASP_0_CTRL_REGS, I2S_SLOTS);
/*0 n' m9 P# [+ z
** Set the serializers, Currently only one serializer is set as4 k' t  [! m9 m; C) G+ @3 t" [
** transmitter and one serializer as receiver.3 d8 j% L; A3 [3 B1 q
*/
) e$ R7 ^4 k" ^, [/ V3 JMcASPSerializerRxSet(SOC_MCASP_0_CTRL_REGS, MCASP_XSER_RX);0 Z$ H& I- r( h$ _- g2 ]" w& N
McASPSerializerTxSet(SOC_MCASP_0_CTRL_REGS, MCASP_XSER_TX);
/*# Z7 D5 P: w& `4 T$ T, O' J
** Configure the McASP pins , C) ~7 i0 ~# p7 K% w) t
** Input - Frame Sync, Clock and Serializer Rx9 B+ q+ X# S: L6 A% L3 y
** Output - Serializer Tx is connected to the input of the codec   r; L5 ^6 l9 G% H- ^
*// e' f" G7 G% t( V6 O" k3 q6 ?
McASPPinMcASPSet(SOC_MCASP_0_CTRL_REGS, 0xFFFFFFFF);  _$ e* [, ^/ v1 S
McASPPinDirOutputSet(SOC_MCASP_0_CTRL_REGS,MCASP_PIN_AXR(MCASP_XSER_TX));
# S, k0 I; j. @McASPPinDirInputSet(SOC_MCASP_0_CTRL_REGS, MCASP_PIN_AFSX
* l6 H/ L8 l' t; M+ w# t| MCASP_PIN_ACLKX
2 s, ?4 Q2 d4 f: d+ H" }| MCASP_PIN_AHCLKX
. D5 `0 M+ w$ s0 _| MCASP_PIN_AXR(MCASP_XSER_RX));
/* Enable error interrupts for McASP */
2 w2 g& E( U. ~3 j; w# ~$ KMcASPTxIntEnable(SOC_MCASP_0_CTRL_REGS, MCASP_TX_DMAERROR - S* L! a8 u% [: i" e
| MCASP_TX_CLKFAIL
. r3 R. [/ e8 l' Q) D4 O| MCASP_TX_SYNCERROR$ h8 a  K/ o- Y' T0 w( X+ R: r& G
| MCASP_TX_UNDERRUN);
McASPRxIntEnable(SOC_MCASP_0_CTRL_REGS, MCASP_RX_DMAERROR
2 e/ m0 N- w. |. W| MCASP_RX_CLKFAIL5 J- c/ A2 C( Y. R! L
| MCASP_RX_SYNCERROR
2 [  N7 O1 @$ f& b' N| MCASP_RX_OVERRUN);
0 J) b5 \$ ~/ A) ^& f8 a}
static void I2SDataTxRxActivate(void)
* t" R& ]3 ]) G( C{
! W+ W9 l( K" f' G4 x. e' F/ {/* Start the clocks */3 r  t5 q" _  z' I
McASPRxClkStart(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_EXTERNAL);
1 ~, i! l4 U. O2 g; n' G, C3 JMcASPTxClkStart(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_INTERNAL);
/* Enable EDMA for the transfer */
& {( e" Y. \) q! k# y1 DEDMA3EnableTransfer(SOC_EDMA30CC_0_REGS, EDMA3_CHA_MCASP0_RX,: h- D/ l) @) O
EDMA3_TRIG_MODE_EVENT);0 H; W* D: w; q, w; n
EDMA3EnableTransfer(SOC_EDMA30CC_0_REGS,
& ]6 Z1 i8 L: x& |& o+ d; CEDMA3_CHA_MCASP0_TX, EDMA3_TRIG_MODE_EVENT);
/* Activate the serializers */
' x- j* q$ H8 [& v, T2 K- mMcASPRxSerActivate(SOC_MCASP_0_CTRL_REGS);7 M; s5 c6 i" F) G5 D2 R
McASPTxSerActivate(SOC_MCASP_0_CTRL_REGS);
/* make sure that the XDATA bit is cleared to zero */& q8 R  r: }, y1 A& L+ u% C7 `8 D; q
while(McASPTxStatusGet(SOC_MCASP_0_CTRL_REGS) & MCASP_TX_STAT_DATAREADY);
/* Activate the state machines */
0 h* {9 L3 y9 `* e3 n* K) }McASPRxEnable(SOC_MCASP_0_CTRL_REGS);8 P0 g' D9 `2 T  V
McASPTxEnable(SOC_MCASP_0_CTRL_REGS);
0 G) ?3 }3 {/ \. ~}

3 l2 e$ Z% n9 E% n% \2 y
请问:问题出在哪了,时钟按照这样配是否有错。
另外我看XDATA一直是0,接收的rxbuf0,1,2里有一般全是FFFF一半全是0.

4 z4 X; [5 `: \& i6 I/ f; F
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