MCASP自环配置。 - OMAP-L138 - 嵌入式开发者社区 - 51ele.net
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[未解决] MCASP自环配置。

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发表于 2018-11-7 13:28:07 | 只看该作者 回帖奖励 |正序浏览 |阅读模式
我项目上用OMAPL138的板子MCASP的引脚都是链接的FPGA,所以在FPGA这端设置的MCASP自环。把axr0接收到的通过axr1发回去。
部分代码如下
input mcasp_afsx,
4 I8 T& [2 x% L* M) _8 oinput mcasp_ahclkx,
+ U3 D' _8 ?% U  C$ _* Dinput mcasp_aclkx,# S! A( R. V7 B9 d2 V; h
input axr0,
# V" L- I% S2 c
: P/ W  Z  n+ m; v; q6 qoutput mcasp_afsr,- d$ }9 J: W5 `4 n( f4 o* C! w
output mcasp_ahclkr,
2 e2 @2 ?. r" M! F) i! Eoutput mcasp_aclkr,/ Z1 e. t% L+ s+ S
output axr1,
; E4 q! e+ E+ q# a! ]$ o
assign mcasp_afsr = mcasp_afsx;' R. D: R3 m! ~9 Q
assign mcasp_aclkr = mcasp_aclkx;, T' r3 x2 b2 g+ }
assign mcasp_ahclkr = mcasp_ahclkx;
: S4 N/ o; z7 F* b! E; N0 ?0 eassign axr1 = axr0;
! i5 K  \* x$ o8 o( Z, k3 |

4 X0 o5 C1 `1 a4 G0 @6 l$ P1 A( q
在OMAPL138这端,通过axr0接口发固定的数,axr1接收。
在配置MACASP的时候,发送全部取内部时钟,接收全部取外部时钟。
一直循环发送,但是接收不到。在FPGA端也没有看到时钟和信号的波形。
部分代码如下,关于edma3的部分未做变化。
: |3 v& i6 z# u# K
static void McASPI2SConfigure(void)' T5 R) S: x( a  B0 w
{
8 n+ W3 H( {2 h4 y: DMcASPRxReset(SOC_MCASP_0_CTRL_REGS);) W3 C/ X+ d1 @5 _7 R
McASPTxReset(SOC_MCASP_0_CTRL_REGS);
/* Enable the FIFOs for DMA transfer */2 |, e2 B6 d" C0 W0 F+ S# r6 v
McASPReadFifoEnable(SOC_MCASP_0_FIFO_REGS, 1, 1);7 C8 O1 x& P. o1 f  o  `
McASPWriteFifoEnable(SOC_MCASP_0_FIFO_REGS, 1, 1);
/* Set I2S format in the transmitter/receiver format units */
, h+ l& s; S- x5 j5 vMcASPRxFmtI2SSet(SOC_MCASP_0_CTRL_REGS, WORD_SIZE, SLOT_SIZE,
/ E- j/ ~$ r8 NMCASP_RX_MODE_DMA);
+ I2 k! U# r& Y) DMcASPTxFmtI2SSet(SOC_MCASP_0_CTRL_REGS, WORD_SIZE, SLOT_SIZE,* P) }! s/ N' }' ]: f( L2 G0 O. l$ x
MCASP_TX_MODE_DMA);
/* Configure the frame sync. I2S shall work in TDM format with 2 slots */9 K9 s$ @  D0 l* |- w
McASPRxFrameSyncCfg(SOC_MCASP_0_CTRL_REGS, 2, MCASP_RX_FS_WIDTH_WORD, 4 U" K) X/ }2 j4 i1 w) U: U; a
MCASP_RX_FS_EXT_BEGIN_ON_FALL_EDGE);; F! A! C$ Z( C4 e; A' N7 g( \/ H
McASPTxFrameSyncCfg(SOC_MCASP_0_CTRL_REGS, 2, MCASP_TX_FS_WIDTH_WORD, 2 Q5 l, l) c+ ?' d
MCASP_TX_FS_INT_BEGIN_ON_RIS_EDGE);
/* configure the clock for receiver */
6 ^! Y" A+ G* p7 yMcASPRxClkCfg(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_EXTERNAL, 0, 0);) O# v0 ^6 F& k% T& D' a  Z
McASPRxClkPolaritySet(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_POL_RIS_EDGE); 8 v+ U! L9 e3 B/ a( N1 V2 e4 z3 O
McASPRxClkCheckConfig(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLKCHCK_DIV32,7 c7 j/ p6 q+ f2 |9 L7 s0 \, }7 d
0x00, 0xFF);
/* configure the clock for transmitter */( B  J/ L7 B; y+ J2 m! ?. p
McASPTxClkCfg(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_INTERNAL, 11, 1);" ~6 j, j  J& S" f5 W
McASPTxClkPolaritySet(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_POL_FALL_EDGE); 1 A- Z, ^" _7 R, |
McASPTxClkCheckConfig(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLKCHCK_DIV32,- P" _: j" x# N/ q; x) L
0x00, 0xFF);0 x3 k1 A% J. @; v  `$ x

4 Z( Y% Z: w( _" s2 K! K! [: B. ~/* Enable synchronization of RX and TX sections */
0 K7 v( M: ?, s0 y# ?! j- P2 ]) j  C9 y, EMcASPTxRxClkSyncEnable(SOC_MCASP_0_CTRL_REGS);
/* Enable the transmitter/receiver slots. I2S uses 2 slots */
) N' R6 x* O3 {McASPRxTimeSlotSet(SOC_MCASP_0_CTRL_REGS, I2S_SLOTS);5 B4 N! d3 g; n$ R+ ?: w
McASPTxTimeSlotSet(SOC_MCASP_0_CTRL_REGS, I2S_SLOTS);
/*( O8 C0 G# ^7 @$ ?
** Set the serializers, Currently only one serializer is set as
1 n" O/ G; y7 d, P' L** transmitter and one serializer as receiver.
# R" y2 E( i6 c( w*/
) z6 O2 e2 @- {9 ]7 b5 v2 _McASPSerializerRxSet(SOC_MCASP_0_CTRL_REGS, MCASP_XSER_RX);0 `$ f( {, z/ r  ]4 @( H
McASPSerializerTxSet(SOC_MCASP_0_CTRL_REGS, MCASP_XSER_TX);
/*
: e0 }% M( W: @** Configure the McASP pins ( u8 H3 _- n; {* e7 b; s
** Input - Frame Sync, Clock and Serializer Rx
* w7 k7 B/ v& C7 `* Q3 \! G: z** Output - Serializer Tx is connected to the input of the codec
. n/ p1 L5 ^$ w# _% L/ ?5 z+ a*/
. v' \* @- a5 C0 N6 o+ k' _9 j' [McASPPinMcASPSet(SOC_MCASP_0_CTRL_REGS, 0xFFFFFFFF);
" k9 K5 O4 u  W! G4 I1 ^& p2 TMcASPPinDirOutputSet(SOC_MCASP_0_CTRL_REGS,MCASP_PIN_AXR(MCASP_XSER_TX));6 q( v, v/ R! B- s6 I2 W4 A
McASPPinDirInputSet(SOC_MCASP_0_CTRL_REGS, MCASP_PIN_AFSX, s/ C8 P) y* m1 R* H, o
| MCASP_PIN_ACLKX$ e+ t! r! ?) p7 H9 S$ P
| MCASP_PIN_AHCLKX
4 E3 I" }! ~1 z/ f| MCASP_PIN_AXR(MCASP_XSER_RX));
/* Enable error interrupts for McASP */5 d( J7 b- P3 t  ?- W
McASPTxIntEnable(SOC_MCASP_0_CTRL_REGS, MCASP_TX_DMAERROR
2 M( ]0 n( e3 G, c| MCASP_TX_CLKFAIL
" O8 i8 s' |3 |: ]6 ]* }| MCASP_TX_SYNCERROR
! G$ w  k: @! |" d, j2 j( i) S7 ^| MCASP_TX_UNDERRUN);
McASPRxIntEnable(SOC_MCASP_0_CTRL_REGS, MCASP_RX_DMAERROR
$ w1 A, m, Y9 M/ q5 W. B  o| MCASP_RX_CLKFAIL
; x5 _; i6 ~: i0 ?8 \| MCASP_RX_SYNCERROR + U4 p5 T' U. h* Q* E4 A9 E2 A3 t
| MCASP_RX_OVERRUN);
7 Z7 H& m# K0 e  o}
static void I2SDataTxRxActivate(void)' V! K8 \( g. J
{
- O8 b9 u3 C  K8 c% {  P/* Start the clocks */" y1 Y2 \! {+ Q/ ~3 W" ?9 d3 q
McASPRxClkStart(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_EXTERNAL);
( Q5 g. ^1 k5 U, [& d4 dMcASPTxClkStart(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_INTERNAL);
/* Enable EDMA for the transfer */
, r: C% Y& k. V8 ?; B% NEDMA3EnableTransfer(SOC_EDMA30CC_0_REGS, EDMA3_CHA_MCASP0_RX,' h: e7 L6 P# B, `
EDMA3_TRIG_MODE_EVENT);
; F9 E/ i; }) e! y8 G. uEDMA3EnableTransfer(SOC_EDMA30CC_0_REGS, ( B/ n; ?( R+ f8 d8 }
EDMA3_CHA_MCASP0_TX, EDMA3_TRIG_MODE_EVENT);
/* Activate the serializers */$ L% g, w4 J; I; Z- e. m- N* k" d
McASPRxSerActivate(SOC_MCASP_0_CTRL_REGS);" Z* @  J" ]# w+ o
McASPTxSerActivate(SOC_MCASP_0_CTRL_REGS);
/* make sure that the XDATA bit is cleared to zero */. _& E, \( P/ U0 ~$ c
while(McASPTxStatusGet(SOC_MCASP_0_CTRL_REGS) & MCASP_TX_STAT_DATAREADY);
/* Activate the state machines */
, z& Q/ A. v7 Z" M  ~" C# n7 W+ G+ sMcASPRxEnable(SOC_MCASP_0_CTRL_REGS);
+ v, x  o( C9 e( lMcASPTxEnable(SOC_MCASP_0_CTRL_REGS);3 C' K$ y8 h% M/ O  O3 i
}
: o: E& y. v2 a
请问:问题出在哪了,时钟按照这样配是否有错。
另外我看XDATA一直是0,接收的rxbuf0,1,2里有一般全是FFFF一半全是0.

+ O3 u- U0 o+ b6 }0 |
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