MCASP自环配置。 - OMAP-L138 - 嵌入式开发者社区 - 51ele.net
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[未解决] MCASP自环配置。

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发表于 2018-11-7 13:28:07 | 只看该作者 回帖奖励 |正序浏览 |阅读模式
我项目上用OMAPL138的板子MCASP的引脚都是链接的FPGA,所以在FPGA这端设置的MCASP自环。把axr0接收到的通过axr1发回去。
部分代码如下
input mcasp_afsx,6 D5 P7 V, G$ `: x  J
input mcasp_ahclkx,
: V# q$ C( M9 L8 q+ E8 A* `+ |3 [input mcasp_aclkx,2 E1 k, T+ d4 T, X
input axr0,
4 I" s- y# D: z- d# _8 c$ w5 n, g# I; E! s  f! q& F
output mcasp_afsr,1 V3 f$ F( C9 F& I# x
output mcasp_ahclkr,- e8 M* Z* E" ~0 M
output mcasp_aclkr,
7 J" [" W8 `% d2 C* n, Youtput axr1,! J7 z4 b# R3 a* s8 u" ]
assign mcasp_afsr = mcasp_afsx;; C( C5 M4 Y- B% s$ ?
assign mcasp_aclkr = mcasp_aclkx;6 S) l) ~" E5 a
assign mcasp_ahclkr = mcasp_ahclkx;
; m' I( W# O* n3 Y1 Aassign axr1 = axr0;
; r. k* ]) h$ G/ _% J
9 P- Q( z5 M' w2 Z+ _' @
在OMAPL138这端,通过axr0接口发固定的数,axr1接收。
在配置MACASP的时候,发送全部取内部时钟,接收全部取外部时钟。
一直循环发送,但是接收不到。在FPGA端也没有看到时钟和信号的波形。
部分代码如下,关于edma3的部分未做变化。

' E& h6 m, ^7 K" Z
static void McASPI2SConfigure(void)
8 `% ^8 O1 R( ^1 e; z/ T{! d+ |: U9 s5 ?! ^6 }) h6 ?
McASPRxReset(SOC_MCASP_0_CTRL_REGS);' Z1 g* c7 W' s
McASPTxReset(SOC_MCASP_0_CTRL_REGS);
/* Enable the FIFOs for DMA transfer */
3 a; q! Y' k  b% f- \McASPReadFifoEnable(SOC_MCASP_0_FIFO_REGS, 1, 1);
% U! W4 e$ u5 T$ xMcASPWriteFifoEnable(SOC_MCASP_0_FIFO_REGS, 1, 1);
/* Set I2S format in the transmitter/receiver format units */3 B0 t4 p6 B! o: a0 A
McASPRxFmtI2SSet(SOC_MCASP_0_CTRL_REGS, WORD_SIZE, SLOT_SIZE,. P* L7 j) A; _) `% F
MCASP_RX_MODE_DMA);  ^5 G, i4 D9 @% E
McASPTxFmtI2SSet(SOC_MCASP_0_CTRL_REGS, WORD_SIZE, SLOT_SIZE,
8 a! l* q( a+ S5 J# I0 jMCASP_TX_MODE_DMA);
/* Configure the frame sync. I2S shall work in TDM format with 2 slots */
" }5 c. s4 U' q" ]McASPRxFrameSyncCfg(SOC_MCASP_0_CTRL_REGS, 2, MCASP_RX_FS_WIDTH_WORD,
! c% P# w* e  Z- o/ ^, W7 a5 i* yMCASP_RX_FS_EXT_BEGIN_ON_FALL_EDGE);( f: t2 F5 n4 Z1 c) y/ S* E/ x. t
McASPTxFrameSyncCfg(SOC_MCASP_0_CTRL_REGS, 2, MCASP_TX_FS_WIDTH_WORD,
+ U6 a0 h5 j: ~# Z; V$ OMCASP_TX_FS_INT_BEGIN_ON_RIS_EDGE);
/* configure the clock for receiver */
+ e2 q1 U' g8 S( U: @) C) U' DMcASPRxClkCfg(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_EXTERNAL, 0, 0);
; T4 M) h- U$ V' u2 e6 _- dMcASPRxClkPolaritySet(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_POL_RIS_EDGE);
) a3 }$ a  U5 i! uMcASPRxClkCheckConfig(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLKCHCK_DIV32,
* o' |5 _; ^, |# c# O0x00, 0xFF);
/* configure the clock for transmitter */
+ `7 {$ q' d0 S! V2 c  ]McASPTxClkCfg(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_INTERNAL, 11, 1);+ \2 ~/ N3 j- a# i( s# y2 n
McASPTxClkPolaritySet(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_POL_FALL_EDGE); 8 m& v& W2 y1 s6 w: r1 J) s! ~( E
McASPTxClkCheckConfig(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLKCHCK_DIV32,
7 h; }% ~( r/ d. I" N0x00, 0xFF);
( z" D! r# |, @- R! I4 ?
# ^0 K2 u* D+ ]! }/* Enable synchronization of RX and TX sections */ % |; ~/ P, R# X' y/ _
McASPTxRxClkSyncEnable(SOC_MCASP_0_CTRL_REGS);
/* Enable the transmitter/receiver slots. I2S uses 2 slots */6 r0 q1 U! W9 y! D( R$ ]
McASPRxTimeSlotSet(SOC_MCASP_0_CTRL_REGS, I2S_SLOTS);
5 q. I: p2 Y' h) f/ kMcASPTxTimeSlotSet(SOC_MCASP_0_CTRL_REGS, I2S_SLOTS);
/*' W* b" @3 N3 _, \9 a5 Z
** Set the serializers, Currently only one serializer is set as% L* n. k  R& u3 C( K
** transmitter and one serializer as receiver.2 K5 W  Y% |* \% a& k) ~
*/
7 W; G# L9 _# LMcASPSerializerRxSet(SOC_MCASP_0_CTRL_REGS, MCASP_XSER_RX);
# Q: O5 b# ?- A+ lMcASPSerializerTxSet(SOC_MCASP_0_CTRL_REGS, MCASP_XSER_TX);
/*
8 ~, V  C" g. l4 O. E) h) k! n) m** Configure the McASP pins 1 S. d2 h. q7 O( V' d
** Input - Frame Sync, Clock and Serializer Rx
( A! y7 x3 {: G+ {** Output - Serializer Tx is connected to the input of the codec
& _5 s2 x- l* X2 v4 b, Q1 U*/
2 {$ x, O, Y; K5 C" FMcASPPinMcASPSet(SOC_MCASP_0_CTRL_REGS, 0xFFFFFFFF);) ?( Z, Q  p; A/ N0 A1 g# \8 ^& Q
McASPPinDirOutputSet(SOC_MCASP_0_CTRL_REGS,MCASP_PIN_AXR(MCASP_XSER_TX));
) w1 T3 m7 [# b0 e4 wMcASPPinDirInputSet(SOC_MCASP_0_CTRL_REGS, MCASP_PIN_AFSX5 I$ F( x0 r  |  ^  g$ k8 J% J
| MCASP_PIN_ACLKX: X% f9 l. n, t( [
| MCASP_PIN_AHCLKX8 n- q4 b" s* d, [% z* u6 l
| MCASP_PIN_AXR(MCASP_XSER_RX));
/* Enable error interrupts for McASP */, ^8 x  S$ W- v$ d
McASPTxIntEnable(SOC_MCASP_0_CTRL_REGS, MCASP_TX_DMAERROR
( y- S! z' U( W| MCASP_TX_CLKFAIL + g6 |0 S" ^2 _1 u
| MCASP_TX_SYNCERROR3 g+ n$ l- A2 u; @4 f/ C
| MCASP_TX_UNDERRUN);
McASPRxIntEnable(SOC_MCASP_0_CTRL_REGS, MCASP_RX_DMAERROR
( a. s1 U* I4 G7 k/ c| MCASP_RX_CLKFAIL
6 j* k2 |# \$ k$ a| MCASP_RX_SYNCERROR : n9 `% }3 ?, f% q( P# Q% e
| MCASP_RX_OVERRUN);" w1 A) s% M5 G9 g* U+ T# a$ {
}
static void I2SDataTxRxActivate(void)# H# `4 S5 t& n  e) o  X
{6 a7 U4 a# u! \
/* Start the clocks */
1 m' f" {, i8 q. jMcASPRxClkStart(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_EXTERNAL);
, z! O7 r) Y  ^9 BMcASPTxClkStart(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_INTERNAL);
/* Enable EDMA for the transfer */
7 M, s+ L" B3 q) |: V: E5 YEDMA3EnableTransfer(SOC_EDMA30CC_0_REGS, EDMA3_CHA_MCASP0_RX,
2 n" d8 X7 m; e' d& Y$ pEDMA3_TRIG_MODE_EVENT);' V- k1 c) K- i' u/ c
EDMA3EnableTransfer(SOC_EDMA30CC_0_REGS, : @! A) w: E3 z# W$ i  m8 g
EDMA3_CHA_MCASP0_TX, EDMA3_TRIG_MODE_EVENT);
/* Activate the serializers */
- P! S6 [' \; f  y5 z- lMcASPRxSerActivate(SOC_MCASP_0_CTRL_REGS);! e; \% j1 S0 [: N8 r& S! S
McASPTxSerActivate(SOC_MCASP_0_CTRL_REGS);
/* make sure that the XDATA bit is cleared to zero */# r7 h$ `4 e4 L% u7 N6 N9 f
while(McASPTxStatusGet(SOC_MCASP_0_CTRL_REGS) & MCASP_TX_STAT_DATAREADY);
/* Activate the state machines */
$ |/ x( R4 L  T7 TMcASPRxEnable(SOC_MCASP_0_CTRL_REGS);" T; }4 g# k/ n% r$ g
McASPTxEnable(SOC_MCASP_0_CTRL_REGS);
& c, b. `, B3 j; \}

" s! s  R6 d  C1 f/ P4 u
请问:问题出在哪了,时钟按照这样配是否有错。
另外我看XDATA一直是0,接收的rxbuf0,1,2里有一般全是FFFF一半全是0.

$ \; G2 q6 `' E: Z  t* E, G" _
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