MCASP自环配置。 - OMAP-L138 - 嵌入式开发者社区 - 51ele.net
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[未解决] MCASP自环配置。

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发表于 2018-11-7 13:28:07 | 只看该作者 回帖奖励 |正序浏览 |阅读模式
我项目上用OMAPL138的板子MCASP的引脚都是链接的FPGA,所以在FPGA这端设置的MCASP自环。把axr0接收到的通过axr1发回去。
部分代码如下
input mcasp_afsx,2 W( ^! u6 ^! {8 C) x& F
input mcasp_ahclkx,7 h9 t6 A' X7 m* O& V6 H
input mcasp_aclkx,
' _+ O' L7 M! G5 o8 Q: K7 f1 b0 f- jinput axr0,
/ u# B: u5 H. @: X) m2 v. H* l, z9 C4 L# [9 i/ O0 s- I
output mcasp_afsr,! x) F0 h. G1 V  k; B4 L
output mcasp_ahclkr,: o6 g5 |+ i* b/ W8 ?
output mcasp_aclkr,
& k0 ^5 X2 `9 i( |/ f# Ioutput axr1,# e6 n6 x7 K/ j7 {1 w+ `5 P* m* h1 ~
assign mcasp_afsr = mcasp_afsx;
$ l0 `1 Y3 G& C% tassign mcasp_aclkr = mcasp_aclkx;
8 X8 E/ k) v: ^# xassign mcasp_ahclkr = mcasp_ahclkx;
  }# ?" P  u( E* R% w) fassign axr1 = axr0;

. L, G$ }1 d) w# |& \& _+ u: n7 \& N/ D7 c. l4 P5 y2 e$ y) [) y0 `* ~
在OMAPL138这端,通过axr0接口发固定的数,axr1接收。
在配置MACASP的时候,发送全部取内部时钟,接收全部取外部时钟。
一直循环发送,但是接收不到。在FPGA端也没有看到时钟和信号的波形。
部分代码如下,关于edma3的部分未做变化。

5 N) t% s" l: ^6 h5 U0 r
static void McASPI2SConfigure(void)
, V: m" y$ i9 d4 K. y9 I: M{2 K8 K6 @' R  j! \5 V  n8 ~( U$ b
McASPRxReset(SOC_MCASP_0_CTRL_REGS);* P7 K1 H, u* S; E4 e
McASPTxReset(SOC_MCASP_0_CTRL_REGS);
/* Enable the FIFOs for DMA transfer */
" r# E0 j4 |* I6 b; S8 S5 cMcASPReadFifoEnable(SOC_MCASP_0_FIFO_REGS, 1, 1);
( p3 C4 m4 b0 A7 ^( Q( V! a1 nMcASPWriteFifoEnable(SOC_MCASP_0_FIFO_REGS, 1, 1);
/* Set I2S format in the transmitter/receiver format units */: s4 Q0 r9 E, \/ X% ]
McASPRxFmtI2SSet(SOC_MCASP_0_CTRL_REGS, WORD_SIZE, SLOT_SIZE,
8 `  I, E: l& s- C( kMCASP_RX_MODE_DMA);  I' A6 I% C4 H+ v4 V
McASPTxFmtI2SSet(SOC_MCASP_0_CTRL_REGS, WORD_SIZE, SLOT_SIZE,
" b% k# |/ Q! _( `! RMCASP_TX_MODE_DMA);
/* Configure the frame sync. I2S shall work in TDM format with 2 slots */
2 `4 E- V  D2 \McASPRxFrameSyncCfg(SOC_MCASP_0_CTRL_REGS, 2, MCASP_RX_FS_WIDTH_WORD,
8 z. K4 d# `7 CMCASP_RX_FS_EXT_BEGIN_ON_FALL_EDGE);+ w9 L3 b2 g8 j$ x8 g
McASPTxFrameSyncCfg(SOC_MCASP_0_CTRL_REGS, 2, MCASP_TX_FS_WIDTH_WORD, # A0 x4 d# {& Y* j- Z8 b0 C
MCASP_TX_FS_INT_BEGIN_ON_RIS_EDGE);
/* configure the clock for receiver */
8 K8 N* I8 p# E& V; v% D, kMcASPRxClkCfg(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_EXTERNAL, 0, 0);
8 V! G9 j5 i! ?McASPRxClkPolaritySet(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_POL_RIS_EDGE);
1 x7 q" e& V) Q+ P: ^McASPRxClkCheckConfig(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLKCHCK_DIV32,
' f4 s! ?/ u& ~9 }' b0x00, 0xFF);
/* configure the clock for transmitter */
. M* L- U, h& r4 W0 U; AMcASPTxClkCfg(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_INTERNAL, 11, 1);
7 E( \* P  S7 ~+ K/ b5 SMcASPTxClkPolaritySet(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_POL_FALL_EDGE); & l  Q: D6 @8 W
McASPTxClkCheckConfig(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLKCHCK_DIV32,
$ M) f) A% J1 D0 A( n9 Z' s0x00, 0xFF);8 V+ q7 F+ t$ U# D* Y
9 a  ?8 @# f( ?8 m& T% m
/* Enable synchronization of RX and TX sections */ ! o6 s, `1 M2 R. ^6 \1 o
McASPTxRxClkSyncEnable(SOC_MCASP_0_CTRL_REGS);
/* Enable the transmitter/receiver slots. I2S uses 2 slots */
' w- S0 ^5 s7 P; I' ~4 lMcASPRxTimeSlotSet(SOC_MCASP_0_CTRL_REGS, I2S_SLOTS);  y! s. c! P& M, B2 G0 y# B, s$ N  ~. [
McASPTxTimeSlotSet(SOC_MCASP_0_CTRL_REGS, I2S_SLOTS);
/*
9 H: d  ~) V' Y+ c1 d+ `( R! U** Set the serializers, Currently only one serializer is set as
* D/ `- X% C! B0 L" b; K8 o** transmitter and one serializer as receiver.
( T, D$ ~6 I# }( M) x- h! O5 S*/
4 @. }) k: a: m. B2 x; _McASPSerializerRxSet(SOC_MCASP_0_CTRL_REGS, MCASP_XSER_RX);  o1 l& M% c6 [; V/ N. p
McASPSerializerTxSet(SOC_MCASP_0_CTRL_REGS, MCASP_XSER_TX);
/*1 W: O% {& E0 x5 A' N( u! b
** Configure the McASP pins
' t" Q) I: J  x. P$ r** Input - Frame Sync, Clock and Serializer Rx
7 J3 R9 b- Z9 i- |** Output - Serializer Tx is connected to the input of the codec
) c! H' B7 X7 [: o6 n8 z2 V' p5 ?+ D*/8 x+ n3 W9 l, Y8 q; ^5 n- I
McASPPinMcASPSet(SOC_MCASP_0_CTRL_REGS, 0xFFFFFFFF);9 [- e1 R( d' n
McASPPinDirOutputSet(SOC_MCASP_0_CTRL_REGS,MCASP_PIN_AXR(MCASP_XSER_TX));
9 k6 e2 U; P0 j& }, i" E9 }McASPPinDirInputSet(SOC_MCASP_0_CTRL_REGS, MCASP_PIN_AFSX& l' C4 u+ V' J
| MCASP_PIN_ACLKX
: j1 d$ S/ a+ k$ U) ~| MCASP_PIN_AHCLKX/ p7 g! t9 M- E7 o! \) W
| MCASP_PIN_AXR(MCASP_XSER_RX));
/* Enable error interrupts for McASP */  L, H' n6 M. \2 n& I. G
McASPTxIntEnable(SOC_MCASP_0_CTRL_REGS, MCASP_TX_DMAERROR
& A; c! A4 ^/ K% j0 p, h| MCASP_TX_CLKFAIL
6 }; d: ~- t$ q7 L3 B| MCASP_TX_SYNCERROR
$ z6 Y8 F3 \( q7 ]7 P- R| MCASP_TX_UNDERRUN);
McASPRxIntEnable(SOC_MCASP_0_CTRL_REGS, MCASP_RX_DMAERROR 6 u" _% G- q5 d% A. n+ j# ]7 J2 _
| MCASP_RX_CLKFAIL
) B, b5 L* }* u7 w. B+ M| MCASP_RX_SYNCERROR
5 [4 ^/ k/ Y4 _, `; Q- E. g$ M| MCASP_RX_OVERRUN);) `" p3 u' {: t5 b% g
}
static void I2SDataTxRxActivate(void)$ ~% W' s! C; y3 i: V2 |
{/ o4 n9 x0 c" G5 ]: m, ]+ F
/* Start the clocks */8 Y+ @3 K3 T* c, ]8 {
McASPRxClkStart(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_EXTERNAL);
& j! I/ l" O$ Z) M8 YMcASPTxClkStart(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_INTERNAL);
/* Enable EDMA for the transfer */# m8 B3 k' D! q" o9 P  |
EDMA3EnableTransfer(SOC_EDMA30CC_0_REGS, EDMA3_CHA_MCASP0_RX,, ]! `" C$ M/ i2 N4 }* Y3 J' n
EDMA3_TRIG_MODE_EVENT);- \& ?( C2 ~- S( @- k; |5 T
EDMA3EnableTransfer(SOC_EDMA30CC_0_REGS,
: m& m6 u# c1 r3 |+ n; z3 x6 y7 mEDMA3_CHA_MCASP0_TX, EDMA3_TRIG_MODE_EVENT);
/* Activate the serializers */9 \% B5 \& e1 a2 [! p( k: N
McASPRxSerActivate(SOC_MCASP_0_CTRL_REGS);
8 |# O8 a  `9 k. uMcASPTxSerActivate(SOC_MCASP_0_CTRL_REGS);
/* make sure that the XDATA bit is cleared to zero */! T5 Z, r: ~  Y% p* [4 A: B) {
while(McASPTxStatusGet(SOC_MCASP_0_CTRL_REGS) & MCASP_TX_STAT_DATAREADY);
/* Activate the state machines */
1 K9 r' H9 O5 \; F  EMcASPRxEnable(SOC_MCASP_0_CTRL_REGS);5 @* y9 l( f, W1 q! I% Z2 Q
McASPTxEnable(SOC_MCASP_0_CTRL_REGS);& L7 F4 l2 u; Q! f( F
}
9 f' \2 K* f4 r  W. v
请问:问题出在哪了,时钟按照这样配是否有错。
另外我看XDATA一直是0,接收的rxbuf0,1,2里有一般全是FFFF一半全是0.
) G$ Y7 E1 {  m1 ?& r, {
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