MCASP自环配置。 - OMAP-L138 - 嵌入式开发者社区 - 51ele.net
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[未解决] MCASP自环配置。

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发表于 2018-11-7 13:28:07 | 只看该作者 回帖奖励 |正序浏览 |阅读模式
我项目上用OMAPL138的板子MCASP的引脚都是链接的FPGA,所以在FPGA这端设置的MCASP自环。把axr0接收到的通过axr1发回去。
部分代码如下
input mcasp_afsx,
7 R3 ^" b* L% {$ _$ s; o; [input mcasp_ahclkx,/ J  _# l+ q+ I6 [9 |4 V
input mcasp_aclkx,
3 c# }0 ~' ]9 {- V7 O5 uinput axr0,4 x1 b# ~  Y4 T7 F0 H) [: }

1 m/ y) Z, n4 l" R! ?! ~) H$ Doutput mcasp_afsr,+ U4 v' J5 e8 O# i6 l5 @
output mcasp_ahclkr,
) B" y4 z/ c# u' \9 b' boutput mcasp_aclkr,4 D; _* k. F/ X4 X5 |9 g
output axr1,
) z  p8 R( c& H1 @
assign mcasp_afsr = mcasp_afsx;+ w' C8 c" ^0 J* u" M$ s9 i
assign mcasp_aclkr = mcasp_aclkx;
. b, W) m! v  F9 X" M4 Jassign mcasp_ahclkr = mcasp_ahclkx;5 Q4 d1 d; I! n0 T8 y
assign axr1 = axr0;

* V6 N! {/ }6 V$ y: S' S$ n  [1 A0 j( P5 o4 s5 v" B) x
在OMAPL138这端,通过axr0接口发固定的数,axr1接收。
在配置MACASP的时候,发送全部取内部时钟,接收全部取外部时钟。
一直循环发送,但是接收不到。在FPGA端也没有看到时钟和信号的波形。
部分代码如下,关于edma3的部分未做变化。

! v0 m9 r2 S" G
static void McASPI2SConfigure(void)% j8 b2 i9 o  k7 B
{
( A% }. _3 Z& ~7 \' K: Z# u/ F0 |McASPRxReset(SOC_MCASP_0_CTRL_REGS);+ G+ i1 j: b+ d6 M9 D" y! r  |& h
McASPTxReset(SOC_MCASP_0_CTRL_REGS);
/* Enable the FIFOs for DMA transfer */
% z8 j! O3 o% p4 K) a9 wMcASPReadFifoEnable(SOC_MCASP_0_FIFO_REGS, 1, 1);: \4 f- i% u0 x+ ?9 p* l
McASPWriteFifoEnable(SOC_MCASP_0_FIFO_REGS, 1, 1);
/* Set I2S format in the transmitter/receiver format units */
1 v+ v* p  C6 ^+ G( PMcASPRxFmtI2SSet(SOC_MCASP_0_CTRL_REGS, WORD_SIZE, SLOT_SIZE,; ^" u) W6 L: p' Q
MCASP_RX_MODE_DMA);9 U4 F, {" Z: B6 B" E/ [; p5 g- I% x
McASPTxFmtI2SSet(SOC_MCASP_0_CTRL_REGS, WORD_SIZE, SLOT_SIZE,. j, h3 ^7 O( ?9 Y2 Y
MCASP_TX_MODE_DMA);
/* Configure the frame sync. I2S shall work in TDM format with 2 slots */+ {5 }# ]5 ~/ n" }8 G  |
McASPRxFrameSyncCfg(SOC_MCASP_0_CTRL_REGS, 2, MCASP_RX_FS_WIDTH_WORD,
9 \' r9 ]# {9 u$ c$ h9 C$ i1 q: mMCASP_RX_FS_EXT_BEGIN_ON_FALL_EDGE);
* n: m9 s2 q: T) d: ?9 tMcASPTxFrameSyncCfg(SOC_MCASP_0_CTRL_REGS, 2, MCASP_TX_FS_WIDTH_WORD,
5 G" J" d0 n2 n2 k# PMCASP_TX_FS_INT_BEGIN_ON_RIS_EDGE);
/* configure the clock for receiver */) ?! d4 Z8 f$ Z5 H2 J
McASPRxClkCfg(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_EXTERNAL, 0, 0);- i2 @+ k& b$ ]( N- j' i
McASPRxClkPolaritySet(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_POL_RIS_EDGE); & q+ D, A; C* Z3 _$ ]1 |& z. O
McASPRxClkCheckConfig(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLKCHCK_DIV32,
5 z, Z  f+ \: p5 Q" b/ H# \# e6 J: f0x00, 0xFF);
/* configure the clock for transmitter */
5 Y% j2 U# }% u% G/ W- r6 \McASPTxClkCfg(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_INTERNAL, 11, 1);
: r/ H1 t( M- j4 YMcASPTxClkPolaritySet(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_POL_FALL_EDGE); , S1 M) D: j& P0 U+ X
McASPTxClkCheckConfig(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLKCHCK_DIV32,! k/ f# k7 @' k* r2 `
0x00, 0xFF);
' w2 R! v1 P9 G% O' U1 h
" ~- J9 P/ i$ W9 }1 M. H2 b/* Enable synchronization of RX and TX sections */ ' }" S4 @# `8 ~. U
McASPTxRxClkSyncEnable(SOC_MCASP_0_CTRL_REGS);
/* Enable the transmitter/receiver slots. I2S uses 2 slots */6 n) B" ?, x9 B7 Y5 O
McASPRxTimeSlotSet(SOC_MCASP_0_CTRL_REGS, I2S_SLOTS);# d( H1 b9 G5 d2 n$ F* w
McASPTxTimeSlotSet(SOC_MCASP_0_CTRL_REGS, I2S_SLOTS);
/*: a  X7 h9 m. N" f, I/ u
** Set the serializers, Currently only one serializer is set as" q$ p; P& C: H2 A5 f2 x
** transmitter and one serializer as receiver.7 G, ^5 ?, N! e
*/
7 q1 q- }( M9 u0 Q3 tMcASPSerializerRxSet(SOC_MCASP_0_CTRL_REGS, MCASP_XSER_RX);
+ |& W. r- t9 E/ Z/ B* y, ~McASPSerializerTxSet(SOC_MCASP_0_CTRL_REGS, MCASP_XSER_TX);
/*3 {5 ?1 G6 G% s) K$ o1 N
** Configure the McASP pins
& s3 E# M5 ^. W) |0 `; X1 f** Input - Frame Sync, Clock and Serializer Rx
: h2 U3 {& L8 I# k/ z** Output - Serializer Tx is connected to the input of the codec
2 l( F/ v0 m% p3 |*/: o- i* }5 G7 @8 S" A  Z
McASPPinMcASPSet(SOC_MCASP_0_CTRL_REGS, 0xFFFFFFFF);$ F4 s% M+ o$ h9 N; I
McASPPinDirOutputSet(SOC_MCASP_0_CTRL_REGS,MCASP_PIN_AXR(MCASP_XSER_TX));
; j3 x' E0 v0 Q0 FMcASPPinDirInputSet(SOC_MCASP_0_CTRL_REGS, MCASP_PIN_AFSX
" J0 k; l1 X$ e$ r# G9 I" D$ d| MCASP_PIN_ACLKX
6 ~4 \2 N$ T7 U0 P) ^2 U2 `9 L5 d| MCASP_PIN_AHCLKX
* S- ]% V2 T0 ?+ F, o| MCASP_PIN_AXR(MCASP_XSER_RX));
/* Enable error interrupts for McASP */) M. E& b" i! T9 _9 V  }
McASPTxIntEnable(SOC_MCASP_0_CTRL_REGS, MCASP_TX_DMAERROR 9 R! s: j; x0 K# x
| MCASP_TX_CLKFAIL 4 {# o$ u6 ?6 V$ Y: s; o
| MCASP_TX_SYNCERROR
) r( }! H( M" O& Y6 h1 z: q| MCASP_TX_UNDERRUN);
McASPRxIntEnable(SOC_MCASP_0_CTRL_REGS, MCASP_RX_DMAERROR
  g& f- b( v6 W| MCASP_RX_CLKFAIL5 [, G5 s  K1 ~0 U! i' v8 K
| MCASP_RX_SYNCERROR 2 o* u6 {0 i( V' g1 i* W: y' l+ T
| MCASP_RX_OVERRUN);$ D, J* p  ]2 c" s1 E% ~9 i5 \
}
static void I2SDataTxRxActivate(void)! v3 \" `" b5 w" e+ [" b. T% i! k
{
) c( H0 b, i4 ^* h- `* L/* Start the clocks */# X( q; s* i, x, w8 k: ]2 V
McASPRxClkStart(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_EXTERNAL);
: e* J$ ?  `' a6 q5 U+ Y, fMcASPTxClkStart(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_INTERNAL);
/* Enable EDMA for the transfer */! F* B- e0 r- t* Q
EDMA3EnableTransfer(SOC_EDMA30CC_0_REGS, EDMA3_CHA_MCASP0_RX,& A0 r) q" Z5 b) ?0 b7 c5 b
EDMA3_TRIG_MODE_EVENT);
0 k3 S: N1 j2 J9 d# yEDMA3EnableTransfer(SOC_EDMA30CC_0_REGS,
! u8 F4 c0 e9 d9 Y5 vEDMA3_CHA_MCASP0_TX, EDMA3_TRIG_MODE_EVENT);
/* Activate the serializers */
7 C* P( J: z& C8 W9 QMcASPRxSerActivate(SOC_MCASP_0_CTRL_REGS);0 c6 v4 e3 M1 {; Q  C
McASPTxSerActivate(SOC_MCASP_0_CTRL_REGS);
/* make sure that the XDATA bit is cleared to zero */
% I/ O: O4 W9 X1 Jwhile(McASPTxStatusGet(SOC_MCASP_0_CTRL_REGS) & MCASP_TX_STAT_DATAREADY);
/* Activate the state machines */
" i/ }( O+ O( U0 U: ZMcASPRxEnable(SOC_MCASP_0_CTRL_REGS);
" b! _; q( y' L' DMcASPTxEnable(SOC_MCASP_0_CTRL_REGS);
$ g- B& Q4 |+ d$ b: S; J}

- h- K% e9 V. F. @; }! M; P* D
请问:问题出在哪了,时钟按照这样配是否有错。
另外我看XDATA一直是0,接收的rxbuf0,1,2里有一般全是FFFF一半全是0.
$ D( ^  v8 ?3 U: l* B5 a. w* |$ v
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