MCASP自环配置。 - OMAP-L138 - 嵌入式开发者社区 - 51ele.net
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[未解决] MCASP自环配置。

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发表于 2018-11-7 13:28:07 | 只看该作者 回帖奖励 |正序浏览 |阅读模式
我项目上用OMAPL138的板子MCASP的引脚都是链接的FPGA,所以在FPGA这端设置的MCASP自环。把axr0接收到的通过axr1发回去。
部分代码如下
input mcasp_afsx,
. y- V' ?  p1 L6 N/ v! i; c# Rinput mcasp_ahclkx,
6 e4 S# D; V( \( q  Winput mcasp_aclkx,* y, J; u$ _; r$ H4 p0 ?% ?
input axr0,
* m+ ^. b# J1 \
* d% w- V; V( Z8 [  goutput mcasp_afsr,
7 m. Q# h- b- x/ foutput mcasp_ahclkr,
6 e2 f. n* u- C& doutput mcasp_aclkr,
, b7 r4 b; Y' S' c8 n" X( m8 Moutput axr1,
3 d1 J, ?7 J; k) }( K) L8 v
assign mcasp_afsr = mcasp_afsx;
( r$ E% Z0 T: @" ?assign mcasp_aclkr = mcasp_aclkx;% i  m  x5 A  Z* J- D( M
assign mcasp_ahclkr = mcasp_ahclkx;5 E: z3 e& }+ k0 X* [3 p5 r
assign axr1 = axr0;
; ^# |7 D# v4 ~- _/ t
" J4 q+ {1 n5 [6 b. S# ?: [
在OMAPL138这端,通过axr0接口发固定的数,axr1接收。
在配置MACASP的时候,发送全部取内部时钟,接收全部取外部时钟。
一直循环发送,但是接收不到。在FPGA端也没有看到时钟和信号的波形。
部分代码如下,关于edma3的部分未做变化。
3 p: ^# d3 l9 S7 A- w7 I1 G% J. Z2 i
static void McASPI2SConfigure(void)* j; E3 G; A) M0 E: |. E; G3 W
{
5 t: g9 L6 I# u' a4 A8 XMcASPRxReset(SOC_MCASP_0_CTRL_REGS);; P4 |5 ^* W, l; V; k7 M& k
McASPTxReset(SOC_MCASP_0_CTRL_REGS);
/* Enable the FIFOs for DMA transfer */
3 p; V& M& v8 H: {# x, J/ sMcASPReadFifoEnable(SOC_MCASP_0_FIFO_REGS, 1, 1);/ L' H/ a7 }' N" X9 T$ C
McASPWriteFifoEnable(SOC_MCASP_0_FIFO_REGS, 1, 1);
/* Set I2S format in the transmitter/receiver format units */1 U0 ]3 m7 j) J: y' X$ @& m
McASPRxFmtI2SSet(SOC_MCASP_0_CTRL_REGS, WORD_SIZE, SLOT_SIZE,6 \, s# R% T, L% n9 b
MCASP_RX_MODE_DMA);
: }4 i+ d& B& BMcASPTxFmtI2SSet(SOC_MCASP_0_CTRL_REGS, WORD_SIZE, SLOT_SIZE,6 y6 j& \; U. s9 _" v9 g
MCASP_TX_MODE_DMA);
/* Configure the frame sync. I2S shall work in TDM format with 2 slots */
% c, f) F9 [; {1 T% V& A. ^1 cMcASPRxFrameSyncCfg(SOC_MCASP_0_CTRL_REGS, 2, MCASP_RX_FS_WIDTH_WORD, 5 H5 M. L/ O+ {( ?. Z: `
MCASP_RX_FS_EXT_BEGIN_ON_FALL_EDGE);0 ]# j3 h0 k; z# q" r9 O, A
McASPTxFrameSyncCfg(SOC_MCASP_0_CTRL_REGS, 2, MCASP_TX_FS_WIDTH_WORD,
/ M6 v% s/ p/ O0 }9 D8 r/ F6 QMCASP_TX_FS_INT_BEGIN_ON_RIS_EDGE);
/* configure the clock for receiver */
+ D. v7 s- U, yMcASPRxClkCfg(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_EXTERNAL, 0, 0);% m5 _: k8 E2 O) S
McASPRxClkPolaritySet(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_POL_RIS_EDGE); 5 S+ ]9 z+ I8 S+ Z
McASPRxClkCheckConfig(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLKCHCK_DIV32,
$ `" Y$ L0 c# t& W0x00, 0xFF);
/* configure the clock for transmitter */& p& X3 o8 h+ O& o) O/ _+ D
McASPTxClkCfg(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_INTERNAL, 11, 1);# L0 ~  h$ r" _8 E. r3 j
McASPTxClkPolaritySet(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_POL_FALL_EDGE);
/ B0 G/ W* M, UMcASPTxClkCheckConfig(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLKCHCK_DIV32,' F) f# Q. H+ c
0x00, 0xFF);
4 Q" G1 q3 f8 X! T; z
. |. C, }" Q* j; l/* Enable synchronization of RX and TX sections */
/ h7 g( t  s% O* r' p6 aMcASPTxRxClkSyncEnable(SOC_MCASP_0_CTRL_REGS);
/* Enable the transmitter/receiver slots. I2S uses 2 slots */
( E% u7 q1 E2 _9 Q0 m' ]. {# A2 l) yMcASPRxTimeSlotSet(SOC_MCASP_0_CTRL_REGS, I2S_SLOTS);0 T! Y% P" Q1 N
McASPTxTimeSlotSet(SOC_MCASP_0_CTRL_REGS, I2S_SLOTS);
/*0 c; j" H" V7 a. c7 \* [6 n
** Set the serializers, Currently only one serializer is set as9 |0 r& f6 D% Z) {- [
** transmitter and one serializer as receiver.) N  Y  @- P6 I
*/
. q5 o0 v  F, W- t0 Z5 UMcASPSerializerRxSet(SOC_MCASP_0_CTRL_REGS, MCASP_XSER_RX);/ U8 n  B) w4 E) C8 L4 A
McASPSerializerTxSet(SOC_MCASP_0_CTRL_REGS, MCASP_XSER_TX);
/*
/ e4 O" s, C' K  Q** Configure the McASP pins : t6 m# h) ~$ g, X& m  j" ?1 K
** Input - Frame Sync, Clock and Serializer Rx
7 M8 C+ Q& T1 a% q' s+ S' H# X** Output - Serializer Tx is connected to the input of the codec 2 K# D3 A1 J0 n& w* U5 n
*/
$ d" ~( H# v" B+ o$ k: U8 nMcASPPinMcASPSet(SOC_MCASP_0_CTRL_REGS, 0xFFFFFFFF);0 \+ h; i) ~& T. Y1 E
McASPPinDirOutputSet(SOC_MCASP_0_CTRL_REGS,MCASP_PIN_AXR(MCASP_XSER_TX));. Y1 o$ C' U2 o
McASPPinDirInputSet(SOC_MCASP_0_CTRL_REGS, MCASP_PIN_AFSX$ @, \  s7 a2 V, ~, O
| MCASP_PIN_ACLKX3 ?1 t& M( o; Y6 ^
| MCASP_PIN_AHCLKX, ?4 B8 P7 M) v& ?
| MCASP_PIN_AXR(MCASP_XSER_RX));
/* Enable error interrupts for McASP */
& u: B% y- `- o+ _0 M& M, dMcASPTxIntEnable(SOC_MCASP_0_CTRL_REGS, MCASP_TX_DMAERROR ) U5 Z# ^5 `& a4 _9 J, n
| MCASP_TX_CLKFAIL
1 ?& i$ R1 y6 w7 j6 c| MCASP_TX_SYNCERROR
' I% C$ ]; x1 F  j| MCASP_TX_UNDERRUN);
McASPRxIntEnable(SOC_MCASP_0_CTRL_REGS, MCASP_RX_DMAERROR 3 j' Y3 }: p, v
| MCASP_RX_CLKFAIL- l- `3 W3 Y3 C
| MCASP_RX_SYNCERROR 9 d6 v% W' L% e/ G
| MCASP_RX_OVERRUN);5 n4 f: B" A; r. y9 C
}
static void I2SDataTxRxActivate(void)
& N" G3 H2 E( @8 s* ]{
' e  V8 w7 C/ N3 G5 x: E' w/* Start the clocks */. ]$ ~  m( R& z
McASPRxClkStart(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_EXTERNAL);) J6 P0 G( K* g( v* K
McASPTxClkStart(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_INTERNAL);
/* Enable EDMA for the transfer */
9 b. a4 `3 x. p) E- b* Z4 h& tEDMA3EnableTransfer(SOC_EDMA30CC_0_REGS, EDMA3_CHA_MCASP0_RX,1 f1 f: \7 j# d0 U( N( B% o: V
EDMA3_TRIG_MODE_EVENT);
) }8 e$ o0 H3 QEDMA3EnableTransfer(SOC_EDMA30CC_0_REGS,
$ }; u8 w2 w( f7 r0 ~EDMA3_CHA_MCASP0_TX, EDMA3_TRIG_MODE_EVENT);
/* Activate the serializers */4 ?$ q- A3 t& q& H; ^9 \
McASPRxSerActivate(SOC_MCASP_0_CTRL_REGS);& N7 W* E5 h/ c! @- \
McASPTxSerActivate(SOC_MCASP_0_CTRL_REGS);
/* make sure that the XDATA bit is cleared to zero */
8 M; k1 {# e0 a+ c- d: Q) Xwhile(McASPTxStatusGet(SOC_MCASP_0_CTRL_REGS) & MCASP_TX_STAT_DATAREADY);
/* Activate the state machines */% T$ R% N7 s/ J$ {* ]
McASPRxEnable(SOC_MCASP_0_CTRL_REGS);
" m7 v& v, i; b* {( M9 x( x" DMcASPTxEnable(SOC_MCASP_0_CTRL_REGS);
7 {/ Z8 a, o# `# f}
! ^$ b) m& ?, p0 R# R
请问:问题出在哪了,时钟按照这样配是否有错。
另外我看XDATA一直是0,接收的rxbuf0,1,2里有一般全是FFFF一半全是0.
( ~) v9 j, O0 D/ G5 A
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