MCASP自环配置。 - OMAP-L138 - 嵌入式开发者社区 - 51ele.net
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[未解决] MCASP自环配置。

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发表于 2018-11-7 13:28:07 | 只看该作者 回帖奖励 |正序浏览 |阅读模式
我项目上用OMAPL138的板子MCASP的引脚都是链接的FPGA,所以在FPGA这端设置的MCASP自环。把axr0接收到的通过axr1发回去。
部分代码如下
input mcasp_afsx,5 R: G$ h' M* z$ Y. w  v
input mcasp_ahclkx,
$ f3 {8 B, ~5 L' ?2 v- Dinput mcasp_aclkx,& v4 h* P! x3 E& Z
input axr0,
9 N" v9 C4 w# `/ l4 p. O/ {, R$ i  A7 ]7 I9 J
output mcasp_afsr,
% j" o7 B; y" F2 y. c& C. h  i8 Houtput mcasp_ahclkr,; ]$ y1 K6 u4 P
output mcasp_aclkr,, y& P* V7 l' ]: y; ~; v4 V
output axr1,
; u, \# w. w- ]" o4 p. {! J
assign mcasp_afsr = mcasp_afsx;; U5 h, v0 B3 Z6 S* ?
assign mcasp_aclkr = mcasp_aclkx;% w  S- a. n, |5 }6 Q8 G
assign mcasp_ahclkr = mcasp_ahclkx;
. y" W4 s( U- b0 i+ H. q* k5 _3 @$ `assign axr1 = axr0;
& w+ \6 E0 p0 ?( @/ }
4 }" O) o4 [9 h* t7 w
在OMAPL138这端,通过axr0接口发固定的数,axr1接收。
在配置MACASP的时候,发送全部取内部时钟,接收全部取外部时钟。
一直循环发送,但是接收不到。在FPGA端也没有看到时钟和信号的波形。
部分代码如下,关于edma3的部分未做变化。
5 y: g7 e/ y8 {
static void McASPI2SConfigure(void)$ p2 }5 P2 A0 [4 v9 |. d5 C1 i, @
{+ U  A, i' [; j& q% `+ c
McASPRxReset(SOC_MCASP_0_CTRL_REGS);. z2 l3 N9 m: [, z
McASPTxReset(SOC_MCASP_0_CTRL_REGS);
/* Enable the FIFOs for DMA transfer */
" b& @0 p* C, VMcASPReadFifoEnable(SOC_MCASP_0_FIFO_REGS, 1, 1);9 C; w! J$ U; n' c4 f
McASPWriteFifoEnable(SOC_MCASP_0_FIFO_REGS, 1, 1);
/* Set I2S format in the transmitter/receiver format units */8 D7 F2 \5 }: j" x' M
McASPRxFmtI2SSet(SOC_MCASP_0_CTRL_REGS, WORD_SIZE, SLOT_SIZE,
* U: x. O8 e3 o7 \+ AMCASP_RX_MODE_DMA);: G. G' o5 |5 A8 d  Y- f: N
McASPTxFmtI2SSet(SOC_MCASP_0_CTRL_REGS, WORD_SIZE, SLOT_SIZE,
: N2 Y- x6 Z6 \  SMCASP_TX_MODE_DMA);
/* Configure the frame sync. I2S shall work in TDM format with 2 slots *// G2 l" c8 F8 n5 Y# g4 Q$ ~
McASPRxFrameSyncCfg(SOC_MCASP_0_CTRL_REGS, 2, MCASP_RX_FS_WIDTH_WORD,
; X0 }  q! C% C/ O! [$ OMCASP_RX_FS_EXT_BEGIN_ON_FALL_EDGE);
9 V# R9 P7 J1 q/ x1 T# b+ l+ lMcASPTxFrameSyncCfg(SOC_MCASP_0_CTRL_REGS, 2, MCASP_TX_FS_WIDTH_WORD,
) o. a6 \" e- a; L7 U2 oMCASP_TX_FS_INT_BEGIN_ON_RIS_EDGE);
/* configure the clock for receiver */
2 F& c2 m2 b1 V% R( J9 i! AMcASPRxClkCfg(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_EXTERNAL, 0, 0);1 F! Y  Z0 i( O# G8 U8 ?0 F
McASPRxClkPolaritySet(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_POL_RIS_EDGE); ' ~; c( s  ^* I* B/ t0 K. w4 |! V
McASPRxClkCheckConfig(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLKCHCK_DIV32,3 |0 R: P  v8 }
0x00, 0xFF);
/* configure the clock for transmitter */' r5 G/ l" Y* S: Z! t
McASPTxClkCfg(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_INTERNAL, 11, 1);
1 h/ v3 u" Y. n. z0 sMcASPTxClkPolaritySet(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_POL_FALL_EDGE);
5 o9 T: \) v0 l5 {* m% _( RMcASPTxClkCheckConfig(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLKCHCK_DIV32,
1 J& i9 T7 b* F& X0x00, 0xFF);0 X2 r/ M/ G. m; B" g0 A* |$ V6 X
, K! i) k# D3 I+ f# J( f& ?
/* Enable synchronization of RX and TX sections */
" b* a" G6 w! `! x6 L6 UMcASPTxRxClkSyncEnable(SOC_MCASP_0_CTRL_REGS);
/* Enable the transmitter/receiver slots. I2S uses 2 slots */
0 v: r5 _; z6 ]$ J- _2 F' jMcASPRxTimeSlotSet(SOC_MCASP_0_CTRL_REGS, I2S_SLOTS);
0 E  h! O5 d1 R$ z% w- l+ [McASPTxTimeSlotSet(SOC_MCASP_0_CTRL_REGS, I2S_SLOTS);
/*
9 g9 X  e7 J) z# d1 H: p/ D0 L** Set the serializers, Currently only one serializer is set as6 G1 o2 \% v( ~' t
** transmitter and one serializer as receiver.
0 A3 Y  J6 ]8 v*/$ w  L/ _- U  o' x5 Q
McASPSerializerRxSet(SOC_MCASP_0_CTRL_REGS, MCASP_XSER_RX);6 ^- `0 U6 i+ k$ ^
McASPSerializerTxSet(SOC_MCASP_0_CTRL_REGS, MCASP_XSER_TX);
/*4 ]. p4 K+ H" }5 P3 s6 C3 x5 c# t
** Configure the McASP pins $ a  G6 Q. h0 M! L2 D5 p
** Input - Frame Sync, Clock and Serializer Rx
0 j# l0 o8 ^  [7 \** Output - Serializer Tx is connected to the input of the codec
/ _/ K8 Y# U% o! \& t* m1 n*/9 l: g% X5 P0 k! {# d7 `
McASPPinMcASPSet(SOC_MCASP_0_CTRL_REGS, 0xFFFFFFFF);
8 m  b" j# p- h* fMcASPPinDirOutputSet(SOC_MCASP_0_CTRL_REGS,MCASP_PIN_AXR(MCASP_XSER_TX));' e+ f# _: d6 F$ {
McASPPinDirInputSet(SOC_MCASP_0_CTRL_REGS, MCASP_PIN_AFSX: t4 p6 g) c5 B
| MCASP_PIN_ACLKX
8 _; u6 D# X3 B| MCASP_PIN_AHCLKX
" P. e& p- N8 [# Y| MCASP_PIN_AXR(MCASP_XSER_RX));
/* Enable error interrupts for McASP */+ T, F9 w8 f3 O7 L2 I: K
McASPTxIntEnable(SOC_MCASP_0_CTRL_REGS, MCASP_TX_DMAERROR , S6 l$ u1 M& `$ x% {
| MCASP_TX_CLKFAIL
  l' R- p( B: o; o0 `! o" d/ O| MCASP_TX_SYNCERROR
* x# g; I2 {5 D, g6 ?$ R) J4 R| MCASP_TX_UNDERRUN);
McASPRxIntEnable(SOC_MCASP_0_CTRL_REGS, MCASP_RX_DMAERROR
+ L0 H" g5 f2 Z# y  L, y6 p| MCASP_RX_CLKFAIL% |; ?2 m# Z( g2 d$ ~8 B8 n
| MCASP_RX_SYNCERROR - J1 D. K  O) f4 n* X1 A
| MCASP_RX_OVERRUN);
/ x% {7 f5 J" V  A- L. ^4 Y}
static void I2SDataTxRxActivate(void)
6 J3 Y7 I! w0 Y' S  U- r- V& F{
9 U& \1 l6 l- W: T3 }; L/* Start the clocks */
9 n& g/ f8 ]* x  k7 N6 |$ kMcASPRxClkStart(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_EXTERNAL);
: X5 E! j+ H! J: ?3 ^) f$ `7 JMcASPTxClkStart(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_INTERNAL);
/* Enable EDMA for the transfer */
% e$ y  l$ u3 e4 q4 C8 [; eEDMA3EnableTransfer(SOC_EDMA30CC_0_REGS, EDMA3_CHA_MCASP0_RX,
% z2 k# m. m1 b) C1 G/ {EDMA3_TRIG_MODE_EVENT);
$ D( T  G+ Z, v. f1 PEDMA3EnableTransfer(SOC_EDMA30CC_0_REGS, 1 _& V# ~3 N7 s% L4 F! E0 G+ H* L2 A9 M
EDMA3_CHA_MCASP0_TX, EDMA3_TRIG_MODE_EVENT);
/* Activate the serializers */
$ a9 ]! k* t/ ~0 D/ [McASPRxSerActivate(SOC_MCASP_0_CTRL_REGS);
& ?1 a7 i* l- J% F6 _  a  VMcASPTxSerActivate(SOC_MCASP_0_CTRL_REGS);
/* make sure that the XDATA bit is cleared to zero */- B2 ]9 a0 {. T( L" X4 ]+ z3 k* V6 m
while(McASPTxStatusGet(SOC_MCASP_0_CTRL_REGS) & MCASP_TX_STAT_DATAREADY);
/* Activate the state machines */" M  T/ u: g* N% r$ v
McASPRxEnable(SOC_MCASP_0_CTRL_REGS);
7 d! R! m- w1 y: l# MMcASPTxEnable(SOC_MCASP_0_CTRL_REGS);4 ~: J- f! O, T8 ?7 I" e; z' ~
}
- ]* C* O3 X* ]1 p9 r0 U# l: I$ e, D
请问:问题出在哪了,时钟按照这样配是否有错。
另外我看XDATA一直是0,接收的rxbuf0,1,2里有一般全是FFFF一半全是0.
$ N: X: L8 t) G! ^3 ]3 s
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