MCASP自环配置。 - OMAP-L138 - 嵌入式开发者社区 - 51ele.net
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[未解决] MCASP自环配置。

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发表于 2018-11-7 13:28:07 | 只看该作者 回帖奖励 |正序浏览 |阅读模式
我项目上用OMAPL138的板子MCASP的引脚都是链接的FPGA,所以在FPGA这端设置的MCASP自环。把axr0接收到的通过axr1发回去。
部分代码如下
input mcasp_afsx,3 q5 ?9 Z7 ]4 J/ r1 W: X1 B
input mcasp_ahclkx,* P4 N( a& F+ d2 s0 F
input mcasp_aclkx,2 N; E* X8 o) s; {$ Z1 U( k/ o1 N
input axr0,: H( p$ J3 C, S* l# ^9 P

4 ]8 n) I) a' f; q* |output mcasp_afsr,
9 ?- n9 G3 u  J( boutput mcasp_ahclkr,
$ A6 }& X% W" F! I# f) H0 g# xoutput mcasp_aclkr,
% m  l4 k$ L9 w# Coutput axr1,
9 t9 @9 D8 }( N9 x- w, @
assign mcasp_afsr = mcasp_afsx;
% ]8 S- T5 T8 n& w' F: a* S* j+ dassign mcasp_aclkr = mcasp_aclkx;$ A) \* \) `8 U2 ^. a$ I
assign mcasp_ahclkr = mcasp_ahclkx;
0 @' f$ Y$ r8 passign axr1 = axr0;
. Y& `3 v# T5 Q3 c( Y
$ k3 ?5 X7 ?0 D% E# `) `
在OMAPL138这端,通过axr0接口发固定的数,axr1接收。
在配置MACASP的时候,发送全部取内部时钟,接收全部取外部时钟。
一直循环发送,但是接收不到。在FPGA端也没有看到时钟和信号的波形。
部分代码如下,关于edma3的部分未做变化。
0 A& E* A8 n5 r, X7 l
static void McASPI2SConfigure(void)
$ H6 I* [. A1 P; A5 Q+ ]) C; n{# ^2 P. d, B& ^6 C- N
McASPRxReset(SOC_MCASP_0_CTRL_REGS);3 K) u8 K! L/ m) A/ c. y8 M
McASPTxReset(SOC_MCASP_0_CTRL_REGS);
/* Enable the FIFOs for DMA transfer */# }* ]( R% n' ~" G) q
McASPReadFifoEnable(SOC_MCASP_0_FIFO_REGS, 1, 1);& o2 f( X  Z- u# K6 R
McASPWriteFifoEnable(SOC_MCASP_0_FIFO_REGS, 1, 1);
/* Set I2S format in the transmitter/receiver format units */" w9 g* e5 j  j7 U% p2 c
McASPRxFmtI2SSet(SOC_MCASP_0_CTRL_REGS, WORD_SIZE, SLOT_SIZE,* v2 E8 ?& Z3 @2 D1 q7 q
MCASP_RX_MODE_DMA);% F2 c3 ^: l3 q
McASPTxFmtI2SSet(SOC_MCASP_0_CTRL_REGS, WORD_SIZE, SLOT_SIZE,
9 w8 z% I+ i) \8 q% ]. fMCASP_TX_MODE_DMA);
/* Configure the frame sync. I2S shall work in TDM format with 2 slots */' [& W/ D2 X8 x
McASPRxFrameSyncCfg(SOC_MCASP_0_CTRL_REGS, 2, MCASP_RX_FS_WIDTH_WORD,
9 [& U) U7 C8 d5 |' b& h3 OMCASP_RX_FS_EXT_BEGIN_ON_FALL_EDGE);
! r7 k) Q: b" f! `McASPTxFrameSyncCfg(SOC_MCASP_0_CTRL_REGS, 2, MCASP_TX_FS_WIDTH_WORD,
3 ~' E* U+ ?0 LMCASP_TX_FS_INT_BEGIN_ON_RIS_EDGE);
/* configure the clock for receiver */( ]) z6 a8 H7 H7 l% v  {, v6 Q, v. C
McASPRxClkCfg(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_EXTERNAL, 0, 0);
; ?. C' h% ^. ^0 W1 }; j) zMcASPRxClkPolaritySet(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_POL_RIS_EDGE); 3 B  M. `  y% l* L
McASPRxClkCheckConfig(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLKCHCK_DIV32,
  w  P5 `0 X9 y5 Z) R0 h8 H: I0x00, 0xFF);
/* configure the clock for transmitter */1 u" v! o$ u5 A5 T( k
McASPTxClkCfg(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_INTERNAL, 11, 1);
; o, }+ A* P* u8 I- xMcASPTxClkPolaritySet(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_POL_FALL_EDGE); 7 H) f" q0 X/ j" h! Q- x! S# E7 P
McASPTxClkCheckConfig(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLKCHCK_DIV32,
  Q; ^8 L. v/ o: _0x00, 0xFF);6 b3 z" U3 K- v. I! C, u
" e8 S4 R" X" @' N5 G6 y( p! [
/* Enable synchronization of RX and TX sections */
& M# F" s% ~- z& i- H" ?& E5 L  CMcASPTxRxClkSyncEnable(SOC_MCASP_0_CTRL_REGS);
/* Enable the transmitter/receiver slots. I2S uses 2 slots */
* p$ ^6 x. D8 `) y6 T3 DMcASPRxTimeSlotSet(SOC_MCASP_0_CTRL_REGS, I2S_SLOTS);
8 H1 d, \% X! y. h8 y0 J- tMcASPTxTimeSlotSet(SOC_MCASP_0_CTRL_REGS, I2S_SLOTS);
/*
! J  L% K& e9 g: A2 Z** Set the serializers, Currently only one serializer is set as
% B, l6 A8 A2 `' u. F" R** transmitter and one serializer as receiver.
' |# w" d/ O! v*/
5 ]5 \; S8 X5 u; j! n/ oMcASPSerializerRxSet(SOC_MCASP_0_CTRL_REGS, MCASP_XSER_RX);
1 V& V4 S7 r9 [; H- j' s& eMcASPSerializerTxSet(SOC_MCASP_0_CTRL_REGS, MCASP_XSER_TX);
/*1 v1 C, o; i6 M  F" `; j
** Configure the McASP pins ! Z/ j. Z' D, y$ B# K
** Input - Frame Sync, Clock and Serializer Rx8 c/ x. H6 v( L) i0 t, G
** Output - Serializer Tx is connected to the input of the codec
. p' O. p' c! s; d8 [! K1 P*/2 ]+ i4 G2 e! T& O' u4 m/ ^
McASPPinMcASPSet(SOC_MCASP_0_CTRL_REGS, 0xFFFFFFFF);% F5 a. d1 `, d6 n
McASPPinDirOutputSet(SOC_MCASP_0_CTRL_REGS,MCASP_PIN_AXR(MCASP_XSER_TX));2 f6 s7 A+ h( c
McASPPinDirInputSet(SOC_MCASP_0_CTRL_REGS, MCASP_PIN_AFSX
2 O2 U, _. G0 v' S1 ^6 m| MCASP_PIN_ACLKX
% g9 @' I+ C1 C9 z| MCASP_PIN_AHCLKX
! B6 p1 @3 l9 o% F| MCASP_PIN_AXR(MCASP_XSER_RX));
/* Enable error interrupts for McASP */
, |, v- T; I7 y3 ?McASPTxIntEnable(SOC_MCASP_0_CTRL_REGS, MCASP_TX_DMAERROR 7 m" [' Y  J2 c3 a% k3 S- T
| MCASP_TX_CLKFAIL
+ [% R: \$ [7 Z| MCASP_TX_SYNCERROR
* C$ u% ?! W2 Y# b| MCASP_TX_UNDERRUN);
McASPRxIntEnable(SOC_MCASP_0_CTRL_REGS, MCASP_RX_DMAERROR
9 X7 _! g3 ~* u. m| MCASP_RX_CLKFAIL- V" w% `: u# g6 H8 j
| MCASP_RX_SYNCERROR
4 q' c! r1 H0 [3 K) q' r| MCASP_RX_OVERRUN);
# U! ]3 p# @! a2 `  ?8 _}
static void I2SDataTxRxActivate(void)
+ Y  I5 n0 J$ B{; F0 h( Y6 z& p1 C/ ^) G  i
/* Start the clocks */
$ V% s! a& I% X/ i' k( zMcASPRxClkStart(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_EXTERNAL);
% I$ P1 w* f8 m5 a7 H/ K' v0 aMcASPTxClkStart(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_INTERNAL);
/* Enable EDMA for the transfer */# s7 ^) q6 w2 t$ V& @3 g
EDMA3EnableTransfer(SOC_EDMA30CC_0_REGS, EDMA3_CHA_MCASP0_RX,
% ^6 {0 {& W' r  u6 o3 MEDMA3_TRIG_MODE_EVENT);
, J: ~7 _8 B" E9 h2 xEDMA3EnableTransfer(SOC_EDMA30CC_0_REGS,
+ _1 ~7 T( X2 PEDMA3_CHA_MCASP0_TX, EDMA3_TRIG_MODE_EVENT);
/* Activate the serializers *// b$ U/ T; N6 \* n% m) B
McASPRxSerActivate(SOC_MCASP_0_CTRL_REGS);1 z, ?, {$ C; g# s; d' H* d: R
McASPTxSerActivate(SOC_MCASP_0_CTRL_REGS);
/* make sure that the XDATA bit is cleared to zero */1 T2 N% N$ R- E& t
while(McASPTxStatusGet(SOC_MCASP_0_CTRL_REGS) & MCASP_TX_STAT_DATAREADY);
/* Activate the state machines */
- Z9 A$ k7 G* {' j; z# r6 R% eMcASPRxEnable(SOC_MCASP_0_CTRL_REGS);, w1 K8 l+ a) P8 N6 B) L
McASPTxEnable(SOC_MCASP_0_CTRL_REGS);4 V9 X" b1 F/ n: v
}
( M4 u3 \0 Y0 [. ~) }, Y
请问:问题出在哪了,时钟按照这样配是否有错。
另外我看XDATA一直是0,接收的rxbuf0,1,2里有一般全是FFFF一半全是0.
! N" W- P! j) B$ N; d. T
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