MCASP自环配置。 - OMAP-L138 - 嵌入式开发者社区 - 51ele.net
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[未解决] MCASP自环配置。

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发表于 2018-11-7 13:28:07 | 只看该作者 回帖奖励 |正序浏览 |阅读模式
我项目上用OMAPL138的板子MCASP的引脚都是链接的FPGA,所以在FPGA这端设置的MCASP自环。把axr0接收到的通过axr1发回去。
部分代码如下
input mcasp_afsx,  T& C9 d4 d) n6 U9 R; M  @- [
input mcasp_ahclkx,9 P* `) P, r2 z3 D2 J# s/ d* S2 F
input mcasp_aclkx,8 f; C% i2 Z5 G4 f. H+ @$ I# u4 k/ c
input axr0,
, \3 e. G6 B8 X+ n2 d' S& B* t5 V' l
output mcasp_afsr,  D4 B0 S) ^/ A$ {% V1 J& b$ ?* n# D
output mcasp_ahclkr,
- @) M# g8 S- Loutput mcasp_aclkr,& H% _  ~8 n! ?5 S! \8 a
output axr1,  q! e/ B9 a: f1 R4 E$ V* S
assign mcasp_afsr = mcasp_afsx;: [) B: d; C5 X2 ^/ }
assign mcasp_aclkr = mcasp_aclkx;
/ P& V6 {  Y- v# Y% wassign mcasp_ahclkr = mcasp_ahclkx;/ x3 w: D: M5 x3 H3 r4 a8 c
assign axr1 = axr0;
( A8 a- u( X. r* {2 ~' B
- ]6 T2 h; H: o
在OMAPL138这端,通过axr0接口发固定的数,axr1接收。
在配置MACASP的时候,发送全部取内部时钟,接收全部取外部时钟。
一直循环发送,但是接收不到。在FPGA端也没有看到时钟和信号的波形。
部分代码如下,关于edma3的部分未做变化。
7 M/ G0 ?8 Q2 X
static void McASPI2SConfigure(void): @! e! p  m0 \# ~( E" O/ [. X$ P
{( S2 F( _/ T0 P  ~0 g2 }- w
McASPRxReset(SOC_MCASP_0_CTRL_REGS);7 }" P+ W! V6 U$ f) D
McASPTxReset(SOC_MCASP_0_CTRL_REGS);
/* Enable the FIFOs for DMA transfer */7 Y5 k2 |1 W. S4 Q
McASPReadFifoEnable(SOC_MCASP_0_FIFO_REGS, 1, 1);, C1 k2 Q% w5 k  q6 ~* Q+ X
McASPWriteFifoEnable(SOC_MCASP_0_FIFO_REGS, 1, 1);
/* Set I2S format in the transmitter/receiver format units */
9 V& q2 o- `6 c6 `9 s# g1 vMcASPRxFmtI2SSet(SOC_MCASP_0_CTRL_REGS, WORD_SIZE, SLOT_SIZE,
; @9 L& a  ]% ^7 q0 JMCASP_RX_MODE_DMA);
  p9 }# ]* l) j8 c& ?2 uMcASPTxFmtI2SSet(SOC_MCASP_0_CTRL_REGS, WORD_SIZE, SLOT_SIZE,; {- ^7 z+ V/ W# F; v' z+ y
MCASP_TX_MODE_DMA);
/* Configure the frame sync. I2S shall work in TDM format with 2 slots */6 [2 ]# Q6 ^$ ~) C% n6 X8 F; F
McASPRxFrameSyncCfg(SOC_MCASP_0_CTRL_REGS, 2, MCASP_RX_FS_WIDTH_WORD, 1 r4 y, a, A6 I' |
MCASP_RX_FS_EXT_BEGIN_ON_FALL_EDGE);2 D8 ^' S( m: z4 l  ^  A
McASPTxFrameSyncCfg(SOC_MCASP_0_CTRL_REGS, 2, MCASP_TX_FS_WIDTH_WORD,
6 G( S; P! ^( A! S* d4 HMCASP_TX_FS_INT_BEGIN_ON_RIS_EDGE);
/* configure the clock for receiver */
* n$ t  l/ v  D$ M% b3 iMcASPRxClkCfg(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_EXTERNAL, 0, 0);! }- f& K& t3 Q9 K6 d
McASPRxClkPolaritySet(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_POL_RIS_EDGE);
3 Q' R) S; ]  ]. {McASPRxClkCheckConfig(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLKCHCK_DIV32,; G$ f7 Y5 L$ n, I# C2 l6 f6 Q( W% {
0x00, 0xFF);
/* configure the clock for transmitter */
6 k$ k0 _9 \" GMcASPTxClkCfg(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_INTERNAL, 11, 1);. F3 j! b3 e* b/ x3 I; a( [
McASPTxClkPolaritySet(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_POL_FALL_EDGE);
2 J; U+ B* N' ^- A' m5 BMcASPTxClkCheckConfig(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLKCHCK_DIV32,
" w8 A! q: a! K, H. G0x00, 0xFF);$ ?% W7 V2 R, j. i

: |( u3 X! `. _1 n- q/* Enable synchronization of RX and TX sections */ 9 X* [$ p$ R$ _" @
McASPTxRxClkSyncEnable(SOC_MCASP_0_CTRL_REGS);
/* Enable the transmitter/receiver slots. I2S uses 2 slots */# i+ K2 e* {) u$ Z' Z$ R
McASPRxTimeSlotSet(SOC_MCASP_0_CTRL_REGS, I2S_SLOTS);1 q/ m* y$ L) i0 {; c% I
McASPTxTimeSlotSet(SOC_MCASP_0_CTRL_REGS, I2S_SLOTS);
/*. E# w" n0 M) W! Y: T  }2 d
** Set the serializers, Currently only one serializer is set as
! Q; ]$ u- Z3 Z2 K" j5 ~3 ]/ u** transmitter and one serializer as receiver.2 T0 C% |: E& v. \! ^3 K5 Y* r( p
*/
2 d4 t: R. f$ p. c9 B: F- hMcASPSerializerRxSet(SOC_MCASP_0_CTRL_REGS, MCASP_XSER_RX);& `/ ]4 m4 D1 L% h% C
McASPSerializerTxSet(SOC_MCASP_0_CTRL_REGS, MCASP_XSER_TX);
/*. O0 N. E4 b) }5 H
** Configure the McASP pins
0 Y& @8 {0 j( A3 ]/ t! g% Y1 `8 C4 L** Input - Frame Sync, Clock and Serializer Rx" @: C( ]2 |5 q- I$ u
** Output - Serializer Tx is connected to the input of the codec $ j( s; U  @" |5 O2 }
*/
9 w6 N! {% g* S( v7 p! SMcASPPinMcASPSet(SOC_MCASP_0_CTRL_REGS, 0xFFFFFFFF);3 P9 n8 e8 e8 O8 l( w+ L  W* q
McASPPinDirOutputSet(SOC_MCASP_0_CTRL_REGS,MCASP_PIN_AXR(MCASP_XSER_TX));
1 R7 c& Y7 @/ u% zMcASPPinDirInputSet(SOC_MCASP_0_CTRL_REGS, MCASP_PIN_AFSX
8 E9 l: F6 j, Q: s$ d, `| MCASP_PIN_ACLKX' Z, t; `9 T4 m
| MCASP_PIN_AHCLKX
7 h. |: f( h# U" f: Y/ @9 H| MCASP_PIN_AXR(MCASP_XSER_RX));
/* Enable error interrupts for McASP */
, x* k" \  R0 M, k* dMcASPTxIntEnable(SOC_MCASP_0_CTRL_REGS, MCASP_TX_DMAERROR 6 \1 J( N0 s  \8 o
| MCASP_TX_CLKFAIL
- a, p. x) N) I; ]/ j  C# d, z  m| MCASP_TX_SYNCERROR2 R- k# ]8 C. a5 i3 p
| MCASP_TX_UNDERRUN);
McASPRxIntEnable(SOC_MCASP_0_CTRL_REGS, MCASP_RX_DMAERROR
, X+ @. S6 c. r0 I5 ?% O9 n| MCASP_RX_CLKFAIL
9 p+ H. @" x# y, v, K  U0 J| MCASP_RX_SYNCERROR - B' s. X1 _2 }/ l5 f0 U3 i
| MCASP_RX_OVERRUN);4 r+ G8 r" H3 ?+ m% l/ `0 ?
}
static void I2SDataTxRxActivate(void)
0 C/ V  @5 t( l6 [% j0 G  N7 U5 k{
+ w/ v2 k2 a0 F3 P" V8 y+ L/* Start the clocks */4 j+ z. [7 G7 `3 l1 ]0 h" d1 A
McASPRxClkStart(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_EXTERNAL);
( @" Z3 |* R2 V3 ^; B+ fMcASPTxClkStart(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_INTERNAL);
/* Enable EDMA for the transfer */
+ f6 i9 M4 C) E; w; VEDMA3EnableTransfer(SOC_EDMA30CC_0_REGS, EDMA3_CHA_MCASP0_RX,3 \% w6 K$ F$ x) I& S4 D
EDMA3_TRIG_MODE_EVENT);
7 {, A7 r: o8 ]+ x* uEDMA3EnableTransfer(SOC_EDMA30CC_0_REGS, " J! n/ I7 d: n6 S  _. W; e& a0 w
EDMA3_CHA_MCASP0_TX, EDMA3_TRIG_MODE_EVENT);
/* Activate the serializers */
9 g/ S6 [3 G) Q% {McASPRxSerActivate(SOC_MCASP_0_CTRL_REGS);
! G5 |9 i* a& o! l) ~. WMcASPTxSerActivate(SOC_MCASP_0_CTRL_REGS);
/* make sure that the XDATA bit is cleared to zero */
, ]: l8 l# `& H) ywhile(McASPTxStatusGet(SOC_MCASP_0_CTRL_REGS) & MCASP_TX_STAT_DATAREADY);
/* Activate the state machines */
4 ?7 a4 z0 q' T& F% H. c$ zMcASPRxEnable(SOC_MCASP_0_CTRL_REGS);% a9 t% S8 E% u
McASPTxEnable(SOC_MCASP_0_CTRL_REGS);& l% E  k/ K5 c( x4 _
}
. H! F  k! L# ]; n
请问:问题出在哪了,时钟按照这样配是否有错。
另外我看XDATA一直是0,接收的rxbuf0,1,2里有一般全是FFFF一半全是0.

0 G' M" w6 \9 \
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