MCASP自环配置。 - OMAP-L138 - 嵌入式开发者社区 - 51ele.net
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[未解决] MCASP自环配置。

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发表于 2018-11-7 13:28:07 | 只看该作者 回帖奖励 |正序浏览 |阅读模式
我项目上用OMAPL138的板子MCASP的引脚都是链接的FPGA,所以在FPGA这端设置的MCASP自环。把axr0接收到的通过axr1发回去。
部分代码如下
input mcasp_afsx,( C& h6 Z7 t: k) J8 t, c; ]- v
input mcasp_ahclkx,
# r. c9 l% ^" e; Linput mcasp_aclkx,
' K( U, q7 I/ Finput axr0,
* d* t8 P2 v8 \- H" R
) Y" h4 f( {# V! i; eoutput mcasp_afsr,
& T2 [! R# N% C& b+ Ooutput mcasp_ahclkr,! n  t6 f: l2 ?: d8 M) D1 A1 I
output mcasp_aclkr,
. K$ M2 ^& ~6 J3 ~; e' ooutput axr1,0 i  ^( q" ^. j
assign mcasp_afsr = mcasp_afsx;/ L8 Z$ ~$ P9 C3 B/ J
assign mcasp_aclkr = mcasp_aclkx;
) k/ ?$ s& X. n/ \assign mcasp_ahclkr = mcasp_ahclkx;
* Y8 z4 y) e7 i& d! cassign axr1 = axr0;

' h6 n9 }3 J2 Y/ w
" c/ _  W! i$ M0 ?  K, X
在OMAPL138这端,通过axr0接口发固定的数,axr1接收。
在配置MACASP的时候,发送全部取内部时钟,接收全部取外部时钟。
一直循环发送,但是接收不到。在FPGA端也没有看到时钟和信号的波形。
部分代码如下,关于edma3的部分未做变化。

; U# _( k; @8 Q6 b
static void McASPI2SConfigure(void)
5 I* L: w. T; p, x' O8 ]3 |: P{; t$ k) n/ s( ~, H! v+ l
McASPRxReset(SOC_MCASP_0_CTRL_REGS);
0 D- R, E1 j1 Y1 Z4 C. KMcASPTxReset(SOC_MCASP_0_CTRL_REGS);
/* Enable the FIFOs for DMA transfer */
2 o( k4 B3 r5 `  m; Q, l+ ?( F+ k& U5 W8 ~9 RMcASPReadFifoEnable(SOC_MCASP_0_FIFO_REGS, 1, 1);5 z' g, Y8 g) \9 e. O8 @! B
McASPWriteFifoEnable(SOC_MCASP_0_FIFO_REGS, 1, 1);
/* Set I2S format in the transmitter/receiver format units */6 h1 D" s0 X' K( q3 }
McASPRxFmtI2SSet(SOC_MCASP_0_CTRL_REGS, WORD_SIZE, SLOT_SIZE,
7 `- `- K6 `& lMCASP_RX_MODE_DMA);  _) Z1 v+ V+ t
McASPTxFmtI2SSet(SOC_MCASP_0_CTRL_REGS, WORD_SIZE, SLOT_SIZE,9 O- _9 p+ n' ^: R# @+ F
MCASP_TX_MODE_DMA);
/* Configure the frame sync. I2S shall work in TDM format with 2 slots */; E' Q  }% _5 E
McASPRxFrameSyncCfg(SOC_MCASP_0_CTRL_REGS, 2, MCASP_RX_FS_WIDTH_WORD,
. C2 r3 d& \& b- b3 m. E* n4 DMCASP_RX_FS_EXT_BEGIN_ON_FALL_EDGE);
4 ~4 {9 r2 `. V1 u3 b9 r- mMcASPTxFrameSyncCfg(SOC_MCASP_0_CTRL_REGS, 2, MCASP_TX_FS_WIDTH_WORD, ) C2 L& F+ N8 w. ]5 y
MCASP_TX_FS_INT_BEGIN_ON_RIS_EDGE);
/* configure the clock for receiver */
6 \9 d7 j! M3 w4 l# i* q" `McASPRxClkCfg(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_EXTERNAL, 0, 0);2 M/ b8 A! C9 s7 _8 e, B
McASPRxClkPolaritySet(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_POL_RIS_EDGE); 2 c, d' E/ _2 O7 L3 \# ~
McASPRxClkCheckConfig(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLKCHCK_DIV32,
! J0 W0 O" A6 r* h- z0x00, 0xFF);
/* configure the clock for transmitter */9 w& z3 u/ l* G# @" q
McASPTxClkCfg(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_INTERNAL, 11, 1);/ ~1 R: g' K1 {: Y" i% ?
McASPTxClkPolaritySet(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_POL_FALL_EDGE);
: j" u& R0 @9 b' k* y) VMcASPTxClkCheckConfig(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLKCHCK_DIV32,% ?# F" D! T" {5 _$ }
0x00, 0xFF);" T; c& ?" `0 h# C0 p$ X( {

" N8 |1 A7 M% b% \/* Enable synchronization of RX and TX sections */ 5 ?+ H) Y8 E* F0 }5 ^# x; h( @
McASPTxRxClkSyncEnable(SOC_MCASP_0_CTRL_REGS);
/* Enable the transmitter/receiver slots. I2S uses 2 slots */( K2 e( q) f% @) ~" A
McASPRxTimeSlotSet(SOC_MCASP_0_CTRL_REGS, I2S_SLOTS);
1 p* [9 [7 j4 X5 _McASPTxTimeSlotSet(SOC_MCASP_0_CTRL_REGS, I2S_SLOTS);
/*
3 U, P% R. |6 E; R7 k** Set the serializers, Currently only one serializer is set as0 J1 h9 E4 ~0 z; j
** transmitter and one serializer as receiver.
1 S$ w6 t0 E6 V- b: X( W; x*/2 L! m: U) j' V  Y( x# m
McASPSerializerRxSet(SOC_MCASP_0_CTRL_REGS, MCASP_XSER_RX);
* k( H# k4 n1 q! I9 i( k. W3 JMcASPSerializerTxSet(SOC_MCASP_0_CTRL_REGS, MCASP_XSER_TX);
/*
5 c) q! o$ }0 I1 [+ @4 J/ }% A** Configure the McASP pins
) ^5 F4 R$ C1 {+ x8 n. A! g+ F' A** Input - Frame Sync, Clock and Serializer Rx$ l% l- R+ n# ?
** Output - Serializer Tx is connected to the input of the codec
. @) V; w, F* Y8 J4 u4 j3 c+ C; q*/
4 d& \3 O2 H7 P9 z# u) XMcASPPinMcASPSet(SOC_MCASP_0_CTRL_REGS, 0xFFFFFFFF);1 x& U& I9 k& }
McASPPinDirOutputSet(SOC_MCASP_0_CTRL_REGS,MCASP_PIN_AXR(MCASP_XSER_TX));8 }4 l& b, l7 t5 l
McASPPinDirInputSet(SOC_MCASP_0_CTRL_REGS, MCASP_PIN_AFSX% ^9 }4 X0 F( A3 o
| MCASP_PIN_ACLKX9 l; H, F3 n* Z7 E' @
| MCASP_PIN_AHCLKX, O. P% x/ t. ~
| MCASP_PIN_AXR(MCASP_XSER_RX));
/* Enable error interrupts for McASP */+ p, S- `" Y0 @
McASPTxIntEnable(SOC_MCASP_0_CTRL_REGS, MCASP_TX_DMAERROR 7 B8 P7 }& B" b0 U2 @1 E
| MCASP_TX_CLKFAIL 0 p! v3 }9 Y# V9 |% x; v1 L+ N
| MCASP_TX_SYNCERROR
+ N- F5 b6 x: [2 I| MCASP_TX_UNDERRUN);
McASPRxIntEnable(SOC_MCASP_0_CTRL_REGS, MCASP_RX_DMAERROR
# _6 z7 b4 O/ ?6 ]; L6 q  X| MCASP_RX_CLKFAIL/ Q  n8 z" ~1 T) d5 _3 E0 E, j
| MCASP_RX_SYNCERROR ' H- y$ Q: _  Z5 s$ e8 v2 W
| MCASP_RX_OVERRUN);# o4 D! A* X$ m4 X8 u1 K
}
static void I2SDataTxRxActivate(void)* `0 z1 v6 F5 m6 G5 I5 I: |
{8 D# F& i" d- j1 R) o# T
/* Start the clocks */
3 {0 H4 C3 W( J% ]% u  x/ u5 O2 xMcASPRxClkStart(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_EXTERNAL);6 @. q1 E: A2 n' @, H; J
McASPTxClkStart(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_INTERNAL);
/* Enable EDMA for the transfer */
) ~2 `) Z! r7 {( D7 ^EDMA3EnableTransfer(SOC_EDMA30CC_0_REGS, EDMA3_CHA_MCASP0_RX,
. T+ U6 X. _5 {6 mEDMA3_TRIG_MODE_EVENT);1 [9 q; j% E. C9 |& Q' ^- |
EDMA3EnableTransfer(SOC_EDMA30CC_0_REGS, + Y7 {6 r3 c7 O, ?) i. l- C
EDMA3_CHA_MCASP0_TX, EDMA3_TRIG_MODE_EVENT);
/* Activate the serializers */
- ^- W3 t: `% EMcASPRxSerActivate(SOC_MCASP_0_CTRL_REGS);, h  Y4 M) `( {, o
McASPTxSerActivate(SOC_MCASP_0_CTRL_REGS);
/* make sure that the XDATA bit is cleared to zero */5 o* E/ }/ x$ D3 V* N4 d0 r
while(McASPTxStatusGet(SOC_MCASP_0_CTRL_REGS) & MCASP_TX_STAT_DATAREADY);
/* Activate the state machines */' w' C2 B1 q2 e2 u) p( G- c
McASPRxEnable(SOC_MCASP_0_CTRL_REGS);
, w( W3 M1 h9 g3 O- YMcASPTxEnable(SOC_MCASP_0_CTRL_REGS);0 x/ d$ M7 r) V# H/ M4 J) Q
}
. c) W$ a. {1 |2 Q' H
请问:问题出在哪了,时钟按照这样配是否有错。
另外我看XDATA一直是0,接收的rxbuf0,1,2里有一般全是FFFF一半全是0.

5 B6 B+ ?5 v& o$ m, ], h
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