MCASP自环配置。 - OMAP-L138 - 嵌入式开发者社区 - 51ele.net
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[未解决] MCASP自环配置。

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发表于 2018-11-7 13:28:07 | 只看该作者 回帖奖励 |正序浏览 |阅读模式
我项目上用OMAPL138的板子MCASP的引脚都是链接的FPGA,所以在FPGA这端设置的MCASP自环。把axr0接收到的通过axr1发回去。
部分代码如下
input mcasp_afsx,! x& t0 Q5 S  n) c
input mcasp_ahclkx,
- O1 n9 E. |" v6 Dinput mcasp_aclkx,1 p  D" F* V8 p* ~
input axr0,* F" H2 z/ F; s; `0 b& P; j
+ i  U: b0 o* a" A9 _
output mcasp_afsr,5 b+ H  S& ^4 V& S5 b, _3 s7 `* d
output mcasp_ahclkr,+ b8 D  F# {& J  \* R6 s& }$ O( b! U
output mcasp_aclkr,& f) R6 W8 |9 F
output axr1,
; L8 l! u4 [: g
assign mcasp_afsr = mcasp_afsx;! `" L- ?* x& K# X2 W  |
assign mcasp_aclkr = mcasp_aclkx;
0 u- j. t/ F: y# [assign mcasp_ahclkr = mcasp_ahclkx;' G+ d/ N' [  m  n9 m2 f: b3 Z6 B
assign axr1 = axr0;
9 l+ s! j4 t9 v

4 K! X. X8 ?7 J7 b+ ]
在OMAPL138这端,通过axr0接口发固定的数,axr1接收。
在配置MACASP的时候,发送全部取内部时钟,接收全部取外部时钟。
一直循环发送,但是接收不到。在FPGA端也没有看到时钟和信号的波形。
部分代码如下,关于edma3的部分未做变化。
. E9 ?2 Z3 {9 Y& E: R2 y% b0 C' a
static void McASPI2SConfigure(void)  W( w! J, e3 u, ~& S- ~0 W
{
  q* C5 O+ T" ~$ H$ e  f, x5 kMcASPRxReset(SOC_MCASP_0_CTRL_REGS);- k, _3 B4 k# r) W% [
McASPTxReset(SOC_MCASP_0_CTRL_REGS);
/* Enable the FIFOs for DMA transfer */
: n# `* _2 `1 r" G- z* fMcASPReadFifoEnable(SOC_MCASP_0_FIFO_REGS, 1, 1);; i+ o' v6 U- q' U( X
McASPWriteFifoEnable(SOC_MCASP_0_FIFO_REGS, 1, 1);
/* Set I2S format in the transmitter/receiver format units */
$ e% f8 `' a" L3 Y4 XMcASPRxFmtI2SSet(SOC_MCASP_0_CTRL_REGS, WORD_SIZE, SLOT_SIZE,, ~' p3 q) c8 _) `
MCASP_RX_MODE_DMA);
, ^# n& c. S# N6 o; B2 aMcASPTxFmtI2SSet(SOC_MCASP_0_CTRL_REGS, WORD_SIZE, SLOT_SIZE,# z) g2 {8 b2 j( L7 V4 {1 S) ]
MCASP_TX_MODE_DMA);
/* Configure the frame sync. I2S shall work in TDM format with 2 slots */
  x0 N2 `) p0 r3 s, rMcASPRxFrameSyncCfg(SOC_MCASP_0_CTRL_REGS, 2, MCASP_RX_FS_WIDTH_WORD, / X5 I/ N" V; \" s0 W. s. z# z
MCASP_RX_FS_EXT_BEGIN_ON_FALL_EDGE);
% E7 \# r+ _5 Z# ?3 h5 A' n. C; J4 GMcASPTxFrameSyncCfg(SOC_MCASP_0_CTRL_REGS, 2, MCASP_TX_FS_WIDTH_WORD,
3 \. s5 i4 b, c. KMCASP_TX_FS_INT_BEGIN_ON_RIS_EDGE);
/* configure the clock for receiver */
. M  I* I* a$ ]1 b2 ]# oMcASPRxClkCfg(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_EXTERNAL, 0, 0);8 K% |7 J3 M, l
McASPRxClkPolaritySet(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_POL_RIS_EDGE);
* {$ n) Q# I( `5 o9 k- kMcASPRxClkCheckConfig(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLKCHCK_DIV32,$ O7 C& W$ j7 e; Z7 b8 _- V0 v
0x00, 0xFF);
/* configure the clock for transmitter */4 y9 S- P7 ~% q
McASPTxClkCfg(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_INTERNAL, 11, 1);
/ g* D; n/ x3 @# g  g' mMcASPTxClkPolaritySet(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_POL_FALL_EDGE);
, s, o* T% F$ n# CMcASPTxClkCheckConfig(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLKCHCK_DIV32,5 Q5 n1 }+ U4 K7 l
0x00, 0xFF);
% ~  n  i2 d% W7 I" y
9 y- ?: i, r% i+ ?/* Enable synchronization of RX and TX sections */
2 A/ L- B0 Y. E. A) `  ^# NMcASPTxRxClkSyncEnable(SOC_MCASP_0_CTRL_REGS);
/* Enable the transmitter/receiver slots. I2S uses 2 slots */
! E! {  Y/ O2 QMcASPRxTimeSlotSet(SOC_MCASP_0_CTRL_REGS, I2S_SLOTS);
9 B1 r" |, Q8 oMcASPTxTimeSlotSet(SOC_MCASP_0_CTRL_REGS, I2S_SLOTS);
/*
+ H8 g' w! Y: v2 `: {, i1 X8 v' d** Set the serializers, Currently only one serializer is set as% k+ b" q; G. Z) y7 |
** transmitter and one serializer as receiver.! p. {- k7 O$ `; h) F+ M
*/
# R1 T5 N& |6 p" m8 D, Y- f7 w' ZMcASPSerializerRxSet(SOC_MCASP_0_CTRL_REGS, MCASP_XSER_RX);
4 f- x' t" z  j4 k* pMcASPSerializerTxSet(SOC_MCASP_0_CTRL_REGS, MCASP_XSER_TX);
/*
! C6 v. n/ b% n# f5 _/ D# w** Configure the McASP pins ( ]6 u) v. n; k( b1 }" P
** Input - Frame Sync, Clock and Serializer Rx% }+ b: p6 m, ^6 B
** Output - Serializer Tx is connected to the input of the codec # S4 ]/ y% O7 x
*/
& n2 t) E) v: `. bMcASPPinMcASPSet(SOC_MCASP_0_CTRL_REGS, 0xFFFFFFFF);( A% d. K7 w/ \
McASPPinDirOutputSet(SOC_MCASP_0_CTRL_REGS,MCASP_PIN_AXR(MCASP_XSER_TX));
  r  _4 H6 k9 cMcASPPinDirInputSet(SOC_MCASP_0_CTRL_REGS, MCASP_PIN_AFSX' M+ b* j$ d, k2 M
| MCASP_PIN_ACLKX
1 I2 |: m- \" M% ]9 Y| MCASP_PIN_AHCLKX
& [- d5 o. X. y; d. M3 _$ s( z| MCASP_PIN_AXR(MCASP_XSER_RX));
/* Enable error interrupts for McASP */
" K! y; m1 n) }) N: e) DMcASPTxIntEnable(SOC_MCASP_0_CTRL_REGS, MCASP_TX_DMAERROR ( f0 i4 L& S: @8 A- ~3 w9 I
| MCASP_TX_CLKFAIL 1 x2 F$ D4 g0 n
| MCASP_TX_SYNCERROR
/ y2 E6 V5 D0 p% z. ?| MCASP_TX_UNDERRUN);
McASPRxIntEnable(SOC_MCASP_0_CTRL_REGS, MCASP_RX_DMAERROR
9 a2 k& B9 q$ C| MCASP_RX_CLKFAIL8 [# v. V0 Z+ N! p! Y% o
| MCASP_RX_SYNCERROR
6 e1 _2 q- \# ^# Z9 k) E* o5 \| MCASP_RX_OVERRUN);2 O# t5 l: Y$ `' u3 f) m  ?0 z
}
static void I2SDataTxRxActivate(void)
+ D! c/ N% \1 v- G- _' ^{
8 k- @; e/ W1 O, H  G' i/* Start the clocks */" D6 {$ Q6 Q* Q. q, O! {! x
McASPRxClkStart(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_EXTERNAL);8 F6 O: X( T5 B9 D  W
McASPTxClkStart(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_INTERNAL);
/* Enable EDMA for the transfer */6 Y; m' w4 x2 p" |' Q# l
EDMA3EnableTransfer(SOC_EDMA30CC_0_REGS, EDMA3_CHA_MCASP0_RX,
" \' }, M. r$ Z6 UEDMA3_TRIG_MODE_EVENT);+ Z) \, q7 ^$ q5 P* A- r
EDMA3EnableTransfer(SOC_EDMA30CC_0_REGS,
. J/ N/ f- s0 f6 K8 aEDMA3_CHA_MCASP0_TX, EDMA3_TRIG_MODE_EVENT);
/* Activate the serializers *// Q8 \% u! t8 Z4 F* p1 ?+ @- r+ B
McASPRxSerActivate(SOC_MCASP_0_CTRL_REGS);0 w6 l4 @9 t' b( R% ^1 @
McASPTxSerActivate(SOC_MCASP_0_CTRL_REGS);
/* make sure that the XDATA bit is cleared to zero */
. J$ Q( S; e6 v! ^while(McASPTxStatusGet(SOC_MCASP_0_CTRL_REGS) & MCASP_TX_STAT_DATAREADY);
/* Activate the state machines */
" }  o2 Y2 h3 Q/ E+ z0 C, wMcASPRxEnable(SOC_MCASP_0_CTRL_REGS);; S; `8 X. `) v  X! l: p
McASPTxEnable(SOC_MCASP_0_CTRL_REGS);
& C+ e3 e9 w, }}
0 K8 M: O. _. A& ^1 P+ q, D
请问:问题出在哪了,时钟按照这样配是否有错。
另外我看XDATA一直是0,接收的rxbuf0,1,2里有一般全是FFFF一半全是0.
  o8 ^1 w; z$ p* w8 H
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