MCASP自环配置。 - OMAP-L138 - 嵌入式开发者社区 - 51ele.net
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[未解决] MCASP自环配置。

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发表于 2018-11-7 13:28:07 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
我项目上用OMAPL138的板子MCASP的引脚都是链接的FPGA,所以在FPGA这端设置的MCASP自环。把axr0接收到的通过axr1发回去。
部分代码如下
input mcasp_afsx,
3 I+ E0 o* R) Linput mcasp_ahclkx,
2 G8 x  H; W# H$ {( l" m; Cinput mcasp_aclkx,
. M- K) M/ t) W- p0 R! k' Kinput axr0,
: ]- {/ B# c# O2 u( S& U- V6 I
- a9 D/ s0 C0 g" Y/ n) Moutput mcasp_afsr,
0 x/ J& ]7 N  S/ L' [8 \' voutput mcasp_ahclkr,
8 J1 U9 l0 A) }+ n9 r4 qoutput mcasp_aclkr,
- d3 m4 `( O2 [8 toutput axr1,
3 q/ O) b/ H1 Q
assign mcasp_afsr = mcasp_afsx;  a/ e# ?# N) C7 }
assign mcasp_aclkr = mcasp_aclkx;$ f# N  f/ A3 S
assign mcasp_ahclkr = mcasp_ahclkx;- {5 e: z, r# w( x
assign axr1 = axr0;

. u% o9 P' }5 ]3 @$ j7 o: z+ W3 f  Z; @3 g$ }5 n' F' Z/ J- X0 ^
在OMAPL138这端,通过axr0接口发固定的数,axr1接收。
在配置MACASP的时候,发送全部取内部时钟,接收全部取外部时钟。
一直循环发送,但是接收不到。在FPGA端也没有看到时钟和信号的波形。
部分代码如下,关于edma3的部分未做变化。
  l" l$ D0 r1 ~5 [( w- g
static void McASPI2SConfigure(void)
+ G# t/ A; k6 o  u* y8 j  V$ `{
" b5 B/ E9 c; w2 O5 QMcASPRxReset(SOC_MCASP_0_CTRL_REGS);
& U, u, f) G- C7 v/ TMcASPTxReset(SOC_MCASP_0_CTRL_REGS);
/* Enable the FIFOs for DMA transfer */
" F3 `5 p9 d$ D8 v, A) yMcASPReadFifoEnable(SOC_MCASP_0_FIFO_REGS, 1, 1);$ l+ K' v0 S0 z
McASPWriteFifoEnable(SOC_MCASP_0_FIFO_REGS, 1, 1);
/* Set I2S format in the transmitter/receiver format units */. p* e/ J; t: a, x: U7 e9 Z
McASPRxFmtI2SSet(SOC_MCASP_0_CTRL_REGS, WORD_SIZE, SLOT_SIZE," f  y3 H- J9 a
MCASP_RX_MODE_DMA);5 ?  Q# }' ?, C( o
McASPTxFmtI2SSet(SOC_MCASP_0_CTRL_REGS, WORD_SIZE, SLOT_SIZE,, w+ S% }- w3 v/ I5 ~8 _
MCASP_TX_MODE_DMA);
/* Configure the frame sync. I2S shall work in TDM format with 2 slots */8 O2 f/ _7 E/ w4 O
McASPRxFrameSyncCfg(SOC_MCASP_0_CTRL_REGS, 2, MCASP_RX_FS_WIDTH_WORD, 5 b$ ^1 G% [+ u3 x8 h/ y7 @
MCASP_RX_FS_EXT_BEGIN_ON_FALL_EDGE);
) g) Y) x% W! g! `/ v, fMcASPTxFrameSyncCfg(SOC_MCASP_0_CTRL_REGS, 2, MCASP_TX_FS_WIDTH_WORD,
. m- y4 [# v( _3 uMCASP_TX_FS_INT_BEGIN_ON_RIS_EDGE);
/* configure the clock for receiver */5 r5 j% Z% v9 D5 {2 k
McASPRxClkCfg(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_EXTERNAL, 0, 0);. Y. J% V* S3 c6 S5 p
McASPRxClkPolaritySet(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_POL_RIS_EDGE); & V" [5 [" \/ F+ j
McASPRxClkCheckConfig(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLKCHCK_DIV32,9 [. ~4 J: T( A9 ~; t- W
0x00, 0xFF);
/* configure the clock for transmitter */- v; P" k( r& Q9 r. M
McASPTxClkCfg(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_INTERNAL, 11, 1);, u7 y* V  A9 D' e9 p: o
McASPTxClkPolaritySet(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_POL_FALL_EDGE); 8 X' _# l3 N! g1 i$ p- t& O8 H8 V
McASPTxClkCheckConfig(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLKCHCK_DIV32,' {7 |8 K# d- F. ^
0x00, 0xFF);0 H; g6 \1 V- B0 y

- ~! w* d5 c* G+ Z5 Z2 c/* Enable synchronization of RX and TX sections */
; W) @( e. @: d) W/ W! VMcASPTxRxClkSyncEnable(SOC_MCASP_0_CTRL_REGS);
/* Enable the transmitter/receiver slots. I2S uses 2 slots */
- {& }0 k( Q0 ~$ E7 [6 KMcASPRxTimeSlotSet(SOC_MCASP_0_CTRL_REGS, I2S_SLOTS);
+ l+ k7 ~8 p& N. E' A0 C4 qMcASPTxTimeSlotSet(SOC_MCASP_0_CTRL_REGS, I2S_SLOTS);
/*
* e4 g* o) m# M7 H** Set the serializers, Currently only one serializer is set as
! u+ R3 @6 P2 h1 X  l3 r** transmitter and one serializer as receiver.
/ W$ r9 Q8 l' e1 S6 a$ J*/
( v  A" }* K) [, {3 R- jMcASPSerializerRxSet(SOC_MCASP_0_CTRL_REGS, MCASP_XSER_RX);
5 L6 h* j! J/ `7 V4 E, X& O* l3 lMcASPSerializerTxSet(SOC_MCASP_0_CTRL_REGS, MCASP_XSER_TX);
/*
0 ~0 a0 E$ d+ y6 S. Q** Configure the McASP pins
& G& y3 c4 r6 _& ?0 W* [0 y& m2 p/ h** Input - Frame Sync, Clock and Serializer Rx( L, _) m7 r' h: J3 M
** Output - Serializer Tx is connected to the input of the codec 0 e6 r7 M' }2 s
*/: m/ i3 z; F( O7 w% R  S5 q
McASPPinMcASPSet(SOC_MCASP_0_CTRL_REGS, 0xFFFFFFFF);
6 `4 Z" V5 X5 ^- P" f/ `" `McASPPinDirOutputSet(SOC_MCASP_0_CTRL_REGS,MCASP_PIN_AXR(MCASP_XSER_TX));
; t9 {" m8 B  w) NMcASPPinDirInputSet(SOC_MCASP_0_CTRL_REGS, MCASP_PIN_AFSX
* g% {8 R; E, U| MCASP_PIN_ACLKX
0 i/ }+ k: B* {, i4 `3 J# B| MCASP_PIN_AHCLKX
* `+ W3 U: `: ^; Y* b| MCASP_PIN_AXR(MCASP_XSER_RX));
/* Enable error interrupts for McASP */
( r" ?0 ?9 Z# HMcASPTxIntEnable(SOC_MCASP_0_CTRL_REGS, MCASP_TX_DMAERROR
3 G% \8 P+ {7 E$ x' b! p( c9 c| MCASP_TX_CLKFAIL
5 s* C% X$ v$ p) \; a5 W- V& Y| MCASP_TX_SYNCERROR! V. j" t$ H* V; \
| MCASP_TX_UNDERRUN);
McASPRxIntEnable(SOC_MCASP_0_CTRL_REGS, MCASP_RX_DMAERROR ' m2 @7 i4 a& R# ]5 \8 }& e/ h% y4 C
| MCASP_RX_CLKFAIL. K% c  j" Y  D* M4 N: i
| MCASP_RX_SYNCERROR 2 z& n6 k6 l) C
| MCASP_RX_OVERRUN);
5 C0 f' O5 d# ?- M" V& w1 L3 R+ I& ~}
static void I2SDataTxRxActivate(void)
% h  |9 F: ], P+ H{" G) [% ~! X* q1 v
/* Start the clocks */
% `  @. s# \; g2 K: A* ]McASPRxClkStart(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_EXTERNAL);
  R3 \) H+ P4 l4 N9 c+ h5 RMcASPTxClkStart(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_INTERNAL);
/* Enable EDMA for the transfer */. V$ d3 c  X% _; o9 z
EDMA3EnableTransfer(SOC_EDMA30CC_0_REGS, EDMA3_CHA_MCASP0_RX,  i8 j" o/ N" j7 [) K
EDMA3_TRIG_MODE_EVENT);7 E4 Z6 W" X& B: t. H3 {
EDMA3EnableTransfer(SOC_EDMA30CC_0_REGS,
/ U+ C& u! S8 sEDMA3_CHA_MCASP0_TX, EDMA3_TRIG_MODE_EVENT);
/* Activate the serializers */0 e0 ^! X/ q+ p5 y
McASPRxSerActivate(SOC_MCASP_0_CTRL_REGS);
0 e. Q) M2 D, YMcASPTxSerActivate(SOC_MCASP_0_CTRL_REGS);
/* make sure that the XDATA bit is cleared to zero */
/ \6 p$ ^$ t0 N6 J8 E1 I* E* dwhile(McASPTxStatusGet(SOC_MCASP_0_CTRL_REGS) & MCASP_TX_STAT_DATAREADY);
/* Activate the state machines */' \/ X6 |- D. q. e) z' Y0 v
McASPRxEnable(SOC_MCASP_0_CTRL_REGS);" i7 d4 M' ^, O* g7 F+ F+ {
McASPTxEnable(SOC_MCASP_0_CTRL_REGS);
2 n8 K3 y) b7 Q}
" P% h6 n" E- Q' K. Y1 y
请问:问题出在哪了,时钟按照这样配是否有错。
另外我看XDATA一直是0,接收的rxbuf0,1,2里有一般全是FFFF一半全是0.
& W4 j: w, L) x1 S
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