MCASP自环配置。 - OMAP-L138 - 嵌入式开发者社区 - 51ele.net
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[未解决] MCASP自环配置。

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发表于 2018-11-7 13:28:07 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
我项目上用OMAPL138的板子MCASP的引脚都是链接的FPGA,所以在FPGA这端设置的MCASP自环。把axr0接收到的通过axr1发回去。
部分代码如下
input mcasp_afsx,
! b3 G! M5 O$ z3 }% Z+ F% Ninput mcasp_ahclkx,
; r% h, Q3 q- d' @3 uinput mcasp_aclkx,7 O0 E. N$ k7 A, ]1 ?3 d. x
input axr0,
( ~# l  ~$ v( A1 U* D. J6 _
( e- Z4 t9 E% Z2 F& P3 m: v2 u! K% A. Youtput mcasp_afsr,' _$ O; I0 m: i( [: X. [, ?+ b% P
output mcasp_ahclkr,
' z* a6 Q* V3 P7 i: s$ a' x* Poutput mcasp_aclkr,
; r8 v8 k/ b% O8 z$ l8 _& y  H# H1 Ioutput axr1,
1 Q- X2 `# K+ j# {) |+ W, @
assign mcasp_afsr = mcasp_afsx;
+ U: h2 _1 b& k6 s1 X0 y1 [assign mcasp_aclkr = mcasp_aclkx;' T& W2 x9 K! ^3 H  [, x! o5 P, U
assign mcasp_ahclkr = mcasp_ahclkx;
% A: j/ D; B+ {3 `$ Y) dassign axr1 = axr0;

4 Z/ u7 x3 [) G; E" J
, F; T5 x' a2 H0 ~. i
在OMAPL138这端,通过axr0接口发固定的数,axr1接收。
在配置MACASP的时候,发送全部取内部时钟,接收全部取外部时钟。
一直循环发送,但是接收不到。在FPGA端也没有看到时钟和信号的波形。
部分代码如下,关于edma3的部分未做变化。

6 ]* ~  p0 S: I
static void McASPI2SConfigure(void)' B3 F7 G7 j  Q) p/ a- ~
{3 n! x6 B+ k$ a3 Q
McASPRxReset(SOC_MCASP_0_CTRL_REGS);
- z; y( H0 m' s" H$ B  fMcASPTxReset(SOC_MCASP_0_CTRL_REGS);
/* Enable the FIFOs for DMA transfer */, \$ e% D/ _' e; g
McASPReadFifoEnable(SOC_MCASP_0_FIFO_REGS, 1, 1);0 W6 I  S. Z! p* i6 t5 n& a( l) o( B
McASPWriteFifoEnable(SOC_MCASP_0_FIFO_REGS, 1, 1);
/* Set I2S format in the transmitter/receiver format units */$ d* h3 E% _1 S2 A( I2 I
McASPRxFmtI2SSet(SOC_MCASP_0_CTRL_REGS, WORD_SIZE, SLOT_SIZE,
) u- A9 {$ Y) Z4 Q# |0 f' x9 l  y" NMCASP_RX_MODE_DMA);4 w0 H* I7 K4 f' v/ [
McASPTxFmtI2SSet(SOC_MCASP_0_CTRL_REGS, WORD_SIZE, SLOT_SIZE,
) E5 Y) e. H3 s5 O) R( B' x# z# |( HMCASP_TX_MODE_DMA);
/* Configure the frame sync. I2S shall work in TDM format with 2 slots */
- l- H2 Z) B' e7 w: }1 ?% d2 [6 rMcASPRxFrameSyncCfg(SOC_MCASP_0_CTRL_REGS, 2, MCASP_RX_FS_WIDTH_WORD, 9 ^- U3 d7 U1 y4 m. s1 h. b
MCASP_RX_FS_EXT_BEGIN_ON_FALL_EDGE);4 y* {6 f& T4 s& c
McASPTxFrameSyncCfg(SOC_MCASP_0_CTRL_REGS, 2, MCASP_TX_FS_WIDTH_WORD, + }  U2 D0 h5 @+ K
MCASP_TX_FS_INT_BEGIN_ON_RIS_EDGE);
/* configure the clock for receiver */
# {) |2 e) C4 k6 [McASPRxClkCfg(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_EXTERNAL, 0, 0);# E4 t: L; M* }: D8 a/ S
McASPRxClkPolaritySet(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_POL_RIS_EDGE);
8 {- S$ J' d8 v3 C+ kMcASPRxClkCheckConfig(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLKCHCK_DIV32,
3 L% W# I# G- s8 b, u  ]+ v  P0x00, 0xFF);
/* configure the clock for transmitter */5 N+ T5 r9 t  M- `# s& C  ?5 B
McASPTxClkCfg(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_INTERNAL, 11, 1);
, G  w0 l9 k1 F' j* d( BMcASPTxClkPolaritySet(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_POL_FALL_EDGE); % N2 M" T  d. N$ z& o5 A; S
McASPTxClkCheckConfig(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLKCHCK_DIV32,* {! ~% A+ V7 C3 E
0x00, 0xFF);. H8 Z, S' n, d2 E# \! v

8 h; F6 c% Z3 |( }# u: j! c( K1 ^/* Enable synchronization of RX and TX sections */ $ @7 A; V( e& x% t: |- i  s
McASPTxRxClkSyncEnable(SOC_MCASP_0_CTRL_REGS);
/* Enable the transmitter/receiver slots. I2S uses 2 slots */& m) n( {, d9 @5 t0 `# R. k9 R( W
McASPRxTimeSlotSet(SOC_MCASP_0_CTRL_REGS, I2S_SLOTS);! d0 _" y' ?- f1 D& l
McASPTxTimeSlotSet(SOC_MCASP_0_CTRL_REGS, I2S_SLOTS);
/*- {6 b3 f8 T5 O0 [/ }' ~; p: a
** Set the serializers, Currently only one serializer is set as# X+ h# C1 n. g; O( s3 e$ O  v3 m
** transmitter and one serializer as receiver.! [0 y% w1 c" Y3 c) L+ ]
*/
( ]2 Z: d4 w& @8 fMcASPSerializerRxSet(SOC_MCASP_0_CTRL_REGS, MCASP_XSER_RX);: w% E" B+ o/ V& z
McASPSerializerTxSet(SOC_MCASP_0_CTRL_REGS, MCASP_XSER_TX);
/*
5 x0 q+ X- }4 R** Configure the McASP pins " ^* a9 B  Y/ g& w9 I, @3 d0 l
** Input - Frame Sync, Clock and Serializer Rx. `8 p  a" L# G5 n$ x
** Output - Serializer Tx is connected to the input of the codec , a  _9 q3 ]" O- H! W
*/9 p6 b% [! R% u; {( j; e
McASPPinMcASPSet(SOC_MCASP_0_CTRL_REGS, 0xFFFFFFFF);
0 D' T& @4 X9 u$ f; Z! iMcASPPinDirOutputSet(SOC_MCASP_0_CTRL_REGS,MCASP_PIN_AXR(MCASP_XSER_TX));
% l  w( b0 N1 l2 aMcASPPinDirInputSet(SOC_MCASP_0_CTRL_REGS, MCASP_PIN_AFSX
- q' }' o% l5 X1 f5 C| MCASP_PIN_ACLKX; r' D. ^% i& |& u
| MCASP_PIN_AHCLKX1 ?  X0 a# k4 C% F
| MCASP_PIN_AXR(MCASP_XSER_RX));
/* Enable error interrupts for McASP */2 K  i6 H+ \1 H7 V! {! j, `. r
McASPTxIntEnable(SOC_MCASP_0_CTRL_REGS, MCASP_TX_DMAERROR
% X4 d- H0 F) N9 D  I& ]; `9 X2 {: H| MCASP_TX_CLKFAIL - ^6 w' r, N; B8 x- @
| MCASP_TX_SYNCERROR
. y4 i; d, `& ?4 ?# K4 @! u: X% x" Y0 H| MCASP_TX_UNDERRUN);
McASPRxIntEnable(SOC_MCASP_0_CTRL_REGS, MCASP_RX_DMAERROR ( ~9 C; j) {3 i; I
| MCASP_RX_CLKFAIL7 j6 K7 M' y, G0 C! @
| MCASP_RX_SYNCERROR 3 D# T5 ~6 c1 D* d  }# r
| MCASP_RX_OVERRUN);
! D7 H2 M- v# p9 ]$ h! E& r5 {}
static void I2SDataTxRxActivate(void)$ `) `9 e. _+ d1 f+ q" M
{
8 Y0 v/ u6 e) c% V/* Start the clocks */
3 }, r8 x6 ^* ], l0 Q, ^0 n$ f& zMcASPRxClkStart(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_EXTERNAL);" m+ H: r; w; G( x
McASPTxClkStart(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_INTERNAL);
/* Enable EDMA for the transfer */5 h7 w% q% W: d' R2 O/ G1 o+ V% @
EDMA3EnableTransfer(SOC_EDMA30CC_0_REGS, EDMA3_CHA_MCASP0_RX,) R+ q6 S; ~  U( C
EDMA3_TRIG_MODE_EVENT);* I1 |% B0 C9 I" h! L
EDMA3EnableTransfer(SOC_EDMA30CC_0_REGS,   \$ c9 h/ P- o  R0 j
EDMA3_CHA_MCASP0_TX, EDMA3_TRIG_MODE_EVENT);
/* Activate the serializers */2 G3 a1 L8 U  c$ y
McASPRxSerActivate(SOC_MCASP_0_CTRL_REGS);
! w6 M% g$ a8 v, G! OMcASPTxSerActivate(SOC_MCASP_0_CTRL_REGS);
/* make sure that the XDATA bit is cleared to zero */7 G* Y3 I/ T+ Q1 b6 {- l
while(McASPTxStatusGet(SOC_MCASP_0_CTRL_REGS) & MCASP_TX_STAT_DATAREADY);
/* Activate the state machines */
! a' k  ]  `6 _McASPRxEnable(SOC_MCASP_0_CTRL_REGS);: s" H! ^8 ]( n+ M3 ?- H
McASPTxEnable(SOC_MCASP_0_CTRL_REGS);$ n- c7 Q, l5 `% G1 y
}
" X2 @5 k! }& S0 Y8 M
请问:问题出在哪了,时钟按照这样配是否有错。
另外我看XDATA一直是0,接收的rxbuf0,1,2里有一般全是FFFF一半全是0.

; K1 U' ~& D/ n
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