MCASP自环配置。 - OMAP-L138 - 嵌入式开发者社区 - 51ele.net
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[未解决] MCASP自环配置。

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发表于 2018-11-7 13:28:07 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
我项目上用OMAPL138的板子MCASP的引脚都是链接的FPGA,所以在FPGA这端设置的MCASP自环。把axr0接收到的通过axr1发回去。
部分代码如下
input mcasp_afsx,
* }0 U9 k4 e- H, a, \6 N# c& Kinput mcasp_ahclkx,
& K9 S4 v& `, z. }input mcasp_aclkx,3 e1 c0 q% s. @' h2 v, y7 \( f
input axr0,
8 [  R1 r3 C  t# U6 W9 l8 S4 |. Q  G
output mcasp_afsr,
# \/ C$ j5 x; E! T+ xoutput mcasp_ahclkr,: ?& @' R5 r& Q8 n" ^- s) T
output mcasp_aclkr,
: E0 f, h# K! W- A1 m: q+ Ooutput axr1,
6 o4 A4 p' |7 e: y! y. t6 P6 B
assign mcasp_afsr = mcasp_afsx;
0 N# Z. N3 m# F) kassign mcasp_aclkr = mcasp_aclkx;4 j8 ^. D- l9 T: X7 q5 e
assign mcasp_ahclkr = mcasp_ahclkx;
- t5 g: ^, ~9 b* M! g& @, n% nassign axr1 = axr0;
$ k# H7 }3 ], H
, @. i  R) ]9 C! Q
在OMAPL138这端,通过axr0接口发固定的数,axr1接收。
在配置MACASP的时候,发送全部取内部时钟,接收全部取外部时钟。
一直循环发送,但是接收不到。在FPGA端也没有看到时钟和信号的波形。
部分代码如下,关于edma3的部分未做变化。

: @/ u  T/ q' p1 K! ]
static void McASPI2SConfigure(void)  a5 \: h$ A/ w. w1 R* V8 [
{' ~" O; ?+ w& y
McASPRxReset(SOC_MCASP_0_CTRL_REGS);, `) |9 p: R" T6 R" g4 f/ ^
McASPTxReset(SOC_MCASP_0_CTRL_REGS);
/* Enable the FIFOs for DMA transfer */$ @+ E0 Y6 m; @3 u
McASPReadFifoEnable(SOC_MCASP_0_FIFO_REGS, 1, 1);+ @& J2 h* D+ p2 v
McASPWriteFifoEnable(SOC_MCASP_0_FIFO_REGS, 1, 1);
/* Set I2S format in the transmitter/receiver format units */; ?( Z2 X8 Y5 J. _; Z0 f% \* [) I
McASPRxFmtI2SSet(SOC_MCASP_0_CTRL_REGS, WORD_SIZE, SLOT_SIZE,2 L, C4 O5 O3 }7 G3 a# F
MCASP_RX_MODE_DMA);% j; j  Y  z- ^
McASPTxFmtI2SSet(SOC_MCASP_0_CTRL_REGS, WORD_SIZE, SLOT_SIZE,
5 y8 m+ S- l6 U$ J7 QMCASP_TX_MODE_DMA);
/* Configure the frame sync. I2S shall work in TDM format with 2 slots */
5 w! t/ {% |2 J" _& y% yMcASPRxFrameSyncCfg(SOC_MCASP_0_CTRL_REGS, 2, MCASP_RX_FS_WIDTH_WORD,
* p+ W1 _4 {8 _( e; I# YMCASP_RX_FS_EXT_BEGIN_ON_FALL_EDGE);7 C0 @8 y* C1 v$ T! v
McASPTxFrameSyncCfg(SOC_MCASP_0_CTRL_REGS, 2, MCASP_TX_FS_WIDTH_WORD, 3 _/ u: g8 z; p$ v/ ^5 t/ F* i
MCASP_TX_FS_INT_BEGIN_ON_RIS_EDGE);
/* configure the clock for receiver */, g8 w* S) a# r! s! _8 ?) P
McASPRxClkCfg(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_EXTERNAL, 0, 0);
/ Z0 X7 ?3 ]0 ~1 o; o( GMcASPRxClkPolaritySet(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_POL_RIS_EDGE);
4 Y$ U5 [: A  Q- j+ AMcASPRxClkCheckConfig(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLKCHCK_DIV32,7 u7 f4 [$ ?0 Q
0x00, 0xFF);
/* configure the clock for transmitter */
; b6 O  T1 B- R7 k% BMcASPTxClkCfg(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_INTERNAL, 11, 1);( a# H; |/ H2 T; V6 h
McASPTxClkPolaritySet(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_POL_FALL_EDGE);
" b/ [: K; X& mMcASPTxClkCheckConfig(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLKCHCK_DIV32,
$ E8 D! T' y6 x. s% r( y8 V5 C- R9 Y0x00, 0xFF);& V/ p; i/ Z% h% F% p

7 l1 }' O  I3 S0 I8 D/* Enable synchronization of RX and TX sections */
& \7 t: q. O9 ^) L5 z0 BMcASPTxRxClkSyncEnable(SOC_MCASP_0_CTRL_REGS);
/* Enable the transmitter/receiver slots. I2S uses 2 slots */
9 ?( j4 h& ^5 g* |6 TMcASPRxTimeSlotSet(SOC_MCASP_0_CTRL_REGS, I2S_SLOTS);
6 t) y$ k# x& dMcASPTxTimeSlotSet(SOC_MCASP_0_CTRL_REGS, I2S_SLOTS);
/*
9 d( q- g2 h) ~3 \! ?** Set the serializers, Currently only one serializer is set as
6 a2 w* W/ O, O+ O  }+ U! o** transmitter and one serializer as receiver.
0 R  |+ d* [& ^8 s" N*/, m0 P( t- w. W' O9 J; @
McASPSerializerRxSet(SOC_MCASP_0_CTRL_REGS, MCASP_XSER_RX);  s1 t. f( D* n
McASPSerializerTxSet(SOC_MCASP_0_CTRL_REGS, MCASP_XSER_TX);
/*
( j. v8 {$ \" s" L** Configure the McASP pins 8 z$ j6 i  r4 U5 C% I4 V! F1 p
** Input - Frame Sync, Clock and Serializer Rx! m2 n9 ]) L9 S2 ]& f2 d: L1 t6 s
** Output - Serializer Tx is connected to the input of the codec
* ^6 j0 R& I8 n0 E: k*/9 N. x1 o/ d4 W
McASPPinMcASPSet(SOC_MCASP_0_CTRL_REGS, 0xFFFFFFFF);
7 {# J. L3 l$ |McASPPinDirOutputSet(SOC_MCASP_0_CTRL_REGS,MCASP_PIN_AXR(MCASP_XSER_TX));
: d9 }: H$ I" W' D! AMcASPPinDirInputSet(SOC_MCASP_0_CTRL_REGS, MCASP_PIN_AFSX
6 C& w- m9 U  s$ j$ p& t( A) }! ^| MCASP_PIN_ACLKX
9 ]; Q/ U7 B' q$ H1 T# s2 i+ k| MCASP_PIN_AHCLKX* `0 v( r- X( e1 C
| MCASP_PIN_AXR(MCASP_XSER_RX));
/* Enable error interrupts for McASP */, O; r0 S+ m% |
McASPTxIntEnable(SOC_MCASP_0_CTRL_REGS, MCASP_TX_DMAERROR ' k: f3 \" |+ \
| MCASP_TX_CLKFAIL
8 L  I4 v2 v9 x( `$ {0 S| MCASP_TX_SYNCERROR% x4 v. m, a* _1 H/ S  N1 i9 C
| MCASP_TX_UNDERRUN);
McASPRxIntEnable(SOC_MCASP_0_CTRL_REGS, MCASP_RX_DMAERROR 3 B0 ]  U- _" p, `! N& J! i
| MCASP_RX_CLKFAIL
- L& z! l0 s% s  I( U| MCASP_RX_SYNCERROR - a" r7 O1 `4 i2 x1 o+ |
| MCASP_RX_OVERRUN);
# a6 |2 j$ i& R8 A8 U0 n}
static void I2SDataTxRxActivate(void): {. \/ {( `' T
{
7 \) X& v6 O$ }  I$ u/* Start the clocks */3 l) N  c6 c! Y8 R
McASPRxClkStart(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_EXTERNAL);: @# a, o/ U/ \6 y# x
McASPTxClkStart(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_INTERNAL);
/* Enable EDMA for the transfer */2 l: H/ T' o' `2 C( `4 p
EDMA3EnableTransfer(SOC_EDMA30CC_0_REGS, EDMA3_CHA_MCASP0_RX,
+ S+ n& D/ p1 p2 [; _8 m6 REDMA3_TRIG_MODE_EVENT);
9 @" [5 K2 d/ dEDMA3EnableTransfer(SOC_EDMA30CC_0_REGS,
3 t/ S, P8 H  pEDMA3_CHA_MCASP0_TX, EDMA3_TRIG_MODE_EVENT);
/* Activate the serializers */
4 w$ F6 Z; g% [6 [) B* D8 w! [) `McASPRxSerActivate(SOC_MCASP_0_CTRL_REGS);
/ c- ^' e1 r' u5 w$ p8 GMcASPTxSerActivate(SOC_MCASP_0_CTRL_REGS);
/* make sure that the XDATA bit is cleared to zero */' P  T, `1 @+ x. y7 J" s1 u9 {& o6 u
while(McASPTxStatusGet(SOC_MCASP_0_CTRL_REGS) & MCASP_TX_STAT_DATAREADY);
/* Activate the state machines */4 g6 r" {4 _1 B* ]
McASPRxEnable(SOC_MCASP_0_CTRL_REGS);
/ v: j6 L& @. `6 K5 EMcASPTxEnable(SOC_MCASP_0_CTRL_REGS);- {: M2 [$ L; |
}
9 L$ h6 u* q4 A0 @# b2 }
请问:问题出在哪了,时钟按照这样配是否有错。
另外我看XDATA一直是0,接收的rxbuf0,1,2里有一般全是FFFF一半全是0.
$ [  H9 [; k# _+ P6 J/ }
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