MCASP自环配置。 - OMAP-L138 - 嵌入式开发者社区 - 51ele.net
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[未解决] MCASP自环配置。

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发表于 2018-11-7 13:28:07 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
我项目上用OMAPL138的板子MCASP的引脚都是链接的FPGA,所以在FPGA这端设置的MCASP自环。把axr0接收到的通过axr1发回去。
部分代码如下
input mcasp_afsx,
, t8 q- G- ^, X' Zinput mcasp_ahclkx,! d2 ^: R9 q, H! f3 |. x
input mcasp_aclkx,4 Y( i3 K% g5 `) z5 K0 }
input axr0,  _" J4 k* ?9 q7 t! j

0 K9 x1 ]9 _) L5 A2 }) w& `output mcasp_afsr,
& P$ P. s3 _. voutput mcasp_ahclkr," t1 D: a# o5 ^5 V! X
output mcasp_aclkr,1 r# D# g( p" G  J* Q; _  |
output axr1,
; _+ b; r' x) F, q" K. R, k+ i
assign mcasp_afsr = mcasp_afsx;
9 y$ }( k; a( N  L5 passign mcasp_aclkr = mcasp_aclkx;
$ z2 _8 U* K, y8 W$ z  ?assign mcasp_ahclkr = mcasp_ahclkx;
1 y" {; |6 V+ V; L, oassign axr1 = axr0;
% |: ^7 ^8 f5 Q

- D( _! \6 D4 F' a
在OMAPL138这端,通过axr0接口发固定的数,axr1接收。
在配置MACASP的时候,发送全部取内部时钟,接收全部取外部时钟。
一直循环发送,但是接收不到。在FPGA端也没有看到时钟和信号的波形。
部分代码如下,关于edma3的部分未做变化。

2 y" v3 A' X8 b
static void McASPI2SConfigure(void)
/ }; P( ~7 v0 ^. N: t. B! p{
$ C, E# _% j4 R: }; D; q1 wMcASPRxReset(SOC_MCASP_0_CTRL_REGS);0 e) u2 P: {: d! ^2 M8 C6 G" J( R
McASPTxReset(SOC_MCASP_0_CTRL_REGS);
/* Enable the FIFOs for DMA transfer */
" ^( f: g3 T: k+ O, X. d' H* ~3 ^McASPReadFifoEnable(SOC_MCASP_0_FIFO_REGS, 1, 1);
2 b! V* Y; s# Z; ?McASPWriteFifoEnable(SOC_MCASP_0_FIFO_REGS, 1, 1);
/* Set I2S format in the transmitter/receiver format units */, ~$ y( Q/ I$ x
McASPRxFmtI2SSet(SOC_MCASP_0_CTRL_REGS, WORD_SIZE, SLOT_SIZE,
# B6 i; v: T% N- k6 u. \. fMCASP_RX_MODE_DMA);$ H. j/ g# Z+ Q: x* J5 F  r( k
McASPTxFmtI2SSet(SOC_MCASP_0_CTRL_REGS, WORD_SIZE, SLOT_SIZE,1 B, @& J& L' ~6 X1 T
MCASP_TX_MODE_DMA);
/* Configure the frame sync. I2S shall work in TDM format with 2 slots */+ g, u( w7 G. A
McASPRxFrameSyncCfg(SOC_MCASP_0_CTRL_REGS, 2, MCASP_RX_FS_WIDTH_WORD, ) b8 @2 Q( R: O/ h4 p' ~/ a# y6 X. i
MCASP_RX_FS_EXT_BEGIN_ON_FALL_EDGE);
8 T" r: d7 d8 Z) nMcASPTxFrameSyncCfg(SOC_MCASP_0_CTRL_REGS, 2, MCASP_TX_FS_WIDTH_WORD, " s, A3 x: c7 u, v
MCASP_TX_FS_INT_BEGIN_ON_RIS_EDGE);
/* configure the clock for receiver */1 t" n( K1 d" U
McASPRxClkCfg(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_EXTERNAL, 0, 0);& N5 O0 |3 ]" `7 g* _/ ]& g
McASPRxClkPolaritySet(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_POL_RIS_EDGE); ; P* _! a) |/ j. |6 N4 i( S: U
McASPRxClkCheckConfig(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLKCHCK_DIV32,2 J9 Y4 x$ N1 b  U* r$ e3 p# f
0x00, 0xFF);
/* configure the clock for transmitter */
/ f1 b: q7 F3 @6 u$ M  JMcASPTxClkCfg(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_INTERNAL, 11, 1);
2 G: C/ j* ^  V+ |4 PMcASPTxClkPolaritySet(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_POL_FALL_EDGE); 2 p- s# M( g# ^, @
McASPTxClkCheckConfig(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLKCHCK_DIV32,
* G) q$ m  A* B  Y' R0x00, 0xFF);
, X* H/ y7 W, c# I& C; y8 [
9 c+ b( S3 o8 O/* Enable synchronization of RX and TX sections */
2 z% a3 G% Q0 J- N6 Y7 q! Z! i  AMcASPTxRxClkSyncEnable(SOC_MCASP_0_CTRL_REGS);
/* Enable the transmitter/receiver slots. I2S uses 2 slots */5 b) Q$ K8 \$ @% t/ E: U
McASPRxTimeSlotSet(SOC_MCASP_0_CTRL_REGS, I2S_SLOTS);. M% t  x" v# i% T
McASPTxTimeSlotSet(SOC_MCASP_0_CTRL_REGS, I2S_SLOTS);
/*/ F3 l) H% w! d4 J
** Set the serializers, Currently only one serializer is set as
* k' B2 I7 s  |, q8 ^** transmitter and one serializer as receiver.
4 ^, \  m- R9 [0 o$ ]5 n3 r*/% U/ q  @: Z) D$ _) z1 S
McASPSerializerRxSet(SOC_MCASP_0_CTRL_REGS, MCASP_XSER_RX);' t" E' l- W( a+ d0 k7 p: S
McASPSerializerTxSet(SOC_MCASP_0_CTRL_REGS, MCASP_XSER_TX);
/*
+ l; l6 N) b& l0 J# q/ D3 f** Configure the McASP pins ( ?3 k5 i% A4 I7 S6 U' c
** Input - Frame Sync, Clock and Serializer Rx
/ N; @; p, ?4 S* h- @8 {1 j& }1 w! o3 j** Output - Serializer Tx is connected to the input of the codec * c. ]: c, g# A; n
*/
) {) B; `( d- Z1 ?McASPPinMcASPSet(SOC_MCASP_0_CTRL_REGS, 0xFFFFFFFF);2 }4 P, V! `* v+ {5 E
McASPPinDirOutputSet(SOC_MCASP_0_CTRL_REGS,MCASP_PIN_AXR(MCASP_XSER_TX));( \, F3 _, _, m# _! ^
McASPPinDirInputSet(SOC_MCASP_0_CTRL_REGS, MCASP_PIN_AFSX
: u/ c4 A0 n, W| MCASP_PIN_ACLKX
4 S" m3 }9 W* j; O8 `) {6 d& `' |: p& W0 ~| MCASP_PIN_AHCLKX
+ i9 n: q. e5 K2 _| MCASP_PIN_AXR(MCASP_XSER_RX));
/* Enable error interrupts for McASP */
, {. u* o0 B; h0 SMcASPTxIntEnable(SOC_MCASP_0_CTRL_REGS, MCASP_TX_DMAERROR
" J& q1 N  W' u! @; r| MCASP_TX_CLKFAIL 3 U: Z0 _) V# {8 U% S
| MCASP_TX_SYNCERROR) V# m6 c* X* [8 q% x- s* W# W
| MCASP_TX_UNDERRUN);
McASPRxIntEnable(SOC_MCASP_0_CTRL_REGS, MCASP_RX_DMAERROR
, A+ u. C3 h. `- E0 J  S9 ]7 ^| MCASP_RX_CLKFAIL$ X8 q7 P& r/ A; T
| MCASP_RX_SYNCERROR
6 C3 q8 s3 A( `  l  L$ N| MCASP_RX_OVERRUN);3 n1 S" \. g/ ?2 `8 Q) U  x
}
static void I2SDataTxRxActivate(void)' Z' Y) B0 W, e# s' F
{+ U- j- d  u; Z5 i
/* Start the clocks */# n: v; c" c- H* W4 W0 ?7 M( }: i
McASPRxClkStart(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_EXTERNAL);/ R# `& w0 C8 z" Q
McASPTxClkStart(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_INTERNAL);
/* Enable EDMA for the transfer */7 ~7 y4 @- e1 g
EDMA3EnableTransfer(SOC_EDMA30CC_0_REGS, EDMA3_CHA_MCASP0_RX,
( c3 O  d: r9 }7 _9 gEDMA3_TRIG_MODE_EVENT);
- ?9 }5 C: o4 V2 D: ]EDMA3EnableTransfer(SOC_EDMA30CC_0_REGS,
. Q/ ~5 N; B# o: j3 \1 vEDMA3_CHA_MCASP0_TX, EDMA3_TRIG_MODE_EVENT);
/* Activate the serializers */* t5 Z# H; y/ K/ p4 v* U
McASPRxSerActivate(SOC_MCASP_0_CTRL_REGS);) `- K1 V# A, e( |
McASPTxSerActivate(SOC_MCASP_0_CTRL_REGS);
/* make sure that the XDATA bit is cleared to zero */
" }: ~/ n4 G* @/ n4 s% P6 rwhile(McASPTxStatusGet(SOC_MCASP_0_CTRL_REGS) & MCASP_TX_STAT_DATAREADY);
/* Activate the state machines */3 y4 l5 a; [4 y* B8 O
McASPRxEnable(SOC_MCASP_0_CTRL_REGS);
  a- C+ @: n* [4 p4 SMcASPTxEnable(SOC_MCASP_0_CTRL_REGS);+ r) w. K. X, Y
}

& E" [( g# `3 y: Q& m8 q
请问:问题出在哪了,时钟按照这样配是否有错。
另外我看XDATA一直是0,接收的rxbuf0,1,2里有一般全是FFFF一半全是0.

  F  F: p1 U* N) s
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