MCASP自环配置。 - OMAP-L138 - 嵌入式开发者社区 - 51ele.net
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[未解决] MCASP自环配置。

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发表于 2018-11-7 13:28:07 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
我项目上用OMAPL138的板子MCASP的引脚都是链接的FPGA,所以在FPGA这端设置的MCASP自环。把axr0接收到的通过axr1发回去。
部分代码如下
input mcasp_afsx,
% D" Q! }# E6 o* [/ Binput mcasp_ahclkx,
$ \1 h- {  p) v, ^input mcasp_aclkx,
( q9 P# g# q% U5 \input axr0," ~, D" x: a" j* P4 J: }

6 l: z& E) J+ I7 _output mcasp_afsr,, M7 Z! H9 J; [
output mcasp_ahclkr,1 ~% u8 ?+ a2 x7 n) I( J" H$ M
output mcasp_aclkr,  x" a, S* u8 [% E- a3 R, B
output axr1,2 [4 T, B) S$ k* d/ K2 G
assign mcasp_afsr = mcasp_afsx;
& ]8 B, X/ z" A; dassign mcasp_aclkr = mcasp_aclkx;* a- d3 U+ I: Z5 S) }
assign mcasp_ahclkr = mcasp_ahclkx;
) U. B2 V! o; a" @8 k+ V5 uassign axr1 = axr0;

) N1 H) C1 F; O  `6 g  b
; ?" C* M& W8 h9 q% h
在OMAPL138这端,通过axr0接口发固定的数,axr1接收。
在配置MACASP的时候,发送全部取内部时钟,接收全部取外部时钟。
一直循环发送,但是接收不到。在FPGA端也没有看到时钟和信号的波形。
部分代码如下,关于edma3的部分未做变化。

9 m/ T$ c2 T% {) O# I7 e& Z2 V. c+ n
static void McASPI2SConfigure(void)
! C/ H% `. B2 R& N6 j4 z5 d{8 \$ W- ^8 h- [0 I2 b
McASPRxReset(SOC_MCASP_0_CTRL_REGS);# I" k' [5 R$ ?' T- V  v% C; d0 ~
McASPTxReset(SOC_MCASP_0_CTRL_REGS);
/* Enable the FIFOs for DMA transfer */: ?6 T4 V' T# g- P. r( _
McASPReadFifoEnable(SOC_MCASP_0_FIFO_REGS, 1, 1);
1 e4 y, n, o2 \# l* T. QMcASPWriteFifoEnable(SOC_MCASP_0_FIFO_REGS, 1, 1);
/* Set I2S format in the transmitter/receiver format units */
( m3 \) Y8 L8 o- zMcASPRxFmtI2SSet(SOC_MCASP_0_CTRL_REGS, WORD_SIZE, SLOT_SIZE,! R3 f( Q; S! |# G
MCASP_RX_MODE_DMA);% d3 s- g+ |  H1 X
McASPTxFmtI2SSet(SOC_MCASP_0_CTRL_REGS, WORD_SIZE, SLOT_SIZE,
2 N" D+ p# O+ s5 }MCASP_TX_MODE_DMA);
/* Configure the frame sync. I2S shall work in TDM format with 2 slots */4 J, W% |8 o4 F: ]
McASPRxFrameSyncCfg(SOC_MCASP_0_CTRL_REGS, 2, MCASP_RX_FS_WIDTH_WORD, ' {  ?+ L  V- v7 l, L
MCASP_RX_FS_EXT_BEGIN_ON_FALL_EDGE);
! s  }& T! f: V& h$ RMcASPTxFrameSyncCfg(SOC_MCASP_0_CTRL_REGS, 2, MCASP_TX_FS_WIDTH_WORD,
, M" Z' K: d" [3 p8 wMCASP_TX_FS_INT_BEGIN_ON_RIS_EDGE);
/* configure the clock for receiver */
, M1 E! p9 p9 ~, j* Z; BMcASPRxClkCfg(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_EXTERNAL, 0, 0);
1 u2 C0 A4 x( b  r  F, ]3 M: ]McASPRxClkPolaritySet(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_POL_RIS_EDGE); ' Q) c; z1 \5 `6 a
McASPRxClkCheckConfig(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLKCHCK_DIV32,
. W! V+ X9 D* o. n* m2 P- Q0x00, 0xFF);
/* configure the clock for transmitter */) F% U9 d* q# g# \
McASPTxClkCfg(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_INTERNAL, 11, 1);
! {1 q9 I+ E, y' H. M, s$ D- e# [McASPTxClkPolaritySet(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_POL_FALL_EDGE);
2 U, E4 ^  j$ O5 V; ?/ k7 tMcASPTxClkCheckConfig(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLKCHCK_DIV32,
( @& t3 c% A" }! P) P' Q0x00, 0xFF);
3 @' K3 q, u0 @7 y5 F- Y. h' {" b- [3 q: j; O# \, d; Q
/* Enable synchronization of RX and TX sections */ 7 ?+ r& I. i* w7 ]  Y1 O8 B
McASPTxRxClkSyncEnable(SOC_MCASP_0_CTRL_REGS);
/* Enable the transmitter/receiver slots. I2S uses 2 slots */0 m* q' v0 B/ s
McASPRxTimeSlotSet(SOC_MCASP_0_CTRL_REGS, I2S_SLOTS);
# I, v& a2 ~! w- [McASPTxTimeSlotSet(SOC_MCASP_0_CTRL_REGS, I2S_SLOTS);
/*
* c1 {$ v# e* H% K6 V. d** Set the serializers, Currently only one serializer is set as
4 a7 a+ ?; \6 x5 L  D! o4 k** transmitter and one serializer as receiver.
* D1 b; n- K1 N6 H*/, ?% n2 t$ E' j. x. w' K) r6 W3 _
McASPSerializerRxSet(SOC_MCASP_0_CTRL_REGS, MCASP_XSER_RX);6 Z2 n. b' u: i; Q! Q5 D/ J
McASPSerializerTxSet(SOC_MCASP_0_CTRL_REGS, MCASP_XSER_TX);
/*
0 n" {' X' q- p; ^3 |1 x** Configure the McASP pins
9 f% {! G1 T. k; p, Z+ G. k** Input - Frame Sync, Clock and Serializer Rx
8 ]! ~, I  h" ?, z" f1 K** Output - Serializer Tx is connected to the input of the codec
; h& A8 Z6 j) _0 B*/
. M" {. _: v9 S6 }3 `McASPPinMcASPSet(SOC_MCASP_0_CTRL_REGS, 0xFFFFFFFF);
% c. s$ F: U& l2 l! dMcASPPinDirOutputSet(SOC_MCASP_0_CTRL_REGS,MCASP_PIN_AXR(MCASP_XSER_TX));
$ D. W% J7 B5 T2 {9 n* m' k9 g4 xMcASPPinDirInputSet(SOC_MCASP_0_CTRL_REGS, MCASP_PIN_AFSX) \) @% T) h# K+ J5 E0 F
| MCASP_PIN_ACLKX
  t1 O: a6 Q# v! r& k| MCASP_PIN_AHCLKX
- h- }! |4 ^( n| MCASP_PIN_AXR(MCASP_XSER_RX));
/* Enable error interrupts for McASP */
1 t) C- ?7 j# s8 U! y- i+ mMcASPTxIntEnable(SOC_MCASP_0_CTRL_REGS, MCASP_TX_DMAERROR ' M0 m4 ]8 p, x0 y/ h1 o
| MCASP_TX_CLKFAIL
3 }& E, b4 z% w' z! o7 c| MCASP_TX_SYNCERROR. Z# d& o6 Q+ w. {  z
| MCASP_TX_UNDERRUN);
McASPRxIntEnable(SOC_MCASP_0_CTRL_REGS, MCASP_RX_DMAERROR
8 K, P/ S  G1 Y, [9 o$ n, Z| MCASP_RX_CLKFAIL! t. y" d+ P9 _* |( o+ A
| MCASP_RX_SYNCERROR 7 k0 @7 A) m0 X' x
| MCASP_RX_OVERRUN);/ I1 A+ |2 S- I
}
static void I2SDataTxRxActivate(void)+ @' g5 N+ r( W) R' W# w
{" d' A3 Y3 D1 _, C& u
/* Start the clocks */& h* j) V3 o+ L  Q, Q& B: B4 j
McASPRxClkStart(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_EXTERNAL);2 i! P2 x  X  M: w% f+ N; ^
McASPTxClkStart(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_INTERNAL);
/* Enable EDMA for the transfer */
1 y, H0 x5 h) P2 `0 xEDMA3EnableTransfer(SOC_EDMA30CC_0_REGS, EDMA3_CHA_MCASP0_RX,
9 P$ {8 c: E1 F7 c% J( dEDMA3_TRIG_MODE_EVENT);/ ^# |" \$ h# ]2 x9 k" q
EDMA3EnableTransfer(SOC_EDMA30CC_0_REGS,
: v# M3 }/ Y% TEDMA3_CHA_MCASP0_TX, EDMA3_TRIG_MODE_EVENT);
/* Activate the serializers */  r, i( c; x% G& y- n2 W0 n
McASPRxSerActivate(SOC_MCASP_0_CTRL_REGS);) z0 I. p8 S0 |$ v- K- t# X( r  x
McASPTxSerActivate(SOC_MCASP_0_CTRL_REGS);
/* make sure that the XDATA bit is cleared to zero */; {0 u2 o% v4 A& O# @+ X2 @4 y+ z
while(McASPTxStatusGet(SOC_MCASP_0_CTRL_REGS) & MCASP_TX_STAT_DATAREADY);
/* Activate the state machines */
& |7 C' n+ v$ f, Q8 yMcASPRxEnable(SOC_MCASP_0_CTRL_REGS);
/ l) h' H' F4 ]8 I" [9 N7 q; kMcASPTxEnable(SOC_MCASP_0_CTRL_REGS);9 z' X6 ?  V- c" Z2 x' y
}
' t% l1 N8 u% _- `& i
请问:问题出在哪了,时钟按照这样配是否有错。
另外我看XDATA一直是0,接收的rxbuf0,1,2里有一般全是FFFF一半全是0.

7 D9 L1 O8 B# r% m* Q
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