MCASP自环配置。 - OMAP-L138 - 嵌入式开发者社区 - 51ele.net
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[未解决] MCASP自环配置。

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发表于 2018-11-7 13:28:07 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
我项目上用OMAPL138的板子MCASP的引脚都是链接的FPGA,所以在FPGA这端设置的MCASP自环。把axr0接收到的通过axr1发回去。
部分代码如下
input mcasp_afsx,
2 z8 D# e- |# l$ A# r# cinput mcasp_ahclkx,# s% G8 X! ?, T+ ]5 ?6 Y
input mcasp_aclkx,. H) d% Z3 T9 e# P: T$ b
input axr0,9 C) a' E" l& h! ^: z

8 {2 N, _0 \& K" r* B2 R7 q) R, D) L  `; Toutput mcasp_afsr,
+ |' B8 Q/ E% ~& A5 ?& H5 ~output mcasp_ahclkr,
) ~3 Q1 X, r2 j! ?3 ?8 p% P" E! r' {output mcasp_aclkr,
9 [7 {. U! V# Y, h& Y( \4 {- Ooutput axr1,' H" `% x3 l5 s$ |3 f
assign mcasp_afsr = mcasp_afsx;
( |# [7 ?) A+ r4 [( g$ M% w# W4 Oassign mcasp_aclkr = mcasp_aclkx;5 b! H! a' p* {  P* H+ @% F
assign mcasp_ahclkr = mcasp_ahclkx;
& N' _" a: u  C8 R7 d* i6 _* j. Rassign axr1 = axr0;

' N1 d* Q( K* _9 U7 ?0 T! E
$ c2 ]8 Y# y: P5 O
在OMAPL138这端,通过axr0接口发固定的数,axr1接收。
在配置MACASP的时候,发送全部取内部时钟,接收全部取外部时钟。
一直循环发送,但是接收不到。在FPGA端也没有看到时钟和信号的波形。
部分代码如下,关于edma3的部分未做变化。

  {1 G9 V9 R( ~* D
static void McASPI2SConfigure(void)
8 Q1 L4 f! M) t{
/ b9 n8 r) w: k* E' E! AMcASPRxReset(SOC_MCASP_0_CTRL_REGS);
1 L$ T) j5 [9 }McASPTxReset(SOC_MCASP_0_CTRL_REGS);
/* Enable the FIFOs for DMA transfer */; j8 r* z4 S( S* f3 C( P
McASPReadFifoEnable(SOC_MCASP_0_FIFO_REGS, 1, 1);; l. k2 Z6 K' d! }6 E5 L. |
McASPWriteFifoEnable(SOC_MCASP_0_FIFO_REGS, 1, 1);
/* Set I2S format in the transmitter/receiver format units */
; x1 W* c  @5 V" ?0 ^, fMcASPRxFmtI2SSet(SOC_MCASP_0_CTRL_REGS, WORD_SIZE, SLOT_SIZE,
. M4 i% [9 p  U, _4 G5 C7 b, MMCASP_RX_MODE_DMA);
( _2 N9 a; e3 K5 b  M% wMcASPTxFmtI2SSet(SOC_MCASP_0_CTRL_REGS, WORD_SIZE, SLOT_SIZE,% a* I6 T& c7 }2 v1 {7 K
MCASP_TX_MODE_DMA);
/* Configure the frame sync. I2S shall work in TDM format with 2 slots */
, q& p: C" ~( o, n! OMcASPRxFrameSyncCfg(SOC_MCASP_0_CTRL_REGS, 2, MCASP_RX_FS_WIDTH_WORD,
8 h* r3 w- @- q6 M0 _0 ZMCASP_RX_FS_EXT_BEGIN_ON_FALL_EDGE);  `  v& U& Q  n5 j# {
McASPTxFrameSyncCfg(SOC_MCASP_0_CTRL_REGS, 2, MCASP_TX_FS_WIDTH_WORD, . d* |; A; g" d5 F5 z
MCASP_TX_FS_INT_BEGIN_ON_RIS_EDGE);
/* configure the clock for receiver */3 J1 H" p) p+ R; q& t
McASPRxClkCfg(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_EXTERNAL, 0, 0);
* P4 p9 W. C: ?4 {3 V" [; S; GMcASPRxClkPolaritySet(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_POL_RIS_EDGE);
1 d$ d, y/ D. ]6 M+ tMcASPRxClkCheckConfig(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLKCHCK_DIV32,
" y: V3 {% Y+ p/ p0x00, 0xFF);
/* configure the clock for transmitter */
& k. j9 y8 c& N! {4 \) gMcASPTxClkCfg(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_INTERNAL, 11, 1);0 w7 p" ^! {: K# k0 T6 `
McASPTxClkPolaritySet(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_POL_FALL_EDGE); 8 t$ P8 N. N4 x
McASPTxClkCheckConfig(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLKCHCK_DIV32,5 T3 G$ @2 X8 g% G( U
0x00, 0xFF);
0 L) _* e# v7 ?4 K& X
  M9 }+ }4 R" Q/ ]3 @% |5 l" b' O/* Enable synchronization of RX and TX sections */ 1 s/ I2 ]* E1 d! D
McASPTxRxClkSyncEnable(SOC_MCASP_0_CTRL_REGS);
/* Enable the transmitter/receiver slots. I2S uses 2 slots */& W: a* E, X, u
McASPRxTimeSlotSet(SOC_MCASP_0_CTRL_REGS, I2S_SLOTS);; V/ H8 s0 I* _4 T# {
McASPTxTimeSlotSet(SOC_MCASP_0_CTRL_REGS, I2S_SLOTS);
/*
+ _7 u4 j6 Z  a8 m/ v** Set the serializers, Currently only one serializer is set as
, x, f( b, o4 O' \9 W! C' d! x** transmitter and one serializer as receiver.' B6 f" J' A. G- B4 E1 ]- x& T
*/
" g3 n% ?2 G, ~: T9 _% P) iMcASPSerializerRxSet(SOC_MCASP_0_CTRL_REGS, MCASP_XSER_RX);+ @# v  k7 ]( I% m- y: A; B
McASPSerializerTxSet(SOC_MCASP_0_CTRL_REGS, MCASP_XSER_TX);
/*8 H0 z8 n/ T; h) m' E# @8 C
** Configure the McASP pins
; ^* }& C* w6 P* L) M** Input - Frame Sync, Clock and Serializer Rx
4 U* K+ L: A' m( K+ t$ A% G0 k6 @- X/ ^** Output - Serializer Tx is connected to the input of the codec
/ g3 P6 C7 i6 s8 B( C* m* {% K*/
* {7 P' z+ S. S; dMcASPPinMcASPSet(SOC_MCASP_0_CTRL_REGS, 0xFFFFFFFF);- W0 q1 L' P* o- f% j* r
McASPPinDirOutputSet(SOC_MCASP_0_CTRL_REGS,MCASP_PIN_AXR(MCASP_XSER_TX));
7 c1 W  |$ v( N8 x, QMcASPPinDirInputSet(SOC_MCASP_0_CTRL_REGS, MCASP_PIN_AFSX
/ ~1 L% @+ J( D0 u| MCASP_PIN_ACLKX2 t. o* u% y; T  K5 P
| MCASP_PIN_AHCLKX
/ j* i: L4 ~0 _: i& z: n| MCASP_PIN_AXR(MCASP_XSER_RX));
/* Enable error interrupts for McASP */* j9 }9 E* O% Q4 h$ Y
McASPTxIntEnable(SOC_MCASP_0_CTRL_REGS, MCASP_TX_DMAERROR 5 W* `, B6 P8 x) A4 P- T* i
| MCASP_TX_CLKFAIL ) F7 @" J3 B+ \
| MCASP_TX_SYNCERROR
* N! g. w9 G  S5 l9 x0 {4 s2 u| MCASP_TX_UNDERRUN);
McASPRxIntEnable(SOC_MCASP_0_CTRL_REGS, MCASP_RX_DMAERROR " N) S. y8 H5 X  k. ~1 X
| MCASP_RX_CLKFAIL% C$ `1 B, ]: v% G# J: P
| MCASP_RX_SYNCERROR
9 U& N% j/ H/ o+ e4 E; i/ z| MCASP_RX_OVERRUN);
9 G' o6 Y4 T( Y) d& K  ?' i* F3 Z% o}
static void I2SDataTxRxActivate(void)
* w7 d8 ]5 Q3 f' p, ~' i{' A* \" m8 R9 h* p9 `
/* Start the clocks */
6 [" z5 j  H. F( n( eMcASPRxClkStart(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_EXTERNAL);
6 W4 M6 e" P! G3 f1 _& C) yMcASPTxClkStart(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_INTERNAL);
/* Enable EDMA for the transfer */. H! x4 \" W7 {; H- u
EDMA3EnableTransfer(SOC_EDMA30CC_0_REGS, EDMA3_CHA_MCASP0_RX,
5 [6 ^6 J$ s. A/ l+ W5 _$ NEDMA3_TRIG_MODE_EVENT);
1 ]) G) D. R; vEDMA3EnableTransfer(SOC_EDMA30CC_0_REGS, ; a, o. J4 }  V4 \
EDMA3_CHA_MCASP0_TX, EDMA3_TRIG_MODE_EVENT);
/* Activate the serializers */
5 X4 i, m" }: N* FMcASPRxSerActivate(SOC_MCASP_0_CTRL_REGS);5 I3 j  W, L/ a* V. s: F
McASPTxSerActivate(SOC_MCASP_0_CTRL_REGS);
/* make sure that the XDATA bit is cleared to zero */
; f& G7 x  f0 Z" x! d- Mwhile(McASPTxStatusGet(SOC_MCASP_0_CTRL_REGS) & MCASP_TX_STAT_DATAREADY);
/* Activate the state machines */2 u) l# W' p5 e# P' G( V
McASPRxEnable(SOC_MCASP_0_CTRL_REGS);
7 X; y2 K7 e9 W+ c9 V$ i$ tMcASPTxEnable(SOC_MCASP_0_CTRL_REGS);: M5 S# {& ~3 h; o8 x
}
7 n2 Y! x* T7 s
请问:问题出在哪了,时钟按照这样配是否有错。
另外我看XDATA一直是0,接收的rxbuf0,1,2里有一般全是FFFF一半全是0.

  [4 |( E2 ~4 y, z+ |7 ?% n
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