MCASP自环配置。 - OMAP-L138 - 嵌入式开发者社区 - 51ele.net
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[未解决] MCASP自环配置。

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发表于 2018-11-7 13:28:07 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
我项目上用OMAPL138的板子MCASP的引脚都是链接的FPGA,所以在FPGA这端设置的MCASP自环。把axr0接收到的通过axr1发回去。
部分代码如下
input mcasp_afsx,7 r2 R) [! h. l# o
input mcasp_ahclkx,6 I8 K) H3 Y& ~5 r" h' D( N
input mcasp_aclkx,
$ P. {* ?* o, M) T5 j9 Zinput axr0,3 t6 l) u/ S6 t, V9 `

* Q' y* @' b8 W* g! H% O: J4 `output mcasp_afsr,( v$ O# d7 `! t0 F( ?
output mcasp_ahclkr,
( B: h6 w3 R0 r+ @" Z  \  ^output mcasp_aclkr,% M0 L, y# R8 U' y# m
output axr1,8 X7 m3 s6 Q) ?' D9 U  `
assign mcasp_afsr = mcasp_afsx;
% U( }' E- Z6 o) Fassign mcasp_aclkr = mcasp_aclkx;2 h; A0 `2 {; z. M% P
assign mcasp_ahclkr = mcasp_ahclkx;1 x7 w% r1 e$ L' A
assign axr1 = axr0;

3 `0 K2 T* [+ [3 Z3 {( V3 r  ^) P: T$ T$ U/ R1 o3 z
在OMAPL138这端,通过axr0接口发固定的数,axr1接收。
在配置MACASP的时候,发送全部取内部时钟,接收全部取外部时钟。
一直循环发送,但是接收不到。在FPGA端也没有看到时钟和信号的波形。
部分代码如下,关于edma3的部分未做变化。
7 e, X, U6 y/ ]
static void McASPI2SConfigure(void)9 |1 e$ L$ i) F% W
{$ l9 E: w# ^7 i' n
McASPRxReset(SOC_MCASP_0_CTRL_REGS);" Q6 T  d- ^  }: P6 I1 C% h( ]
McASPTxReset(SOC_MCASP_0_CTRL_REGS);
/* Enable the FIFOs for DMA transfer */# ?, j0 `8 q% _9 E+ z6 A' f
McASPReadFifoEnable(SOC_MCASP_0_FIFO_REGS, 1, 1);( x4 l& H  S' E9 q+ b
McASPWriteFifoEnable(SOC_MCASP_0_FIFO_REGS, 1, 1);
/* Set I2S format in the transmitter/receiver format units */7 Y8 s, v0 |3 z4 Y8 W1 r! f  U$ |
McASPRxFmtI2SSet(SOC_MCASP_0_CTRL_REGS, WORD_SIZE, SLOT_SIZE,
: C7 Y0 H' z/ ]( MMCASP_RX_MODE_DMA);" L' x7 F: T4 _, g4 Z- |
McASPTxFmtI2SSet(SOC_MCASP_0_CTRL_REGS, WORD_SIZE, SLOT_SIZE,
; _. H5 l7 g! X) K" F) pMCASP_TX_MODE_DMA);
/* Configure the frame sync. I2S shall work in TDM format with 2 slots */
! f, n' n& g8 d. _! B- _) k; [McASPRxFrameSyncCfg(SOC_MCASP_0_CTRL_REGS, 2, MCASP_RX_FS_WIDTH_WORD, 2 h3 \% o7 S& S' d7 L
MCASP_RX_FS_EXT_BEGIN_ON_FALL_EDGE);
6 Q& `; ^  B, x9 KMcASPTxFrameSyncCfg(SOC_MCASP_0_CTRL_REGS, 2, MCASP_TX_FS_WIDTH_WORD, 3 Q9 W6 a% Q  m8 r5 D4 [
MCASP_TX_FS_INT_BEGIN_ON_RIS_EDGE);
/* configure the clock for receiver */4 K& A: D4 O$ K- L4 O
McASPRxClkCfg(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_EXTERNAL, 0, 0);
( y$ g% a7 M5 Z- p2 M1 g, m! mMcASPRxClkPolaritySet(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_POL_RIS_EDGE);
" b- Z3 `% y6 H5 z  KMcASPRxClkCheckConfig(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLKCHCK_DIV32,
; R8 f5 a) I8 S- H: x$ I) `0x00, 0xFF);
/* configure the clock for transmitter */
& O5 A" K  W7 @: c0 S6 rMcASPTxClkCfg(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_INTERNAL, 11, 1);
1 a" G' l+ n; \: S9 y9 YMcASPTxClkPolaritySet(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_POL_FALL_EDGE); 8 ], C( h. N1 h2 ^$ ]
McASPTxClkCheckConfig(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLKCHCK_DIV32,8 g% {$ h" T  Y0 K
0x00, 0xFF);
9 j( M" r. m( B; |9 M
7 O9 E* x$ {7 X% J% d6 Z9 v* {/* Enable synchronization of RX and TX sections */ ( R/ a" T5 b& |, B; H$ v/ k
McASPTxRxClkSyncEnable(SOC_MCASP_0_CTRL_REGS);
/* Enable the transmitter/receiver slots. I2S uses 2 slots */) x6 |. q! x6 b' ^
McASPRxTimeSlotSet(SOC_MCASP_0_CTRL_REGS, I2S_SLOTS);: v$ v- ~2 }1 T& V
McASPTxTimeSlotSet(SOC_MCASP_0_CTRL_REGS, I2S_SLOTS);
/*3 @) T. h. N- \* m4 I) ^+ u4 ~
** Set the serializers, Currently only one serializer is set as: \9 |- A7 E6 D& o% r3 H3 b- @
** transmitter and one serializer as receiver./ d2 `) z) @/ q6 H! y! H" p5 K
*/- \. L- t' H3 a+ K5 X$ X/ }
McASPSerializerRxSet(SOC_MCASP_0_CTRL_REGS, MCASP_XSER_RX);
& ~6 D, [! |. y) Y+ c( `McASPSerializerTxSet(SOC_MCASP_0_CTRL_REGS, MCASP_XSER_TX);
/*
3 X8 {) u8 z7 b$ X$ f- N: g** Configure the McASP pins
5 g- J  P% o4 q* F+ l5 j** Input - Frame Sync, Clock and Serializer Rx" ], k* v. T& C, b: `- i4 _
** Output - Serializer Tx is connected to the input of the codec : y) C. _# s% r- K5 I7 b" B
*/) i# N4 D5 k1 e, Z% [* y# U4 F% l7 W
McASPPinMcASPSet(SOC_MCASP_0_CTRL_REGS, 0xFFFFFFFF);
: ^/ t& g% G5 ]9 Q" V6 k9 G$ FMcASPPinDirOutputSet(SOC_MCASP_0_CTRL_REGS,MCASP_PIN_AXR(MCASP_XSER_TX));" I7 w  q% u& p1 X9 B3 L5 i
McASPPinDirInputSet(SOC_MCASP_0_CTRL_REGS, MCASP_PIN_AFSX0 b- ~7 Q- R! C& @9 h$ |
| MCASP_PIN_ACLKX. _: _6 O. v$ L( F% E& y1 p5 v
| MCASP_PIN_AHCLKX; ]' I5 R: N+ c. Q& y
| MCASP_PIN_AXR(MCASP_XSER_RX));
/* Enable error interrupts for McASP */
. x4 f; o4 _+ B& gMcASPTxIntEnable(SOC_MCASP_0_CTRL_REGS, MCASP_TX_DMAERROR
: m. ~, c) t5 h) W7 }, o9 O- P3 j| MCASP_TX_CLKFAIL
4 O, W) D6 _* V% E* \# E  d  W3 u7 p| MCASP_TX_SYNCERROR; @4 m4 x% M, m( t1 J* s
| MCASP_TX_UNDERRUN);
McASPRxIntEnable(SOC_MCASP_0_CTRL_REGS, MCASP_RX_DMAERROR 7 n; ~& q; U4 v- w$ @
| MCASP_RX_CLKFAIL/ k" S6 h! d4 x7 R* {1 j6 k
| MCASP_RX_SYNCERROR 6 o6 [# f* \- Q
| MCASP_RX_OVERRUN);3 w$ n8 C$ V# S: A, T
}
static void I2SDataTxRxActivate(void)
( b" f5 {/ Q  c0 n- z{
' i6 N( S, @9 K6 j/* Start the clocks */3 K# _( o7 S5 Y$ `) @4 B) M4 E
McASPRxClkStart(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_EXTERNAL);
# A+ l0 b  M/ ~( S( aMcASPTxClkStart(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_INTERNAL);
/* Enable EDMA for the transfer */
, y% J( P3 W1 V& @EDMA3EnableTransfer(SOC_EDMA30CC_0_REGS, EDMA3_CHA_MCASP0_RX,- w% P1 m: H! x7 N: m( j
EDMA3_TRIG_MODE_EVENT);
' D( o5 t; h  f1 Y. E- k2 m. dEDMA3EnableTransfer(SOC_EDMA30CC_0_REGS, ' V1 r, g1 m1 s: U
EDMA3_CHA_MCASP0_TX, EDMA3_TRIG_MODE_EVENT);
/* Activate the serializers */
4 Y6 H: X- Q9 j; @McASPRxSerActivate(SOC_MCASP_0_CTRL_REGS);9 E3 @8 F" v0 k) h* B7 i2 @+ n6 P
McASPTxSerActivate(SOC_MCASP_0_CTRL_REGS);
/* make sure that the XDATA bit is cleared to zero */# {7 k- M: F7 T6 P" B3 K
while(McASPTxStatusGet(SOC_MCASP_0_CTRL_REGS) & MCASP_TX_STAT_DATAREADY);
/* Activate the state machines */
* E+ {0 O$ n2 u, j- o9 ZMcASPRxEnable(SOC_MCASP_0_CTRL_REGS);! v, `( e. ^: @9 o" C  Q
McASPTxEnable(SOC_MCASP_0_CTRL_REGS);9 h3 N( o5 y7 X) }1 Y* F
}

4 P$ r# ?. d0 Y: a
请问:问题出在哪了,时钟按照这样配是否有错。
另外我看XDATA一直是0,接收的rxbuf0,1,2里有一般全是FFFF一半全是0.
' T$ y: I- B: k4 b3 P+ l1 P$ d6 `2 O3 ~
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