MCASP自环配置。 - OMAP-L138 - 嵌入式开发者社区 - 51ele.net
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[未解决] MCASP自环配置。

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发表于 2018-11-7 13:28:07 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
我项目上用OMAPL138的板子MCASP的引脚都是链接的FPGA,所以在FPGA这端设置的MCASP自环。把axr0接收到的通过axr1发回去。
部分代码如下
input mcasp_afsx,
' `7 }) s6 e& Binput mcasp_ahclkx,
! v+ o& K- l3 X  H- x  Sinput mcasp_aclkx,
. _% M7 b! u, ^( `) T2 pinput axr0,
+ [$ X- w+ ~/ k) W, H/ Q5 i; `/ s/ ^* n8 j& M
output mcasp_afsr,: N2 r8 N. l) b
output mcasp_ahclkr,
9 i  m2 [! q7 uoutput mcasp_aclkr,
2 R, i: Q& _4 G+ y) Ooutput axr1,
4 J* q- ~$ P0 s5 H5 u: c
assign mcasp_afsr = mcasp_afsx;8 p+ M5 ~# d1 T' U
assign mcasp_aclkr = mcasp_aclkx;" X1 o9 p, Z. D: ?9 r& T0 o1 K
assign mcasp_ahclkr = mcasp_ahclkx;
9 h! c5 @, _1 R4 Oassign axr1 = axr0;
, T, Y8 Y" T2 u* d" [
5 i) g' \1 o2 L5 g
在OMAPL138这端,通过axr0接口发固定的数,axr1接收。
在配置MACASP的时候,发送全部取内部时钟,接收全部取外部时钟。
一直循环发送,但是接收不到。在FPGA端也没有看到时钟和信号的波形。
部分代码如下,关于edma3的部分未做变化。
- C, W5 K! F7 q2 L
static void McASPI2SConfigure(void)2 g* S7 [. b, d+ c
{
3 [" z& V" m% I" hMcASPRxReset(SOC_MCASP_0_CTRL_REGS);
/ O8 i, t3 X5 k  {$ tMcASPTxReset(SOC_MCASP_0_CTRL_REGS);
/* Enable the FIFOs for DMA transfer */
' r( B9 v: c; q, d# O* L+ `" EMcASPReadFifoEnable(SOC_MCASP_0_FIFO_REGS, 1, 1);( I3 g% {; b" S( ?' }0 C+ E
McASPWriteFifoEnable(SOC_MCASP_0_FIFO_REGS, 1, 1);
/* Set I2S format in the transmitter/receiver format units */
& d7 c  h- R* p8 G1 fMcASPRxFmtI2SSet(SOC_MCASP_0_CTRL_REGS, WORD_SIZE, SLOT_SIZE,: b8 N& b# O. j
MCASP_RX_MODE_DMA);; q3 O& T  p( D& ]( H
McASPTxFmtI2SSet(SOC_MCASP_0_CTRL_REGS, WORD_SIZE, SLOT_SIZE,$ M3 ]7 f& l2 L
MCASP_TX_MODE_DMA);
/* Configure the frame sync. I2S shall work in TDM format with 2 slots */5 x" c, a$ |/ y* @+ @" f
McASPRxFrameSyncCfg(SOC_MCASP_0_CTRL_REGS, 2, MCASP_RX_FS_WIDTH_WORD, / f* b) m7 a6 f  {
MCASP_RX_FS_EXT_BEGIN_ON_FALL_EDGE);
2 G$ }0 Y  E, m9 c" k7 O7 A2 pMcASPTxFrameSyncCfg(SOC_MCASP_0_CTRL_REGS, 2, MCASP_TX_FS_WIDTH_WORD, + W7 K7 V# N( I9 |5 v
MCASP_TX_FS_INT_BEGIN_ON_RIS_EDGE);
/* configure the clock for receiver */, Q1 ~- l7 X, A  ~
McASPRxClkCfg(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_EXTERNAL, 0, 0);$ k. ?& O& B2 W
McASPRxClkPolaritySet(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_POL_RIS_EDGE); - }$ X) T( F1 S2 \3 F) c/ }
McASPRxClkCheckConfig(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLKCHCK_DIV32,6 E2 I6 t& o7 T( p
0x00, 0xFF);
/* configure the clock for transmitter */
$ z* r5 Y  f1 W8 `McASPTxClkCfg(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_INTERNAL, 11, 1);0 {: N. v/ W4 ]' N, w3 Y; m( R
McASPTxClkPolaritySet(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_POL_FALL_EDGE);
; m# f: T- T2 k( C$ G' sMcASPTxClkCheckConfig(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLKCHCK_DIV32,
  i! a1 Q1 v3 {! O7 y. K  `0x00, 0xFF);5 U0 a7 t$ Z) U* H; n% W
* E: }; b- c: F: F1 B3 u5 S
/* Enable synchronization of RX and TX sections */ " M" b# [- G4 m, P* |& C' J
McASPTxRxClkSyncEnable(SOC_MCASP_0_CTRL_REGS);
/* Enable the transmitter/receiver slots. I2S uses 2 slots */
5 W7 t7 h$ r' ?& x# mMcASPRxTimeSlotSet(SOC_MCASP_0_CTRL_REGS, I2S_SLOTS);
* z! m' p# B3 J- i+ f. C  s$ KMcASPTxTimeSlotSet(SOC_MCASP_0_CTRL_REGS, I2S_SLOTS);
/*" S1 Z( m5 P# ^2 N9 Q- P" J
** Set the serializers, Currently only one serializer is set as$ ?& N4 H# L! Y8 f% G0 [' c
** transmitter and one serializer as receiver.
# }# v# D% N' ^, A3 x*/
9 r3 x' W  |% v1 MMcASPSerializerRxSet(SOC_MCASP_0_CTRL_REGS, MCASP_XSER_RX);
' x8 R! Q! C, H0 W! XMcASPSerializerTxSet(SOC_MCASP_0_CTRL_REGS, MCASP_XSER_TX);
/*2 N! _( `- I0 w# D
** Configure the McASP pins 9 m" b  |1 ?/ O" H1 C$ t
** Input - Frame Sync, Clock and Serializer Rx
! C0 Q' E- e* k; C9 N** Output - Serializer Tx is connected to the input of the codec
4 z9 D  H8 r/ h( ^0 k. w0 Y*/* p7 P3 J2 Z  \
McASPPinMcASPSet(SOC_MCASP_0_CTRL_REGS, 0xFFFFFFFF);
" G9 p* y9 b* v8 Z( k3 [! V5 j4 aMcASPPinDirOutputSet(SOC_MCASP_0_CTRL_REGS,MCASP_PIN_AXR(MCASP_XSER_TX));
: q# J; v# }, l% s4 j% W' zMcASPPinDirInputSet(SOC_MCASP_0_CTRL_REGS, MCASP_PIN_AFSX
8 Q1 l1 M& ^& c$ ^# s| MCASP_PIN_ACLKX
& Q! W% a. @. i  [' t: }| MCASP_PIN_AHCLKX7 J, i! C# |/ N: L' R
| MCASP_PIN_AXR(MCASP_XSER_RX));
/* Enable error interrupts for McASP */: ^4 {: x6 z  E. V' O  z
McASPTxIntEnable(SOC_MCASP_0_CTRL_REGS, MCASP_TX_DMAERROR
) ?& A  p# W" t& c, I- h/ H4 S| MCASP_TX_CLKFAIL 4 s; [$ I3 V2 m6 H7 Y/ v, M: j
| MCASP_TX_SYNCERROR
1 |' L$ X9 G1 Q' ^% ]| MCASP_TX_UNDERRUN);
McASPRxIntEnable(SOC_MCASP_0_CTRL_REGS, MCASP_RX_DMAERROR ) ~8 ^7 n! l4 X) @
| MCASP_RX_CLKFAIL; c7 ~& W# d% t- ~7 V
| MCASP_RX_SYNCERROR % z. O4 A. r! p
| MCASP_RX_OVERRUN);
: j0 I4 w+ w; V" ?5 k}
static void I2SDataTxRxActivate(void)9 O% N2 y6 E, D# m; P7 E) f( t
{) e2 F8 Z% t. {
/* Start the clocks */
. j1 V* [1 }6 B/ W6 dMcASPRxClkStart(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_EXTERNAL);8 |6 ^9 k/ W+ b  h
McASPTxClkStart(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_INTERNAL);
/* Enable EDMA for the transfer */
1 [2 j4 i7 l! {: j- ~EDMA3EnableTransfer(SOC_EDMA30CC_0_REGS, EDMA3_CHA_MCASP0_RX,; L! t3 U$ y" L0 ^* C$ p
EDMA3_TRIG_MODE_EVENT);; j. ]% l; f, ]& N& W+ I, Z
EDMA3EnableTransfer(SOC_EDMA30CC_0_REGS,
" R/ N+ ^9 L4 }- U& L" @: E. rEDMA3_CHA_MCASP0_TX, EDMA3_TRIG_MODE_EVENT);
/* Activate the serializers */
) v/ x8 \7 I7 P/ DMcASPRxSerActivate(SOC_MCASP_0_CTRL_REGS);  T/ `4 }6 A, x: O3 q; {2 \# A
McASPTxSerActivate(SOC_MCASP_0_CTRL_REGS);
/* make sure that the XDATA bit is cleared to zero *// U& m- b2 k+ }+ i- t
while(McASPTxStatusGet(SOC_MCASP_0_CTRL_REGS) & MCASP_TX_STAT_DATAREADY);
/* Activate the state machines *// p* s' a1 K" s% ]
McASPRxEnable(SOC_MCASP_0_CTRL_REGS);" n1 w5 h, ?3 g( {1 t) b7 s
McASPTxEnable(SOC_MCASP_0_CTRL_REGS);
9 K+ d* D% z5 E/ i3 m( z" }}
3 O1 L# f# t% x& Z4 t
请问:问题出在哪了,时钟按照这样配是否有错。
另外我看XDATA一直是0,接收的rxbuf0,1,2里有一般全是FFFF一半全是0.

; A, y: Y) e7 u( |
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