MCASP自环配置。 - OMAP-L138 - 嵌入式开发者社区 - 51ele.net
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[未解决] MCASP自环配置。

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发表于 2018-11-7 13:28:07 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
我项目上用OMAPL138的板子MCASP的引脚都是链接的FPGA,所以在FPGA这端设置的MCASP自环。把axr0接收到的通过axr1发回去。
部分代码如下
input mcasp_afsx,0 c/ Y( F+ H) i$ ^$ y& m4 c- J
input mcasp_ahclkx,9 i5 e& E; w% U& s
input mcasp_aclkx,
$ n( P9 {5 T, y+ Qinput axr0,
, }1 R2 M1 ?9 \( z
$ l' _8 _* z" E4 y3 w: J' Toutput mcasp_afsr,
! o: E* B# w  ~: r/ w3 p2 A9 _output mcasp_ahclkr,8 F1 ~! t& K& d* o) o8 A
output mcasp_aclkr,
6 K/ ~( _- W; m- K4 J& `/ t, ?output axr1,
5 m% M$ X7 F/ e* V- H2 b
assign mcasp_afsr = mcasp_afsx;- q4 y0 x* s$ b* V
assign mcasp_aclkr = mcasp_aclkx;
9 ?5 {7 [6 z8 R$ sassign mcasp_ahclkr = mcasp_ahclkx;5 ]& k5 V7 I% m0 d' Y
assign axr1 = axr0;
' u' w: U6 q- R/ r& `$ b+ {

% e2 {+ Y7 ?2 }: y
在OMAPL138这端,通过axr0接口发固定的数,axr1接收。
在配置MACASP的时候,发送全部取内部时钟,接收全部取外部时钟。
一直循环发送,但是接收不到。在FPGA端也没有看到时钟和信号的波形。
部分代码如下,关于edma3的部分未做变化。

- [9 }1 q( f2 T* p
static void McASPI2SConfigure(void)4 k4 n: f. A+ S& i
{
8 d! W  k/ X! U3 XMcASPRxReset(SOC_MCASP_0_CTRL_REGS);% Q; e; x  w7 \1 A6 D" l
McASPTxReset(SOC_MCASP_0_CTRL_REGS);
/* Enable the FIFOs for DMA transfer */
: e& E8 ~2 H( S% i9 IMcASPReadFifoEnable(SOC_MCASP_0_FIFO_REGS, 1, 1);2 F+ v6 U! ]& N& j" L8 N4 O1 t
McASPWriteFifoEnable(SOC_MCASP_0_FIFO_REGS, 1, 1);
/* Set I2S format in the transmitter/receiver format units */$ ?$ t& h7 ^0 d) f$ e3 F
McASPRxFmtI2SSet(SOC_MCASP_0_CTRL_REGS, WORD_SIZE, SLOT_SIZE,% c2 F* Y0 d- i  `7 k1 f
MCASP_RX_MODE_DMA);
& g! l* v: R* p+ k7 e. _McASPTxFmtI2SSet(SOC_MCASP_0_CTRL_REGS, WORD_SIZE, SLOT_SIZE,9 r8 `' f5 Y: z+ A
MCASP_TX_MODE_DMA);
/* Configure the frame sync. I2S shall work in TDM format with 2 slots */% o& v5 k/ a3 d% a$ t+ W5 t
McASPRxFrameSyncCfg(SOC_MCASP_0_CTRL_REGS, 2, MCASP_RX_FS_WIDTH_WORD,
% v* l. B- F3 M' {MCASP_RX_FS_EXT_BEGIN_ON_FALL_EDGE);
: @, F5 D/ }- D' c# WMcASPTxFrameSyncCfg(SOC_MCASP_0_CTRL_REGS, 2, MCASP_TX_FS_WIDTH_WORD, ( v1 z% A( u! W7 s) L( w* s  @
MCASP_TX_FS_INT_BEGIN_ON_RIS_EDGE);
/* configure the clock for receiver */
# R6 o  ^, {9 h7 qMcASPRxClkCfg(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_EXTERNAL, 0, 0);
+ E/ m6 p& r. K9 V" bMcASPRxClkPolaritySet(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_POL_RIS_EDGE); 8 B5 j9 s6 t/ u: L. a/ J
McASPRxClkCheckConfig(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLKCHCK_DIV32,* J: u, }8 y; f) u9 b0 K1 L
0x00, 0xFF);
/* configure the clock for transmitter */6 v) b  Q2 N9 ^
McASPTxClkCfg(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_INTERNAL, 11, 1);
  f$ ]$ n; g2 y+ g' \: M8 k3 R8 D% l. t/ rMcASPTxClkPolaritySet(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_POL_FALL_EDGE);
4 O; m: Y. l- D' T4 N  A: rMcASPTxClkCheckConfig(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLKCHCK_DIV32," h0 q! L% I9 k7 c$ K4 _1 P% Z
0x00, 0xFF);
9 m6 B: ?8 B2 X% t, N- ]: j9 z; v8 M. {. M/ P/ m- q
/* Enable synchronization of RX and TX sections */ ; ?3 \# G8 n0 z. g9 a0 V- J
McASPTxRxClkSyncEnable(SOC_MCASP_0_CTRL_REGS);
/* Enable the transmitter/receiver slots. I2S uses 2 slots */
: f' i0 k4 d% XMcASPRxTimeSlotSet(SOC_MCASP_0_CTRL_REGS, I2S_SLOTS);) ]: W/ X# f8 J; v7 x% M4 v0 z
McASPTxTimeSlotSet(SOC_MCASP_0_CTRL_REGS, I2S_SLOTS);
/*' p1 ~. v6 i& F: U9 x
** Set the serializers, Currently only one serializer is set as) H3 i+ n8 D* x* o
** transmitter and one serializer as receiver.
, w' \2 _( C- S# E& b) J*/
. J2 ]( [( H2 P5 v; e- m7 D2 V0 fMcASPSerializerRxSet(SOC_MCASP_0_CTRL_REGS, MCASP_XSER_RX);% g! L" j. f0 T  a( |1 |' U
McASPSerializerTxSet(SOC_MCASP_0_CTRL_REGS, MCASP_XSER_TX);
/*
# o8 A0 K+ f# I: ]- K9 W* @  a** Configure the McASP pins
! n& M% E- |2 D# L1 N* I- R! }$ o** Input - Frame Sync, Clock and Serializer Rx7 t/ k' V( u% Z; F' X0 M
** Output - Serializer Tx is connected to the input of the codec
; v7 X7 o, D2 t0 K1 q*/7 V2 l/ n3 R1 F+ W
McASPPinMcASPSet(SOC_MCASP_0_CTRL_REGS, 0xFFFFFFFF);
) }, H3 \3 M9 j3 MMcASPPinDirOutputSet(SOC_MCASP_0_CTRL_REGS,MCASP_PIN_AXR(MCASP_XSER_TX));4 \6 H! J3 Q* S, {) H- P
McASPPinDirInputSet(SOC_MCASP_0_CTRL_REGS, MCASP_PIN_AFSX8 a, b* F. i( q+ A5 ~
| MCASP_PIN_ACLKX
5 i! S" v) ^% p- I& Z| MCASP_PIN_AHCLKX
; D$ e7 [& B: v: c# k| MCASP_PIN_AXR(MCASP_XSER_RX));
/* Enable error interrupts for McASP */0 Z% g  p2 _+ ?7 y4 F, ^
McASPTxIntEnable(SOC_MCASP_0_CTRL_REGS, MCASP_TX_DMAERROR 8 B* J: v) }* o
| MCASP_TX_CLKFAIL . z- m+ K  J( t8 V' C
| MCASP_TX_SYNCERROR' B6 P8 G/ i3 |# |; S( \4 Z' X
| MCASP_TX_UNDERRUN);
McASPRxIntEnable(SOC_MCASP_0_CTRL_REGS, MCASP_RX_DMAERROR
) O! y" F: ]. S. Z( B4 ]- H| MCASP_RX_CLKFAIL0 W& R* Y) b4 K9 {. C4 w
| MCASP_RX_SYNCERROR
5 Y* t/ T0 n) {| MCASP_RX_OVERRUN);9 Y/ H) D2 l4 X! o' v
}
static void I2SDataTxRxActivate(void)% a, ~4 y. v0 C0 d* I; t( O
{
: Y' I+ ]/ }9 f& _6 _* E! I5 @/* Start the clocks */
! g6 |! {4 A9 o+ E0 nMcASPRxClkStart(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_EXTERNAL);" K& B  a' R; c5 \# ~- @! T* T
McASPTxClkStart(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_INTERNAL);
/* Enable EDMA for the transfer */+ L9 F2 W6 g) i: \- ?% }' y3 Q
EDMA3EnableTransfer(SOC_EDMA30CC_0_REGS, EDMA3_CHA_MCASP0_RX,( U+ o3 u$ ]1 x% s6 ~/ H) D7 K
EDMA3_TRIG_MODE_EVENT);
" D6 M( T9 _% ~( |0 Q7 uEDMA3EnableTransfer(SOC_EDMA30CC_0_REGS,
! k& b4 H/ {* Y+ C" p. P6 nEDMA3_CHA_MCASP0_TX, EDMA3_TRIG_MODE_EVENT);
/* Activate the serializers */
* K9 X  C' ]+ {; W. e( K8 w# XMcASPRxSerActivate(SOC_MCASP_0_CTRL_REGS);
, I' C. a8 @/ }1 |/ m0 u, Q' xMcASPTxSerActivate(SOC_MCASP_0_CTRL_REGS);
/* make sure that the XDATA bit is cleared to zero */% l7 D( c  v, {' w0 A5 Q
while(McASPTxStatusGet(SOC_MCASP_0_CTRL_REGS) & MCASP_TX_STAT_DATAREADY);
/* Activate the state machines */
" H. ~5 ~0 k7 J& N/ y4 gMcASPRxEnable(SOC_MCASP_0_CTRL_REGS);
' W8 t4 K& p- g1 V3 ^' |3 \* Y  vMcASPTxEnable(SOC_MCASP_0_CTRL_REGS);
% H3 E0 i4 f1 f0 ]/ x, O}

' j$ @4 ^. E6 O" H- _- m1 h8 O8 s- x8 R
请问:问题出在哪了,时钟按照这样配是否有错。
另外我看XDATA一直是0,接收的rxbuf0,1,2里有一般全是FFFF一半全是0.
  {" W6 V& h$ h3 }- o8 ~
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