MCASP自环配置。 - OMAP-L138 - 嵌入式开发者社区 - 51ele.net
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[未解决] MCASP自环配置。

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发表于 2018-11-7 13:28:07 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
我项目上用OMAPL138的板子MCASP的引脚都是链接的FPGA,所以在FPGA这端设置的MCASP自环。把axr0接收到的通过axr1发回去。
部分代码如下
input mcasp_afsx,  P$ ~" ^- I. W2 @
input mcasp_ahclkx,8 k0 |' R- m. {0 l; M2 k% a
input mcasp_aclkx,
' F: K4 J' P' K+ t/ L  w. e& k) vinput axr0,
. D% ~) L3 ?; z8 i
& e/ G; D' d1 K% n/ f9 Qoutput mcasp_afsr,
+ B+ [* B( g, u7 Noutput mcasp_ahclkr,
/ b0 u: {6 `6 P% Loutput mcasp_aclkr,
* B" \- ~8 E4 a9 v. l( youtput axr1,1 g5 s. t; l, |' b1 ]7 u
assign mcasp_afsr = mcasp_afsx;
6 ?0 Z$ C. v3 J8 {& \assign mcasp_aclkr = mcasp_aclkx;
& A) E% v( U) Zassign mcasp_ahclkr = mcasp_ahclkx;
, b3 G7 z! n1 X$ W+ nassign axr1 = axr0;

& R# j! \0 e- n. z; F2 X, h. U+ \, W
在OMAPL138这端,通过axr0接口发固定的数,axr1接收。
在配置MACASP的时候,发送全部取内部时钟,接收全部取外部时钟。
一直循环发送,但是接收不到。在FPGA端也没有看到时钟和信号的波形。
部分代码如下,关于edma3的部分未做变化。
) ~* K. @8 h" ^6 T7 j
static void McASPI2SConfigure(void)
: d  [  _+ w- D- m{& F. ]+ I+ w- n& i9 ?/ n5 _; @
McASPRxReset(SOC_MCASP_0_CTRL_REGS);' T7 P7 E, _$ M
McASPTxReset(SOC_MCASP_0_CTRL_REGS);
/* Enable the FIFOs for DMA transfer */
# R& Q# S! V! \0 {' RMcASPReadFifoEnable(SOC_MCASP_0_FIFO_REGS, 1, 1);  E  N; I. I/ K/ s$ c- {* G
McASPWriteFifoEnable(SOC_MCASP_0_FIFO_REGS, 1, 1);
/* Set I2S format in the transmitter/receiver format units */( }9 j4 f" J. U( d' I
McASPRxFmtI2SSet(SOC_MCASP_0_CTRL_REGS, WORD_SIZE, SLOT_SIZE,
  [1 _8 \- K4 _& k( V3 {, q2 h5 jMCASP_RX_MODE_DMA);
5 i5 A' A8 S: s9 D! ?- q( y% nMcASPTxFmtI2SSet(SOC_MCASP_0_CTRL_REGS, WORD_SIZE, SLOT_SIZE,
- k& Y) X9 u5 }MCASP_TX_MODE_DMA);
/* Configure the frame sync. I2S shall work in TDM format with 2 slots */
- H1 A- C) ^0 n/ O& D* J: U% g$ ]$ P4 nMcASPRxFrameSyncCfg(SOC_MCASP_0_CTRL_REGS, 2, MCASP_RX_FS_WIDTH_WORD,
; e8 G" A5 H* t# oMCASP_RX_FS_EXT_BEGIN_ON_FALL_EDGE);2 K2 N7 n; f  x+ P) Q' H
McASPTxFrameSyncCfg(SOC_MCASP_0_CTRL_REGS, 2, MCASP_TX_FS_WIDTH_WORD,
; L- Y$ n. S5 u7 [4 l$ MMCASP_TX_FS_INT_BEGIN_ON_RIS_EDGE);
/* configure the clock for receiver */
* X6 `- R/ z. ~8 w; {McASPRxClkCfg(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_EXTERNAL, 0, 0);% C9 Z5 C3 M! k( ]. D3 R
McASPRxClkPolaritySet(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_POL_RIS_EDGE);
; F" b- |' T6 V0 MMcASPRxClkCheckConfig(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLKCHCK_DIV32,6 d# s; {8 b! w; l# h
0x00, 0xFF);
/* configure the clock for transmitter */
7 J7 a9 v& i. w3 E" N" KMcASPTxClkCfg(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_INTERNAL, 11, 1);
  y5 k# x9 O  h3 L, p$ aMcASPTxClkPolaritySet(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_POL_FALL_EDGE); ( [! Y" M/ q( y$ g- j/ u/ y% G7 y, }
McASPTxClkCheckConfig(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLKCHCK_DIV32,) ~  p/ ^3 K! G
0x00, 0xFF);
* n4 A* `) j. q& v0 U& X3 e6 O2 `
( j! o/ i( t! W. E6 U/* Enable synchronization of RX and TX sections */ % [. T3 R* _) M4 o$ Q
McASPTxRxClkSyncEnable(SOC_MCASP_0_CTRL_REGS);
/* Enable the transmitter/receiver slots. I2S uses 2 slots */
8 b0 E- B+ g' l  v) K+ ^McASPRxTimeSlotSet(SOC_MCASP_0_CTRL_REGS, I2S_SLOTS);6 j& |/ S$ Z9 a* o8 P8 L
McASPTxTimeSlotSet(SOC_MCASP_0_CTRL_REGS, I2S_SLOTS);
/*. ~' W% o8 D  B1 V0 \! j6 _. G
** Set the serializers, Currently only one serializer is set as+ F% ^1 K1 ~. P/ o" S/ [
** transmitter and one serializer as receiver.8 I* }5 w1 A! B3 ]; y( E
*/
8 j& @" y5 N. l4 kMcASPSerializerRxSet(SOC_MCASP_0_CTRL_REGS, MCASP_XSER_RX);+ {" m) e8 n6 f2 D. I
McASPSerializerTxSet(SOC_MCASP_0_CTRL_REGS, MCASP_XSER_TX);
/*
+ ^  g! D2 U/ o** Configure the McASP pins 8 a  t9 s1 y8 A) R+ K% D; g; M
** Input - Frame Sync, Clock and Serializer Rx6 M" Z, @3 d0 M1 Y4 S6 Q0 }
** Output - Serializer Tx is connected to the input of the codec
, X8 j- I$ p! X*/
; q  y2 v! Z4 q: z6 A! PMcASPPinMcASPSet(SOC_MCASP_0_CTRL_REGS, 0xFFFFFFFF);$ K2 L; p/ h- e) c
McASPPinDirOutputSet(SOC_MCASP_0_CTRL_REGS,MCASP_PIN_AXR(MCASP_XSER_TX));
- h9 ^# x  x" D; zMcASPPinDirInputSet(SOC_MCASP_0_CTRL_REGS, MCASP_PIN_AFSX
% s0 T0 M: ^9 v| MCASP_PIN_ACLKX
) r$ F& k8 r2 k4 B# Z6 R, e| MCASP_PIN_AHCLKX$ r5 E/ v% l0 V7 x. P
| MCASP_PIN_AXR(MCASP_XSER_RX));
/* Enable error interrupts for McASP */5 M. \$ L! z9 l6 S& ]" Q3 r2 d5 V
McASPTxIntEnable(SOC_MCASP_0_CTRL_REGS, MCASP_TX_DMAERROR
, x5 h+ o% ~7 D| MCASP_TX_CLKFAIL ' x  p; m7 c0 r" Y2 M
| MCASP_TX_SYNCERROR( w3 g/ x6 _9 k0 p5 V/ U+ w
| MCASP_TX_UNDERRUN);
McASPRxIntEnable(SOC_MCASP_0_CTRL_REGS, MCASP_RX_DMAERROR
. x+ b* U$ S0 o6 k# v/ C| MCASP_RX_CLKFAIL- A4 B2 J. |4 C  _+ f! h/ j, U8 S
| MCASP_RX_SYNCERROR " ^2 x3 o$ f$ q8 u! s' ]- f8 _# e
| MCASP_RX_OVERRUN);
. a8 B+ i1 _0 n! c! w}
static void I2SDataTxRxActivate(void)
7 C4 y, d- g( w2 N! B" w{
& Q( ~% k' i3 z/* Start the clocks */
+ n; B/ C  ]% K2 EMcASPRxClkStart(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_EXTERNAL);
( {" t7 Y, a9 `/ r* u1 ?3 t' _- SMcASPTxClkStart(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_INTERNAL);
/* Enable EDMA for the transfer */
4 j2 P9 k: a  i6 ?  p  NEDMA3EnableTransfer(SOC_EDMA30CC_0_REGS, EDMA3_CHA_MCASP0_RX,0 o6 @" I+ X: I! o4 B  s
EDMA3_TRIG_MODE_EVENT);! b) ^$ q9 g5 U& N! X
EDMA3EnableTransfer(SOC_EDMA30CC_0_REGS, ) |* U- n7 r. e% Q$ D% t1 H
EDMA3_CHA_MCASP0_TX, EDMA3_TRIG_MODE_EVENT);
/* Activate the serializers */. ]+ r( q5 ]& k( ^7 Q
McASPRxSerActivate(SOC_MCASP_0_CTRL_REGS);
6 q7 l8 Z9 M$ c; B: B9 G1 M8 d  TMcASPTxSerActivate(SOC_MCASP_0_CTRL_REGS);
/* make sure that the XDATA bit is cleared to zero */
! b0 `5 ?# w& U3 O. N, bwhile(McASPTxStatusGet(SOC_MCASP_0_CTRL_REGS) & MCASP_TX_STAT_DATAREADY);
/* Activate the state machines */
" M2 G* [6 @3 v+ @/ BMcASPRxEnable(SOC_MCASP_0_CTRL_REGS);
' \8 J: m/ i! {  P% q( r4 O# c9 xMcASPTxEnable(SOC_MCASP_0_CTRL_REGS);' j/ D% j7 j( j7 q( }8 M* A$ j
}

5 m0 j" I  z& e. J1 N) m8 k& E& G
请问:问题出在哪了,时钟按照这样配是否有错。
另外我看XDATA一直是0,接收的rxbuf0,1,2里有一般全是FFFF一半全是0.
- L& m: z, b& v" e* ~$ `6 ~7 s
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