MCASP自环配置。 - OMAP-L138 - 嵌入式开发者社区 - 51ele.net
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[未解决] MCASP自环配置。

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发表于 2018-11-7 13:28:07 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
我项目上用OMAPL138的板子MCASP的引脚都是链接的FPGA,所以在FPGA这端设置的MCASP自环。把axr0接收到的通过axr1发回去。
部分代码如下
input mcasp_afsx,; ^/ H( G8 s0 v* V
input mcasp_ahclkx,
$ y+ l, }: ?2 U4 u; d4 ~+ {input mcasp_aclkx,. {3 y, e+ H3 @
input axr0,8 G: @; E+ G% t: f0 ~7 H1 m" O

$ v- G* n: E  G' O. d9 b. K0 Zoutput mcasp_afsr,
% F4 y7 {# G, n" B  x+ poutput mcasp_ahclkr,9 I+ P' g) w+ {: U; t- C( x5 W- I
output mcasp_aclkr,6 C) F" m" ~& f, n$ y  L& `
output axr1,
/ w0 Y6 ?8 a" Z; M
assign mcasp_afsr = mcasp_afsx;
" ?7 H. g9 v4 {; K9 O. Passign mcasp_aclkr = mcasp_aclkx;
) b: [& p2 H9 {( b' D4 _assign mcasp_ahclkr = mcasp_ahclkx;
; N* e  X& B. b" eassign axr1 = axr0;

# D+ h1 z5 D! K4 {
9 G' a% C. N4 F+ g2 D3 E9 z
在OMAPL138这端,通过axr0接口发固定的数,axr1接收。
在配置MACASP的时候,发送全部取内部时钟,接收全部取外部时钟。
一直循环发送,但是接收不到。在FPGA端也没有看到时钟和信号的波形。
部分代码如下,关于edma3的部分未做变化。
! L* ~4 K; ^- ~) T9 c, b2 Q1 P$ K
static void McASPI2SConfigure(void)
* z5 ?1 c6 G$ U6 s' h( v6 ]{5 q  B+ }) Y5 P) `8 l. }& z/ r; C
McASPRxReset(SOC_MCASP_0_CTRL_REGS);
3 k& n5 j! ~% OMcASPTxReset(SOC_MCASP_0_CTRL_REGS);
/* Enable the FIFOs for DMA transfer */) _& u3 x7 w! p
McASPReadFifoEnable(SOC_MCASP_0_FIFO_REGS, 1, 1);
  x. X+ a8 L! B6 C' xMcASPWriteFifoEnable(SOC_MCASP_0_FIFO_REGS, 1, 1);
/* Set I2S format in the transmitter/receiver format units */
& f9 v6 T) I: o5 y0 m; cMcASPRxFmtI2SSet(SOC_MCASP_0_CTRL_REGS, WORD_SIZE, SLOT_SIZE,' Y8 z; O% U  j6 t
MCASP_RX_MODE_DMA);: V0 ~; }+ r1 _$ I" T) j
McASPTxFmtI2SSet(SOC_MCASP_0_CTRL_REGS, WORD_SIZE, SLOT_SIZE,
0 p* o; F9 Q: [+ m1 R# qMCASP_TX_MODE_DMA);
/* Configure the frame sync. I2S shall work in TDM format with 2 slots */
3 P/ O8 ]3 v8 Q( T5 wMcASPRxFrameSyncCfg(SOC_MCASP_0_CTRL_REGS, 2, MCASP_RX_FS_WIDTH_WORD,
) b) U2 k$ S* d1 ^. W; UMCASP_RX_FS_EXT_BEGIN_ON_FALL_EDGE);# r) L% E" n) ]& ^) ]+ I
McASPTxFrameSyncCfg(SOC_MCASP_0_CTRL_REGS, 2, MCASP_TX_FS_WIDTH_WORD, 6 A& {8 ^: D9 }0 c! L  c
MCASP_TX_FS_INT_BEGIN_ON_RIS_EDGE);
/* configure the clock for receiver */: ~& K& n* g) R  W: U
McASPRxClkCfg(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_EXTERNAL, 0, 0);6 F+ w) {. Y8 m0 x$ {4 t
McASPRxClkPolaritySet(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_POL_RIS_EDGE); 1 [' L7 l7 d4 Z+ R
McASPRxClkCheckConfig(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLKCHCK_DIV32,
9 _1 s; }% z, u! V* K2 m4 D6 y0x00, 0xFF);
/* configure the clock for transmitter */' v5 j+ p0 I4 y0 j- d1 ?
McASPTxClkCfg(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_INTERNAL, 11, 1);
9 R8 R; F5 [# @McASPTxClkPolaritySet(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_POL_FALL_EDGE); ; T2 a5 g( J$ d5 c7 n- K
McASPTxClkCheckConfig(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLKCHCK_DIV32,* z9 p) E! ]- S
0x00, 0xFF);
& I- I4 E" g% r# X1 {$ a: T' y4 ]( H# h: S% [
/* Enable synchronization of RX and TX sections */
* \4 O5 n) J: m  wMcASPTxRxClkSyncEnable(SOC_MCASP_0_CTRL_REGS);
/* Enable the transmitter/receiver slots. I2S uses 2 slots */
2 Q! A1 d) E5 y% T2 t* oMcASPRxTimeSlotSet(SOC_MCASP_0_CTRL_REGS, I2S_SLOTS);8 H& v( l& W# W6 l4 D* O- @2 j; K
McASPTxTimeSlotSet(SOC_MCASP_0_CTRL_REGS, I2S_SLOTS);
/*
* L: d% @5 b0 I: [0 s" _/ J** Set the serializers, Currently only one serializer is set as
# F9 S) M* e3 I5 X5 s( y** transmitter and one serializer as receiver.
+ [* L3 u) ^$ j  u2 y*/& x8 ^# K& Z) f- \
McASPSerializerRxSet(SOC_MCASP_0_CTRL_REGS, MCASP_XSER_RX);
4 u, d) j' s6 WMcASPSerializerTxSet(SOC_MCASP_0_CTRL_REGS, MCASP_XSER_TX);
/*1 F8 m) Q2 C* \0 A6 ^6 F* ^) W
** Configure the McASP pins
' \* h& A' T) I! ]4 D** Input - Frame Sync, Clock and Serializer Rx
5 \: n$ z* W) T; ?) x- k** Output - Serializer Tx is connected to the input of the codec ( a; Z) _. I/ l/ T: v
*/$ R; |& t6 W. ]7 R/ ~
McASPPinMcASPSet(SOC_MCASP_0_CTRL_REGS, 0xFFFFFFFF);
' P* S% n7 ]3 |McASPPinDirOutputSet(SOC_MCASP_0_CTRL_REGS,MCASP_PIN_AXR(MCASP_XSER_TX));
, K9 [5 q! H! G& d0 x4 V( j2 ?McASPPinDirInputSet(SOC_MCASP_0_CTRL_REGS, MCASP_PIN_AFSX9 g$ J' M. A7 \9 c+ X/ [; B2 r
| MCASP_PIN_ACLKX
" d+ P& A, c% \/ B  ~| MCASP_PIN_AHCLKX
. i; b9 g6 b. a3 r- D7 Q' m| MCASP_PIN_AXR(MCASP_XSER_RX));
/* Enable error interrupts for McASP */
  Q0 Z( y2 x9 d; H3 d' z2 jMcASPTxIntEnable(SOC_MCASP_0_CTRL_REGS, MCASP_TX_DMAERROR , u& J" a4 J/ W. l
| MCASP_TX_CLKFAIL
3 d. r, x+ n( M" Q) X1 D! Y* y| MCASP_TX_SYNCERROR4 R6 }# b) X6 v( J8 P' S
| MCASP_TX_UNDERRUN);
McASPRxIntEnable(SOC_MCASP_0_CTRL_REGS, MCASP_RX_DMAERROR
$ A0 ?0 n" X4 Y, _7 || MCASP_RX_CLKFAIL' h" {. n  q0 D
| MCASP_RX_SYNCERROR ! G2 E; ?8 V/ S9 R
| MCASP_RX_OVERRUN);6 W- t% h- H( ~& O1 B/ F
}
static void I2SDataTxRxActivate(void), K9 X" }! }2 n; }7 f
{
$ h( r% \) c( {, `1 x7 n/* Start the clocks */
  ^4 e! a: Y) c9 P" jMcASPRxClkStart(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_EXTERNAL);
9 K7 K) R8 B; j* z4 q/ h% ~# dMcASPTxClkStart(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_INTERNAL);
/* Enable EDMA for the transfer */
* d& ?' J# m4 r& J7 J0 D7 aEDMA3EnableTransfer(SOC_EDMA30CC_0_REGS, EDMA3_CHA_MCASP0_RX,
  P: V7 C  @1 E  i0 ^1 HEDMA3_TRIG_MODE_EVENT);7 |# B6 H% H' e) s1 u: @4 g7 ?
EDMA3EnableTransfer(SOC_EDMA30CC_0_REGS,
# d3 N) O( a+ v0 Q/ vEDMA3_CHA_MCASP0_TX, EDMA3_TRIG_MODE_EVENT);
/* Activate the serializers */5 J: \6 h" R8 R( ]) g3 n' ^) t$ k: i
McASPRxSerActivate(SOC_MCASP_0_CTRL_REGS);
: ]+ L% ]5 G( U3 \McASPTxSerActivate(SOC_MCASP_0_CTRL_REGS);
/* make sure that the XDATA bit is cleared to zero */
; {# b0 E1 F9 b7 L6 l' N! \/ w2 P0 M2 Zwhile(McASPTxStatusGet(SOC_MCASP_0_CTRL_REGS) & MCASP_TX_STAT_DATAREADY);
/* Activate the state machines */
) d3 Z* V% @" R2 Q/ lMcASPRxEnable(SOC_MCASP_0_CTRL_REGS);
9 L& t6 e' F% p. }) u8 h! `9 AMcASPTxEnable(SOC_MCASP_0_CTRL_REGS);& T% Y7 k9 P% T. u" @
}

  W4 J" Z: E: j( G; w, W
请问:问题出在哪了,时钟按照这样配是否有错。
另外我看XDATA一直是0,接收的rxbuf0,1,2里有一般全是FFFF一半全是0.
& V( s# ]% M% H6 G
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