MCASP自环配置。 - OMAP-L138 - 嵌入式开发者社区 - 51ele.net
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[未解决] MCASP自环配置。

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发表于 2018-11-7 13:28:07 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
我项目上用OMAPL138的板子MCASP的引脚都是链接的FPGA,所以在FPGA这端设置的MCASP自环。把axr0接收到的通过axr1发回去。
部分代码如下
input mcasp_afsx,' ^. I; B+ g. `# t! r' B& O
input mcasp_ahclkx,
1 C0 N% N. o- S9 minput mcasp_aclkx,
) g% w( d" y  Kinput axr0,9 A% j7 e" s% N6 P

3 g7 h" a' }. T- s4 K; Soutput mcasp_afsr,
: d9 J( \3 L8 b" @' Coutput mcasp_ahclkr,+ g, Z$ x; w+ [9 v3 l0 Y  a
output mcasp_aclkr,
: C3 |+ w8 i" \; f+ routput axr1," u# W; G5 u, M0 t$ Y
assign mcasp_afsr = mcasp_afsx;/ d# S! q! d5 B5 t( p9 d) S7 I
assign mcasp_aclkr = mcasp_aclkx;
% r  l) K" J) X* i: I$ [assign mcasp_ahclkr = mcasp_ahclkx;0 K7 h0 y9 Z8 F$ b1 a& \5 A
assign axr1 = axr0;

, [  ?: }: K7 M7 B* Q7 Z% \9 j" ~! q$ |# {2 J! M
在OMAPL138这端,通过axr0接口发固定的数,axr1接收。
在配置MACASP的时候,发送全部取内部时钟,接收全部取外部时钟。
一直循环发送,但是接收不到。在FPGA端也没有看到时钟和信号的波形。
部分代码如下,关于edma3的部分未做变化。

. j0 Q7 @  }4 i3 P" b4 D% |6 X
static void McASPI2SConfigure(void)4 x! k& O; G1 \3 @- e- J# i2 ?1 B
{: Z1 B  W& K* L, ~
McASPRxReset(SOC_MCASP_0_CTRL_REGS);' q8 Q# v8 M( J
McASPTxReset(SOC_MCASP_0_CTRL_REGS);
/* Enable the FIFOs for DMA transfer */
( L; N# a+ }, W7 HMcASPReadFifoEnable(SOC_MCASP_0_FIFO_REGS, 1, 1);
/ L- S; e7 z( G' S$ NMcASPWriteFifoEnable(SOC_MCASP_0_FIFO_REGS, 1, 1);
/* Set I2S format in the transmitter/receiver format units */; e8 Y. S* A( i
McASPRxFmtI2SSet(SOC_MCASP_0_CTRL_REGS, WORD_SIZE, SLOT_SIZE,  c) T8 z; l; i" {
MCASP_RX_MODE_DMA);5 S' m- M3 L2 @, h
McASPTxFmtI2SSet(SOC_MCASP_0_CTRL_REGS, WORD_SIZE, SLOT_SIZE,
- G/ k* ?% C/ j" k- D, s$ QMCASP_TX_MODE_DMA);
/* Configure the frame sync. I2S shall work in TDM format with 2 slots */: p* }* d1 A, x( \
McASPRxFrameSyncCfg(SOC_MCASP_0_CTRL_REGS, 2, MCASP_RX_FS_WIDTH_WORD,
0 _6 J2 @: T) K3 p9 X' k" u* x+ `MCASP_RX_FS_EXT_BEGIN_ON_FALL_EDGE);$ ]0 F1 r, w8 U' M! f& q
McASPTxFrameSyncCfg(SOC_MCASP_0_CTRL_REGS, 2, MCASP_TX_FS_WIDTH_WORD,
4 j# f8 x+ K* M% r; T( G/ KMCASP_TX_FS_INT_BEGIN_ON_RIS_EDGE);
/* configure the clock for receiver */  P0 L8 ^; J" d+ N( i9 ^
McASPRxClkCfg(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_EXTERNAL, 0, 0);
) i( F2 r! B, ?( Z7 k5 h& a5 MMcASPRxClkPolaritySet(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_POL_RIS_EDGE); # d! D) Q( m0 c  B6 l" O5 e
McASPRxClkCheckConfig(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLKCHCK_DIV32,
) G9 D! ~* ~" a0 g5 I; L0x00, 0xFF);
/* configure the clock for transmitter */# h3 R; e; h1 Y1 Z! m, _2 X/ s
McASPTxClkCfg(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_INTERNAL, 11, 1);. K8 s5 F" F5 p7 V/ m1 a9 S
McASPTxClkPolaritySet(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_POL_FALL_EDGE); 3 P6 A3 K5 y6 h! |0 y
McASPTxClkCheckConfig(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLKCHCK_DIV32,
) {# `" g) z- T) C0x00, 0xFF);* I4 D5 Z# R& |( v) @
$ [. W. U. X( _8 s5 v
/* Enable synchronization of RX and TX sections */ 6 J. H6 L. C. N( w* ~  }0 P! j
McASPTxRxClkSyncEnable(SOC_MCASP_0_CTRL_REGS);
/* Enable the transmitter/receiver slots. I2S uses 2 slots */3 x# O* l. ]# n" p
McASPRxTimeSlotSet(SOC_MCASP_0_CTRL_REGS, I2S_SLOTS);3 q  P' n& N$ G/ E/ D) ^4 h
McASPTxTimeSlotSet(SOC_MCASP_0_CTRL_REGS, I2S_SLOTS);
/*7 M5 _# m$ U  H* h  H
** Set the serializers, Currently only one serializer is set as
: B' b3 M" ]" l+ c9 j+ z** transmitter and one serializer as receiver.
5 ?) ?) P- ~& [! w*/) q+ x) P) }) P! h1 A
McASPSerializerRxSet(SOC_MCASP_0_CTRL_REGS, MCASP_XSER_RX);6 Y, z+ N- O- ]4 z+ K, a
McASPSerializerTxSet(SOC_MCASP_0_CTRL_REGS, MCASP_XSER_TX);
/*
4 M, \7 V  l3 @& t% R2 f7 Q) k** Configure the McASP pins
1 U, D# j2 e5 y( K" M** Input - Frame Sync, Clock and Serializer Rx; \8 a4 Y/ i! }
** Output - Serializer Tx is connected to the input of the codec
& W% w& T) c- S* f9 |*/
& c- |, x6 z  W/ j0 yMcASPPinMcASPSet(SOC_MCASP_0_CTRL_REGS, 0xFFFFFFFF);
* x! W3 G: P4 f$ h2 v9 pMcASPPinDirOutputSet(SOC_MCASP_0_CTRL_REGS,MCASP_PIN_AXR(MCASP_XSER_TX));% g# H8 n' K6 \* ~( H+ z+ V
McASPPinDirInputSet(SOC_MCASP_0_CTRL_REGS, MCASP_PIN_AFSX
2 r! L+ |, p# N| MCASP_PIN_ACLKX* h  K4 d7 v% @% t# t/ d& b. b/ J
| MCASP_PIN_AHCLKX
5 F1 ?2 F! w5 \! _  Z2 `' H| MCASP_PIN_AXR(MCASP_XSER_RX));
/* Enable error interrupts for McASP */& v$ v- G" i9 L3 |
McASPTxIntEnable(SOC_MCASP_0_CTRL_REGS, MCASP_TX_DMAERROR
" \5 T3 t% W" r3 |# t& _# y| MCASP_TX_CLKFAIL
" G2 e- Q+ b% r: e4 M) j1 w| MCASP_TX_SYNCERROR' J; Q" G! B0 M; s
| MCASP_TX_UNDERRUN);
McASPRxIntEnable(SOC_MCASP_0_CTRL_REGS, MCASP_RX_DMAERROR
% y. W4 ?" O/ x| MCASP_RX_CLKFAIL  d( K; N/ J; ^
| MCASP_RX_SYNCERROR
$ C! @& \2 Y( B; S! Y| MCASP_RX_OVERRUN);
& J# F1 ?' ^8 s2 O}
static void I2SDataTxRxActivate(void)* J1 s6 b! q; V7 H
{' Z' k" Z5 L. K8 E3 Z
/* Start the clocks */( j, f# d& V! N+ Z# I" a7 s
McASPRxClkStart(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_EXTERNAL);
( ]4 o) z  @4 ~2 g9 L0 O7 TMcASPTxClkStart(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_INTERNAL);
/* Enable EDMA for the transfer */
) Y) r/ W  H* C! IEDMA3EnableTransfer(SOC_EDMA30CC_0_REGS, EDMA3_CHA_MCASP0_RX,
7 K, K7 ^# E" @EDMA3_TRIG_MODE_EVENT);" {1 L( g3 I" x; ?2 x( I# r
EDMA3EnableTransfer(SOC_EDMA30CC_0_REGS,
" U  T/ R: R3 n, J- G8 ~EDMA3_CHA_MCASP0_TX, EDMA3_TRIG_MODE_EVENT);
/* Activate the serializers */* E6 `$ W( e. A, m0 Z
McASPRxSerActivate(SOC_MCASP_0_CTRL_REGS);$ x& Q/ T9 _  `2 J# p
McASPTxSerActivate(SOC_MCASP_0_CTRL_REGS);
/* make sure that the XDATA bit is cleared to zero */) G) Q  M9 ]) M0 e
while(McASPTxStatusGet(SOC_MCASP_0_CTRL_REGS) & MCASP_TX_STAT_DATAREADY);
/* Activate the state machines *// a: o6 A( _- C+ [% J9 ]& Q. Y# u
McASPRxEnable(SOC_MCASP_0_CTRL_REGS);
* Y" l; |( B- xMcASPTxEnable(SOC_MCASP_0_CTRL_REGS);7 [$ c. V  Z) @5 W
}
: Y3 N& L4 k' K( |7 A$ }
请问:问题出在哪了,时钟按照这样配是否有错。
另外我看XDATA一直是0,接收的rxbuf0,1,2里有一般全是FFFF一半全是0.

# z& \1 m" F) U) M+ A. Z
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