MCASP自环配置。 - OMAP-L138 - 嵌入式开发者社区 - 51ele.net
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[未解决] MCASP自环配置。

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发表于 2018-11-7 13:28:07 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
我项目上用OMAPL138的板子MCASP的引脚都是链接的FPGA,所以在FPGA这端设置的MCASP自环。把axr0接收到的通过axr1发回去。
部分代码如下
input mcasp_afsx,
. J9 `7 d0 ]  \8 x% a+ jinput mcasp_ahclkx,2 X4 Y- I% R3 b6 J  k* }" |% A
input mcasp_aclkx,+ V: P; ^" x' I( S
input axr0,
: F% |& i3 f& H$ l: `. h% _1 X: b9 V1 Y7 O- ]. d
output mcasp_afsr,
6 U9 i2 t. }3 I9 `' k+ y, O3 m% }9 Houtput mcasp_ahclkr,4 V5 v& H4 m, R# d
output mcasp_aclkr,
/ J7 L: I' B) Uoutput axr1,
- [, t. f) ^4 s( \; C, a
assign mcasp_afsr = mcasp_afsx;
$ z( O; o0 V1 M8 L2 F1 b" S6 Q7 [7 sassign mcasp_aclkr = mcasp_aclkx;
/ |# J5 u3 V* d3 N7 a! Dassign mcasp_ahclkr = mcasp_ahclkx;. @+ Z' P; u( p, @) A% b6 b- U# H: P: u
assign axr1 = axr0;

5 \  ]& i9 {  f  t1 @; v8 ~% J9 X
) L) J$ m/ O3 H! [" R
在OMAPL138这端,通过axr0接口发固定的数,axr1接收。
在配置MACASP的时候,发送全部取内部时钟,接收全部取外部时钟。
一直循环发送,但是接收不到。在FPGA端也没有看到时钟和信号的波形。
部分代码如下,关于edma3的部分未做变化。
1 X3 h+ Y- P3 Z. F& W) T$ ^0 N$ e
static void McASPI2SConfigure(void)" C8 |. ~+ f+ P# K; i( ~
{! x/ t. H$ u7 \( J
McASPRxReset(SOC_MCASP_0_CTRL_REGS);
! R# `1 N2 M  Y+ ~. cMcASPTxReset(SOC_MCASP_0_CTRL_REGS);
/* Enable the FIFOs for DMA transfer */
" u* I  l% ~4 B* b- s: A7 y% pMcASPReadFifoEnable(SOC_MCASP_0_FIFO_REGS, 1, 1);
  L: B& W& S! N/ k) s. G/ MMcASPWriteFifoEnable(SOC_MCASP_0_FIFO_REGS, 1, 1);
/* Set I2S format in the transmitter/receiver format units */
5 |- e( w+ b9 q( mMcASPRxFmtI2SSet(SOC_MCASP_0_CTRL_REGS, WORD_SIZE, SLOT_SIZE,  L& ]+ k& \5 d- \+ C
MCASP_RX_MODE_DMA);
$ O- l+ O: X7 T, Y* M  M' @6 z. }McASPTxFmtI2SSet(SOC_MCASP_0_CTRL_REGS, WORD_SIZE, SLOT_SIZE,% K" b* W. s4 }% t( c4 M
MCASP_TX_MODE_DMA);
/* Configure the frame sync. I2S shall work in TDM format with 2 slots */
- X* a$ q" C5 M' O* b4 EMcASPRxFrameSyncCfg(SOC_MCASP_0_CTRL_REGS, 2, MCASP_RX_FS_WIDTH_WORD, $ U7 x( d; g( z3 O' c. g
MCASP_RX_FS_EXT_BEGIN_ON_FALL_EDGE);) Z$ b$ S5 o4 q2 h2 J8 a
McASPTxFrameSyncCfg(SOC_MCASP_0_CTRL_REGS, 2, MCASP_TX_FS_WIDTH_WORD, : H5 m+ i& C+ O2 W+ Z( p
MCASP_TX_FS_INT_BEGIN_ON_RIS_EDGE);
/* configure the clock for receiver */# n* ]5 `5 `: I0 n& d
McASPRxClkCfg(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_EXTERNAL, 0, 0);
* Q. o4 O. h  |0 k  E8 AMcASPRxClkPolaritySet(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_POL_RIS_EDGE); 2 K0 i  }& @) ]% I8 ?
McASPRxClkCheckConfig(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLKCHCK_DIV32,
8 a2 o" D, i4 D" m2 a+ h7 m0x00, 0xFF);
/* configure the clock for transmitter */
+ C8 \$ x  h& S2 l  v* zMcASPTxClkCfg(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_INTERNAL, 11, 1);4 b% U' a( R6 J1 `, h' F
McASPTxClkPolaritySet(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_POL_FALL_EDGE);
9 h: s; V9 v% D& `4 t' ?McASPTxClkCheckConfig(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLKCHCK_DIV32,5 V( G$ v$ J# A; H  {  Z1 ^6 r0 x
0x00, 0xFF);- S0 A& ]' t$ }' F) Q. ~. B

1 _/ y) k" u' Z+ W, S/* Enable synchronization of RX and TX sections */ 5 K' {: Y. N$ P; Y  ^" n
McASPTxRxClkSyncEnable(SOC_MCASP_0_CTRL_REGS);
/* Enable the transmitter/receiver slots. I2S uses 2 slots */
( D9 \6 y% Z; |McASPRxTimeSlotSet(SOC_MCASP_0_CTRL_REGS, I2S_SLOTS);
1 S, E+ ^7 U+ d' L" UMcASPTxTimeSlotSet(SOC_MCASP_0_CTRL_REGS, I2S_SLOTS);
/*
/ k. j6 p5 y% d; A1 d; {4 q. r" M** Set the serializers, Currently only one serializer is set as- C. o7 N% T3 _3 u( ]0 L4 ?' D/ N
** transmitter and one serializer as receiver.
2 o3 x1 E+ Q% J; v, S*/
# I* A7 f$ Y" `+ uMcASPSerializerRxSet(SOC_MCASP_0_CTRL_REGS, MCASP_XSER_RX);1 \# d0 ?% _1 N" V+ z  ?
McASPSerializerTxSet(SOC_MCASP_0_CTRL_REGS, MCASP_XSER_TX);
/*  B$ B$ X, R3 A, Z# a
** Configure the McASP pins 4 y; K1 ~8 m" K
** Input - Frame Sync, Clock and Serializer Rx
% y* O, }* l! @. @9 f** Output - Serializer Tx is connected to the input of the codec
# V0 A8 J  t+ @7 [) m2 h*/
' @8 F0 j; O9 V# Y  M+ N9 tMcASPPinMcASPSet(SOC_MCASP_0_CTRL_REGS, 0xFFFFFFFF);) J: T6 I9 }: |" g
McASPPinDirOutputSet(SOC_MCASP_0_CTRL_REGS,MCASP_PIN_AXR(MCASP_XSER_TX));- `' y9 ^9 F5 }4 V6 B3 s
McASPPinDirInputSet(SOC_MCASP_0_CTRL_REGS, MCASP_PIN_AFSX7 K) E- d' _6 `' w
| MCASP_PIN_ACLKX
# e0 @. v0 @$ }1 z| MCASP_PIN_AHCLKX
* j8 Q  ~% k6 P; W0 D) a| MCASP_PIN_AXR(MCASP_XSER_RX));
/* Enable error interrupts for McASP */
9 f8 I  I/ K/ z5 kMcASPTxIntEnable(SOC_MCASP_0_CTRL_REGS, MCASP_TX_DMAERROR
' c; z. f4 z3 ~, A0 J& l8 P# s| MCASP_TX_CLKFAIL + c6 |6 F' x4 g. g% e
| MCASP_TX_SYNCERROR
. ?- U, m1 W  a% f| MCASP_TX_UNDERRUN);
McASPRxIntEnable(SOC_MCASP_0_CTRL_REGS, MCASP_RX_DMAERROR 5 Z3 x3 C) u* ~# i* S0 `4 _6 X3 L
| MCASP_RX_CLKFAIL
/ B+ w  r2 P  }; d, h| MCASP_RX_SYNCERROR
' C* {9 J: p( t| MCASP_RX_OVERRUN);( m; s9 S* \3 n4 u5 @8 N
}
static void I2SDataTxRxActivate(void)' l/ w; [3 a' u! E( c
{+ n# l9 F% R$ P" w0 [
/* Start the clocks */
$ `9 p! ^9 o7 Z1 W, |: QMcASPRxClkStart(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_EXTERNAL);4 j3 W4 D2 {" [# D$ d: G
McASPTxClkStart(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_INTERNAL);
/* Enable EDMA for the transfer */  M0 r# @5 ~# X4 _9 z$ G, i
EDMA3EnableTransfer(SOC_EDMA30CC_0_REGS, EDMA3_CHA_MCASP0_RX,
' G( q; ~4 V( {- PEDMA3_TRIG_MODE_EVENT);7 E; J% R1 e0 K+ C& P: H. y
EDMA3EnableTransfer(SOC_EDMA30CC_0_REGS,
/ ~, y0 v" |( b& d0 oEDMA3_CHA_MCASP0_TX, EDMA3_TRIG_MODE_EVENT);
/* Activate the serializers */
- W% H! t& q- t; }: Q6 M) rMcASPRxSerActivate(SOC_MCASP_0_CTRL_REGS);
; m/ J. N* m, g/ Q5 mMcASPTxSerActivate(SOC_MCASP_0_CTRL_REGS);
/* make sure that the XDATA bit is cleared to zero */  ~5 _$ S0 v) R' E0 `
while(McASPTxStatusGet(SOC_MCASP_0_CTRL_REGS) & MCASP_TX_STAT_DATAREADY);
/* Activate the state machines */
, Z0 W4 M- V0 G: V- i; r1 ^McASPRxEnable(SOC_MCASP_0_CTRL_REGS);
$ \7 c3 n& w2 x. Y3 W4 y' nMcASPTxEnable(SOC_MCASP_0_CTRL_REGS);2 p( t7 z4 c. W9 P! L+ f
}
3 e: n' h$ `4 _" U+ G+ \
请问:问题出在哪了,时钟按照这样配是否有错。
另外我看XDATA一直是0,接收的rxbuf0,1,2里有一般全是FFFF一半全是0.

- f4 }9 r) e4 d" r
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