MCASP自环配置。 - OMAP-L138 - 嵌入式开发者社区 - 51ele.net
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[未解决] MCASP自环配置。

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发表于 2018-11-7 13:28:07 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
我项目上用OMAPL138的板子MCASP的引脚都是链接的FPGA,所以在FPGA这端设置的MCASP自环。把axr0接收到的通过axr1发回去。
部分代码如下
input mcasp_afsx,, w0 _% W3 O7 ^. l# |* K. C
input mcasp_ahclkx,4 i* E! }3 C2 H! e! A9 Y( {' H
input mcasp_aclkx,' b6 N0 t  T% H4 p& B, H; Q8 i
input axr0,
& [  P% r3 ]- [# w: D& N+ ~* h/ ?3 i, C
output mcasp_afsr,
! ]) x3 k; H  H/ a7 Xoutput mcasp_ahclkr,% j9 `2 f1 Z& S  |( |/ d; n% h; C
output mcasp_aclkr,
2 A  i/ w2 l7 z9 \3 poutput axr1," i2 M' ^& `2 e. E
assign mcasp_afsr = mcasp_afsx;
$ A5 p* X  C( c9 L7 {1 Cassign mcasp_aclkr = mcasp_aclkx;0 n+ `3 @  b# {0 f1 L( {
assign mcasp_ahclkr = mcasp_ahclkx;7 K/ K! d0 E( D7 Y7 j
assign axr1 = axr0;

: C/ J+ x; Q# M4 M+ ~6 K/ U5 [, x4 P% Z9 K
在OMAPL138这端,通过axr0接口发固定的数,axr1接收。
在配置MACASP的时候,发送全部取内部时钟,接收全部取外部时钟。
一直循环发送,但是接收不到。在FPGA端也没有看到时钟和信号的波形。
部分代码如下,关于edma3的部分未做变化。
6 s" S( m! s1 m6 ^4 s8 T/ ^& ?
static void McASPI2SConfigure(void)
8 T0 Z3 O+ c: G+ z; ~{1 F$ D: \% \0 j$ M7 Z) ?6 f9 A8 k
McASPRxReset(SOC_MCASP_0_CTRL_REGS);
: K, l# ?! Q* w. J* j2 KMcASPTxReset(SOC_MCASP_0_CTRL_REGS);
/* Enable the FIFOs for DMA transfer */  m# d* I2 a2 w7 @" X3 L& L! c- m
McASPReadFifoEnable(SOC_MCASP_0_FIFO_REGS, 1, 1);
+ O  r3 ?' y8 n4 t- g" EMcASPWriteFifoEnable(SOC_MCASP_0_FIFO_REGS, 1, 1);
/* Set I2S format in the transmitter/receiver format units */
+ Y, ]1 X* ?  m6 pMcASPRxFmtI2SSet(SOC_MCASP_0_CTRL_REGS, WORD_SIZE, SLOT_SIZE,7 W/ C( l/ o: B* s, n0 d  E" S
MCASP_RX_MODE_DMA);
  f0 y: ~( G; H5 g9 ~# }, x" tMcASPTxFmtI2SSet(SOC_MCASP_0_CTRL_REGS, WORD_SIZE, SLOT_SIZE,$ u  ^9 _5 A: m2 J2 k
MCASP_TX_MODE_DMA);
/* Configure the frame sync. I2S shall work in TDM format with 2 slots */
) _" F! ^8 ^2 A) U# bMcASPRxFrameSyncCfg(SOC_MCASP_0_CTRL_REGS, 2, MCASP_RX_FS_WIDTH_WORD, + ~  S0 u4 A1 O! o( H, w/ H* }
MCASP_RX_FS_EXT_BEGIN_ON_FALL_EDGE);
& v2 \- q+ f% tMcASPTxFrameSyncCfg(SOC_MCASP_0_CTRL_REGS, 2, MCASP_TX_FS_WIDTH_WORD,
, w1 c- D9 W) S% v# e2 q5 |MCASP_TX_FS_INT_BEGIN_ON_RIS_EDGE);
/* configure the clock for receiver */4 N, N* [3 d, u: l+ f
McASPRxClkCfg(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_EXTERNAL, 0, 0);( O  L) g% f* {( J2 a1 ]6 n, p
McASPRxClkPolaritySet(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_POL_RIS_EDGE); 5 [9 L' h2 o. z# V9 }( c
McASPRxClkCheckConfig(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLKCHCK_DIV32,
( H% x% L! Z0 ~+ C2 k0x00, 0xFF);
/* configure the clock for transmitter */
& W% h, m2 ]6 ]- U  N& PMcASPTxClkCfg(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_INTERNAL, 11, 1);
+ T. D3 e$ v1 s! {McASPTxClkPolaritySet(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_POL_FALL_EDGE);
" U' I; J0 k- N, Y, I; i# gMcASPTxClkCheckConfig(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLKCHCK_DIV32,
! i2 X4 Y8 x1 s9 H& H% I4 Y% a0x00, 0xFF);
. {" @- |, o0 u4 n* U& n
; g! X) g6 K8 ]/ u% D& ~/* Enable synchronization of RX and TX sections */ % r9 S% l# C6 O# X: y6 f2 W/ I
McASPTxRxClkSyncEnable(SOC_MCASP_0_CTRL_REGS);
/* Enable the transmitter/receiver slots. I2S uses 2 slots */- X) }) G. |) ?* r
McASPRxTimeSlotSet(SOC_MCASP_0_CTRL_REGS, I2S_SLOTS);  m* A0 ?$ A0 l' P% \* D
McASPTxTimeSlotSet(SOC_MCASP_0_CTRL_REGS, I2S_SLOTS);
/*8 g7 W3 a0 m& F( t  l  N4 m
** Set the serializers, Currently only one serializer is set as' B# r# }$ o- L8 _6 {; t
** transmitter and one serializer as receiver.6 E- Q, L* @" E
*/
: o6 Y0 U/ B1 Y& @! P. bMcASPSerializerRxSet(SOC_MCASP_0_CTRL_REGS, MCASP_XSER_RX);( a- j$ F' C9 M( {
McASPSerializerTxSet(SOC_MCASP_0_CTRL_REGS, MCASP_XSER_TX);
/*
0 S" w7 H; F! r% t0 [( C& [( I** Configure the McASP pins
4 S1 }* L" d+ i' ?& V** Input - Frame Sync, Clock and Serializer Rx
( Y7 Y2 H" V9 I1 |, M+ d& m** Output - Serializer Tx is connected to the input of the codec
6 s1 n0 [: L8 K+ ?( f*/9 F4 f0 T+ I2 m3 i1 p& c% _6 m$ c
McASPPinMcASPSet(SOC_MCASP_0_CTRL_REGS, 0xFFFFFFFF);6 h. y6 |( h" _3 `; I
McASPPinDirOutputSet(SOC_MCASP_0_CTRL_REGS,MCASP_PIN_AXR(MCASP_XSER_TX));
" G5 s$ T' s2 `4 _McASPPinDirInputSet(SOC_MCASP_0_CTRL_REGS, MCASP_PIN_AFSX
% N8 O+ v' f- B' {! b) u| MCASP_PIN_ACLKX
4 p* Q; ?/ E4 v" c/ v% t| MCASP_PIN_AHCLKX
. |& r" Q) D, W' D& O5 g* ?/ I  I& t| MCASP_PIN_AXR(MCASP_XSER_RX));
/* Enable error interrupts for McASP */
9 F2 v+ a4 \4 w, p. e+ p4 xMcASPTxIntEnable(SOC_MCASP_0_CTRL_REGS, MCASP_TX_DMAERROR - E9 C1 G. I/ U$ F- |+ A
| MCASP_TX_CLKFAIL
" O1 e8 Q7 S# S, e' l% m| MCASP_TX_SYNCERROR; c% O+ r$ F  s& j; o) G, p1 B
| MCASP_TX_UNDERRUN);
McASPRxIntEnable(SOC_MCASP_0_CTRL_REGS, MCASP_RX_DMAERROR / v2 l$ I  _( i" F
| MCASP_RX_CLKFAIL6 y; k$ N' F! W$ e" [# X7 Y
| MCASP_RX_SYNCERROR
! f9 J  ^3 K7 R* h% |4 D| MCASP_RX_OVERRUN);
, B7 p3 ?# V7 e, U7 C. S' Y}
static void I2SDataTxRxActivate(void)
, P* B- s' V" _# v6 T{0 G  O: {; R2 d9 d- u7 Z
/* Start the clocks */9 j' x( y1 V+ F+ m' r
McASPRxClkStart(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_EXTERNAL);
3 c% i" [& ~4 T, m, F$ ^  \McASPTxClkStart(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_INTERNAL);
/* Enable EDMA for the transfer */, B6 b9 {: {4 {6 @
EDMA3EnableTransfer(SOC_EDMA30CC_0_REGS, EDMA3_CHA_MCASP0_RX,5 U$ S5 g9 V; ]& d$ Z0 l
EDMA3_TRIG_MODE_EVENT);' l  R7 _1 s* D' P) o9 R
EDMA3EnableTransfer(SOC_EDMA30CC_0_REGS, + V1 x; I3 g# r: [/ ~
EDMA3_CHA_MCASP0_TX, EDMA3_TRIG_MODE_EVENT);
/* Activate the serializers */
7 E+ e+ l( D$ k% J+ p, QMcASPRxSerActivate(SOC_MCASP_0_CTRL_REGS);
# H% l0 @, [6 ^7 p0 j, aMcASPTxSerActivate(SOC_MCASP_0_CTRL_REGS);
/* make sure that the XDATA bit is cleared to zero */
- V. @" o- m9 z% i! M/ Uwhile(McASPTxStatusGet(SOC_MCASP_0_CTRL_REGS) & MCASP_TX_STAT_DATAREADY);
/* Activate the state machines */2 U. l9 x: ^( |' u6 H
McASPRxEnable(SOC_MCASP_0_CTRL_REGS);
/ l, Z0 N+ f1 H' @7 N7 ZMcASPTxEnable(SOC_MCASP_0_CTRL_REGS);, p6 x  m' ^- l% m
}
3 q! n5 s' R: Q1 ]' S. P% X
请问:问题出在哪了,时钟按照这样配是否有错。
另外我看XDATA一直是0,接收的rxbuf0,1,2里有一般全是FFFF一半全是0.

# u) u6 \  i. {. |/ g
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