MCASP自环配置。 - OMAP-L138 - 嵌入式开发者社区 - 51ele.net
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[未解决] MCASP自环配置。

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发表于 2018-11-7 13:28:07 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
我项目上用OMAPL138的板子MCASP的引脚都是链接的FPGA,所以在FPGA这端设置的MCASP自环。把axr0接收到的通过axr1发回去。
部分代码如下
input mcasp_afsx,: \2 W, x9 A3 B" L4 ?/ h8 q. O
input mcasp_ahclkx,
$ ]2 E0 D* l. J. ainput mcasp_aclkx,* m! U% g. c. D3 |
input axr0,: `: ]1 A  Y7 ]- f# |! _

, F/ }3 |1 d* o3 e; n. |' Poutput mcasp_afsr,
/ X8 Q  L7 n* P- Ioutput mcasp_ahclkr," b* {' i* ~/ F- L" j9 a, l
output mcasp_aclkr,
9 Q  t6 b' K; u* u/ E. W4 d. t1 }output axr1,! Y9 l) y8 h, `1 ~) ^& C) D
assign mcasp_afsr = mcasp_afsx;* E& W3 \9 N2 _# Z! R* P
assign mcasp_aclkr = mcasp_aclkx;
0 W% E6 Q8 a; O3 {# oassign mcasp_ahclkr = mcasp_ahclkx;; V; a4 Y) n1 L
assign axr1 = axr0;

1 m/ i& S3 A1 `9 k5 m
9 M% _& ]) g2 ?' x
在OMAPL138这端,通过axr0接口发固定的数,axr1接收。
在配置MACASP的时候,发送全部取内部时钟,接收全部取外部时钟。
一直循环发送,但是接收不到。在FPGA端也没有看到时钟和信号的波形。
部分代码如下,关于edma3的部分未做变化。

( E& r! X$ W, Y5 ~3 o, \
static void McASPI2SConfigure(void)
4 S* w  m! C% v: N/ F- D{) A3 u/ M/ I" f9 \! M- h
McASPRxReset(SOC_MCASP_0_CTRL_REGS);
# w- }* u# b  \5 s( f0 a; \McASPTxReset(SOC_MCASP_0_CTRL_REGS);
/* Enable the FIFOs for DMA transfer */1 S+ u9 _* ^% e% d
McASPReadFifoEnable(SOC_MCASP_0_FIFO_REGS, 1, 1);( w% n0 |/ Z% Y; _1 x; n4 n
McASPWriteFifoEnable(SOC_MCASP_0_FIFO_REGS, 1, 1);
/* Set I2S format in the transmitter/receiver format units */
  s+ T9 H5 O7 Y: u, E/ s: fMcASPRxFmtI2SSet(SOC_MCASP_0_CTRL_REGS, WORD_SIZE, SLOT_SIZE,3 ?- g9 J$ f; H
MCASP_RX_MODE_DMA);3 d/ t' B# m& \$ K
McASPTxFmtI2SSet(SOC_MCASP_0_CTRL_REGS, WORD_SIZE, SLOT_SIZE,  ^. Q) \+ t+ V' c1 u1 ^" T
MCASP_TX_MODE_DMA);
/* Configure the frame sync. I2S shall work in TDM format with 2 slots */
8 T' p! |6 G/ X% u: r4 }McASPRxFrameSyncCfg(SOC_MCASP_0_CTRL_REGS, 2, MCASP_RX_FS_WIDTH_WORD, 7 s0 E, u. ~. F: ~! c3 Y
MCASP_RX_FS_EXT_BEGIN_ON_FALL_EDGE);; s. l: t" w/ N, O3 E
McASPTxFrameSyncCfg(SOC_MCASP_0_CTRL_REGS, 2, MCASP_TX_FS_WIDTH_WORD, 6 Z3 ^# G  ?! Q
MCASP_TX_FS_INT_BEGIN_ON_RIS_EDGE);
/* configure the clock for receiver */
. N; p, m1 f9 z1 x9 E* k% @% ^McASPRxClkCfg(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_EXTERNAL, 0, 0);& `6 j2 T3 w+ j! ?' t+ @; C6 _
McASPRxClkPolaritySet(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_POL_RIS_EDGE); 3 D* F; T6 E7 s
McASPRxClkCheckConfig(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLKCHCK_DIV32,
' J! r2 U9 X4 h( t0 ~0x00, 0xFF);
/* configure the clock for transmitter */! l9 _( \, b, `8 ], Y. S; A
McASPTxClkCfg(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_INTERNAL, 11, 1);" B% X6 M& Q0 O4 C9 z
McASPTxClkPolaritySet(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_POL_FALL_EDGE); 8 j+ H2 P" s7 x) V# e; t0 c/ n5 e* i
McASPTxClkCheckConfig(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLKCHCK_DIV32,
  v, Z2 Y- t) a* F7 {0x00, 0xFF);
& m* r* s. t$ m2 n% t. h: E0 H& p, \6 y
/* Enable synchronization of RX and TX sections */ 7 U1 Q  \* o, u! p6 n% V
McASPTxRxClkSyncEnable(SOC_MCASP_0_CTRL_REGS);
/* Enable the transmitter/receiver slots. I2S uses 2 slots */7 q7 n1 C1 E. v2 J
McASPRxTimeSlotSet(SOC_MCASP_0_CTRL_REGS, I2S_SLOTS);4 D. X+ k* V) ]4 H
McASPTxTimeSlotSet(SOC_MCASP_0_CTRL_REGS, I2S_SLOTS);
/*
* k5 k9 j; ]- L: [  r8 d** Set the serializers, Currently only one serializer is set as
) C3 W6 z7 ], K- @$ o** transmitter and one serializer as receiver.
. r4 n: x5 Z) n  [*/
+ F$ h: J( n! `7 i  o/ t8 NMcASPSerializerRxSet(SOC_MCASP_0_CTRL_REGS, MCASP_XSER_RX);
! y0 ?% f8 L/ ?+ @# PMcASPSerializerTxSet(SOC_MCASP_0_CTRL_REGS, MCASP_XSER_TX);
/*
7 G* X# ~* Z; R0 S2 ~+ J( H** Configure the McASP pins
+ D. V$ Q) j% x5 x6 O** Input - Frame Sync, Clock and Serializer Rx
* Y2 Y% K7 r1 S. n6 a" d6 B** Output - Serializer Tx is connected to the input of the codec 1 X' d0 y0 A( `+ j' u: F$ J- z
*/* r  n$ H8 [4 |
McASPPinMcASPSet(SOC_MCASP_0_CTRL_REGS, 0xFFFFFFFF);4 w& b' Z+ W( V3 V; ^$ G( n( l
McASPPinDirOutputSet(SOC_MCASP_0_CTRL_REGS,MCASP_PIN_AXR(MCASP_XSER_TX));
, B6 V: P& w0 P/ b* KMcASPPinDirInputSet(SOC_MCASP_0_CTRL_REGS, MCASP_PIN_AFSX: @% G- T# w4 L* D/ C
| MCASP_PIN_ACLKX, B1 p) m, y6 F: d
| MCASP_PIN_AHCLKX
0 L( [2 a. p) J& Z| MCASP_PIN_AXR(MCASP_XSER_RX));
/* Enable error interrupts for McASP */
4 k6 m& s, [  n$ h$ p! ]0 MMcASPTxIntEnable(SOC_MCASP_0_CTRL_REGS, MCASP_TX_DMAERROR
( N- t" [, n( i1 v# j3 t| MCASP_TX_CLKFAIL 2 u; Z: y/ c6 ^
| MCASP_TX_SYNCERROR% C, x: C1 t7 U
| MCASP_TX_UNDERRUN);
McASPRxIntEnable(SOC_MCASP_0_CTRL_REGS, MCASP_RX_DMAERROR * Y4 q" c/ j# w1 H3 u
| MCASP_RX_CLKFAIL' m9 Y! n' \: z, v0 H
| MCASP_RX_SYNCERROR
* x- Q+ v. c5 Q' u8 E% Y: D| MCASP_RX_OVERRUN);
" A) |' Y" b6 `4 @}
static void I2SDataTxRxActivate(void)/ `' R* X$ x0 P, F
{
' q! T6 D) R+ Q' T2 f- o/* Start the clocks */; v& g0 F+ v6 v9 Q; @
McASPRxClkStart(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_EXTERNAL);% }$ w! Q2 s$ a7 k+ r( J, }) M; I
McASPTxClkStart(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_INTERNAL);
/* Enable EDMA for the transfer */) s4 C9 ?9 N5 X% U5 U% C  Q
EDMA3EnableTransfer(SOC_EDMA30CC_0_REGS, EDMA3_CHA_MCASP0_RX,
' }/ J, i$ s8 q7 |EDMA3_TRIG_MODE_EVENT);
" y( h, b& n3 H( Q1 L, ^" SEDMA3EnableTransfer(SOC_EDMA30CC_0_REGS, . a& A2 l  g9 f; Y- ^7 o3 o
EDMA3_CHA_MCASP0_TX, EDMA3_TRIG_MODE_EVENT);
/* Activate the serializers */7 z( l! e% ^! N+ z: S& H& S( u8 V$ s
McASPRxSerActivate(SOC_MCASP_0_CTRL_REGS);
+ z/ d" E/ p0 o8 OMcASPTxSerActivate(SOC_MCASP_0_CTRL_REGS);
/* make sure that the XDATA bit is cleared to zero */# k% D$ N1 O+ b) b( }
while(McASPTxStatusGet(SOC_MCASP_0_CTRL_REGS) & MCASP_TX_STAT_DATAREADY);
/* Activate the state machines */
# i, }5 f5 N. S6 z: G0 {McASPRxEnable(SOC_MCASP_0_CTRL_REGS);
+ c: ]/ b; Q5 O6 V) zMcASPTxEnable(SOC_MCASP_0_CTRL_REGS);
& Z8 J; K; l3 B! \4 _% u}
9 S8 R) W" d3 a+ Y- c
请问:问题出在哪了,时钟按照这样配是否有错。
另外我看XDATA一直是0,接收的rxbuf0,1,2里有一般全是FFFF一半全是0.

' c- f1 o: D0 Z: G0 R0 H' ^
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