MCASP自环配置。 - OMAP-L138 - 嵌入式开发者社区 - 51ele.net
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[未解决] MCASP自环配置。

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发表于 2018-11-7 13:28:07 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
我项目上用OMAPL138的板子MCASP的引脚都是链接的FPGA,所以在FPGA这端设置的MCASP自环。把axr0接收到的通过axr1发回去。
部分代码如下
input mcasp_afsx,
8 Y# ]8 Y1 w. w% J( M( B6 _, g8 tinput mcasp_ahclkx,
4 w5 N, O% _, z6 k2 H$ einput mcasp_aclkx,! `/ t: ?7 \# {7 x
input axr0,$ p* d& I9 [3 }

1 k3 T# d( m/ B, O0 }output mcasp_afsr,
; G4 D7 `) ^& u5 {output mcasp_ahclkr,& O9 @$ J$ O, Q% g. A
output mcasp_aclkr,, @$ t3 S0 }6 ]1 x- g
output axr1,
% ?2 U& p2 ?& C- x. |. s
assign mcasp_afsr = mcasp_afsx;0 D( `8 F% h. H' C
assign mcasp_aclkr = mcasp_aclkx;
8 p9 M& l( h$ yassign mcasp_ahclkr = mcasp_ahclkx;5 F( q* d- i) B. H. F
assign axr1 = axr0;
2 {* p- D7 M; p9 H

1 J- L1 y# R( _1 W4 K
在OMAPL138这端,通过axr0接口发固定的数,axr1接收。
在配置MACASP的时候,发送全部取内部时钟,接收全部取外部时钟。
一直循环发送,但是接收不到。在FPGA端也没有看到时钟和信号的波形。
部分代码如下,关于edma3的部分未做变化。
+ u6 q; l9 z& k
static void McASPI2SConfigure(void)
  d5 O% t( N' |( O1 U: q{& V: B  [  x8 [0 T: l( C6 W# o& b/ [: c
McASPRxReset(SOC_MCASP_0_CTRL_REGS);
( h* S0 X; n2 W/ r) R7 n/ KMcASPTxReset(SOC_MCASP_0_CTRL_REGS);
/* Enable the FIFOs for DMA transfer */( z8 m9 L7 v) ^* f+ f3 d
McASPReadFifoEnable(SOC_MCASP_0_FIFO_REGS, 1, 1);
4 e6 q4 c/ V2 Y" wMcASPWriteFifoEnable(SOC_MCASP_0_FIFO_REGS, 1, 1);
/* Set I2S format in the transmitter/receiver format units */! M# I' ~( d& R: @
McASPRxFmtI2SSet(SOC_MCASP_0_CTRL_REGS, WORD_SIZE, SLOT_SIZE,* u' V6 T: L4 O! K3 V9 ?
MCASP_RX_MODE_DMA);: ?$ I: o  S* h+ Q
McASPTxFmtI2SSet(SOC_MCASP_0_CTRL_REGS, WORD_SIZE, SLOT_SIZE,7 o  k, k3 m* g) d, x6 y8 M
MCASP_TX_MODE_DMA);
/* Configure the frame sync. I2S shall work in TDM format with 2 slots */
/ `; |) K9 w% r& M% m+ LMcASPRxFrameSyncCfg(SOC_MCASP_0_CTRL_REGS, 2, MCASP_RX_FS_WIDTH_WORD, ) E+ p4 U. I& }* d
MCASP_RX_FS_EXT_BEGIN_ON_FALL_EDGE);' h1 Z; T) G$ O* T# U2 U# x
McASPTxFrameSyncCfg(SOC_MCASP_0_CTRL_REGS, 2, MCASP_TX_FS_WIDTH_WORD,
) l9 i: x# [8 P, R2 l9 ?MCASP_TX_FS_INT_BEGIN_ON_RIS_EDGE);
/* configure the clock for receiver */2 w! A% K; @7 v$ I0 f
McASPRxClkCfg(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_EXTERNAL, 0, 0);- ?- l+ U: L+ v
McASPRxClkPolaritySet(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_POL_RIS_EDGE);
$ @3 a$ f' G: ^McASPRxClkCheckConfig(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLKCHCK_DIV32,7 A6 Y* S4 w  \2 T; D# O& T$ W- z
0x00, 0xFF);
/* configure the clock for transmitter */6 K& A5 R/ }4 s. i5 Z& v% U
McASPTxClkCfg(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_INTERNAL, 11, 1);
5 J4 E6 h" m% e5 ^( hMcASPTxClkPolaritySet(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_POL_FALL_EDGE);
5 {# k* G) H- m) _- j% AMcASPTxClkCheckConfig(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLKCHCK_DIV32,
1 ^- f! V# O& a* ^; l0x00, 0xFF);1 K; w, T8 V- A/ Z9 U  o0 Y. B
$ x' d; s1 l) T" J2 [. z
/* Enable synchronization of RX and TX sections */ + f  c' u: M3 {' }8 D
McASPTxRxClkSyncEnable(SOC_MCASP_0_CTRL_REGS);
/* Enable the transmitter/receiver slots. I2S uses 2 slots */# m" D/ M! k. a$ h& c1 @: l6 W( b; C
McASPRxTimeSlotSet(SOC_MCASP_0_CTRL_REGS, I2S_SLOTS);
, g' }- e/ X# }, q5 D8 B( {9 ?0 uMcASPTxTimeSlotSet(SOC_MCASP_0_CTRL_REGS, I2S_SLOTS);
/*& H' u4 @$ w: t4 ~# x. Y
** Set the serializers, Currently only one serializer is set as: h# d' l, S$ s$ B
** transmitter and one serializer as receiver.1 e9 Q& T8 X; {" w7 Y' J* f% i
*/8 ^) L+ {8 T! k" m, d6 n
McASPSerializerRxSet(SOC_MCASP_0_CTRL_REGS, MCASP_XSER_RX);
, M/ T8 s3 w9 y9 n1 P$ O- J% ZMcASPSerializerTxSet(SOC_MCASP_0_CTRL_REGS, MCASP_XSER_TX);
/*
5 K3 p1 X) W1 p& l4 S  `0 `1 E** Configure the McASP pins
6 m7 W  O/ _$ }5 n** Input - Frame Sync, Clock and Serializer Rx  o  Y) b) V( ~; i* Z
** Output - Serializer Tx is connected to the input of the codec $ i& H. y( G0 Y: \' c
*/
4 p% G9 C/ Q. ?/ `5 X9 xMcASPPinMcASPSet(SOC_MCASP_0_CTRL_REGS, 0xFFFFFFFF);
8 T/ e6 V$ S" \9 h6 dMcASPPinDirOutputSet(SOC_MCASP_0_CTRL_REGS,MCASP_PIN_AXR(MCASP_XSER_TX));  W" C, {# o" n- v' t, ]
McASPPinDirInputSet(SOC_MCASP_0_CTRL_REGS, MCASP_PIN_AFSX! h1 r5 `/ y( t8 @
| MCASP_PIN_ACLKX
9 A0 d( }, C! w- ^! O& ]9 k, N0 n; ~, U| MCASP_PIN_AHCLKX& N+ Z% {" l4 [$ g) v" ^
| MCASP_PIN_AXR(MCASP_XSER_RX));
/* Enable error interrupts for McASP */- j. d2 n' y- p5 y- r
McASPTxIntEnable(SOC_MCASP_0_CTRL_REGS, MCASP_TX_DMAERROR - ~6 E6 k& x/ {
| MCASP_TX_CLKFAIL 8 i( U! W8 h7 r7 A) D7 f% r; C
| MCASP_TX_SYNCERROR1 G4 Z* Y  H5 e8 r9 O0 }* F7 c
| MCASP_TX_UNDERRUN);
McASPRxIntEnable(SOC_MCASP_0_CTRL_REGS, MCASP_RX_DMAERROR ( G7 n& q% e" H
| MCASP_RX_CLKFAIL% c# c) }7 S, M% E
| MCASP_RX_SYNCERROR
8 D9 P- y  Q1 j| MCASP_RX_OVERRUN);
) X, a8 Q- a2 x& U+ e9 |}
static void I2SDataTxRxActivate(void)
" F7 ?& h$ v" A' Z: r6 u6 n{% K& m# m  c2 Z. j
/* Start the clocks */; E! O8 t* W0 K0 n7 [' G  k
McASPRxClkStart(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_EXTERNAL);
% U9 F. H. j% I# j& p: PMcASPTxClkStart(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_INTERNAL);
/* Enable EDMA for the transfer */4 K& R3 _+ w( x( R  @
EDMA3EnableTransfer(SOC_EDMA30CC_0_REGS, EDMA3_CHA_MCASP0_RX,
: A0 ]+ }7 o" e* c$ R! M1 @EDMA3_TRIG_MODE_EVENT);
, r' Y6 p$ c7 p9 u) EEDMA3EnableTransfer(SOC_EDMA30CC_0_REGS,   T- `/ ]$ `3 f% ^8 s: Z. o2 R/ Y- T
EDMA3_CHA_MCASP0_TX, EDMA3_TRIG_MODE_EVENT);
/* Activate the serializers */
; Z# ^- ^, i) ?! M  o- s3 ?McASPRxSerActivate(SOC_MCASP_0_CTRL_REGS);. n+ O; `0 }0 q2 m6 ^" M
McASPTxSerActivate(SOC_MCASP_0_CTRL_REGS);
/* make sure that the XDATA bit is cleared to zero */
  o5 B7 f6 s" y9 R% x/ D1 I6 O! Qwhile(McASPTxStatusGet(SOC_MCASP_0_CTRL_REGS) & MCASP_TX_STAT_DATAREADY);
/* Activate the state machines */9 \" B; S8 V# t; G
McASPRxEnable(SOC_MCASP_0_CTRL_REGS);. C% p' T$ T+ b' R3 f; H, G
McASPTxEnable(SOC_MCASP_0_CTRL_REGS);$ n8 q* i. N: \5 M2 J. P: Z$ G
}
! ?. K5 c( h0 m5 d* K
请问:问题出在哪了,时钟按照这样配是否有错。
另外我看XDATA一直是0,接收的rxbuf0,1,2里有一般全是FFFF一半全是0.

. C5 ~% e+ ?# N3 A. p
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