MCASP自环配置。 - OMAP-L138 - 嵌入式开发者社区 - 51ele.net
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[未解决] MCASP自环配置。

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发表于 2018-11-7 13:28:07 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
我项目上用OMAPL138的板子MCASP的引脚都是链接的FPGA,所以在FPGA这端设置的MCASP自环。把axr0接收到的通过axr1发回去。
部分代码如下
input mcasp_afsx,9 R* Y0 Z- A0 @( C
input mcasp_ahclkx,
3 p! i5 I+ I" u  }; |input mcasp_aclkx,8 `, V* i: k9 i1 W* L0 u. U7 N
input axr0,& K' x9 _3 Q) R: s- n& c

1 I# J. L! m- e( V0 s0 e2 P+ O% coutput mcasp_afsr,  C& P+ U2 ^$ V1 }9 P4 L
output mcasp_ahclkr,% O8 b- p  i1 p) n  P- H5 k
output mcasp_aclkr,
. o& ~* p& l! woutput axr1,8 l/ F6 T. s- N( V/ u
assign mcasp_afsr = mcasp_afsx;# ^! X* ^3 X- Z: F2 [! i
assign mcasp_aclkr = mcasp_aclkx;: v2 f7 \, [. z/ s- F
assign mcasp_ahclkr = mcasp_ahclkx;* u1 _. J0 F+ [
assign axr1 = axr0;
  \+ C& R* x  f- M% {" @% j
3 ~: E6 Y8 a+ Y0 F
在OMAPL138这端,通过axr0接口发固定的数,axr1接收。
在配置MACASP的时候,发送全部取内部时钟,接收全部取外部时钟。
一直循环发送,但是接收不到。在FPGA端也没有看到时钟和信号的波形。
部分代码如下,关于edma3的部分未做变化。
/ d. F% o5 n! b  J
static void McASPI2SConfigure(void)
/ E& u4 ^4 A& ?. Z{
; i) E! Q. p- m# q% z! N. BMcASPRxReset(SOC_MCASP_0_CTRL_REGS);& T7 S. a2 I, q1 H, T) F0 ^
McASPTxReset(SOC_MCASP_0_CTRL_REGS);
/* Enable the FIFOs for DMA transfer */
) ^! K! i* H# y1 y% l; g: U& ^McASPReadFifoEnable(SOC_MCASP_0_FIFO_REGS, 1, 1);
; e* F8 W- n. q$ C0 B9 qMcASPWriteFifoEnable(SOC_MCASP_0_FIFO_REGS, 1, 1);
/* Set I2S format in the transmitter/receiver format units */
8 |; k3 q2 W# f2 C1 ]8 z: SMcASPRxFmtI2SSet(SOC_MCASP_0_CTRL_REGS, WORD_SIZE, SLOT_SIZE,
# ?$ A. R: Q. Y/ V1 Q6 kMCASP_RX_MODE_DMA);
0 }: ?, x' x& @4 g: |McASPTxFmtI2SSet(SOC_MCASP_0_CTRL_REGS, WORD_SIZE, SLOT_SIZE,
, ~$ |8 M) ]5 o/ H3 g0 U) GMCASP_TX_MODE_DMA);
/* Configure the frame sync. I2S shall work in TDM format with 2 slots */
! q4 A, F! G: {3 Y! BMcASPRxFrameSyncCfg(SOC_MCASP_0_CTRL_REGS, 2, MCASP_RX_FS_WIDTH_WORD, 8 ~: _( h/ E8 [) C
MCASP_RX_FS_EXT_BEGIN_ON_FALL_EDGE);
0 U6 E2 d& _" I# ]McASPTxFrameSyncCfg(SOC_MCASP_0_CTRL_REGS, 2, MCASP_TX_FS_WIDTH_WORD, 9 v' _5 a) p% c* M( P0 i9 u. J
MCASP_TX_FS_INT_BEGIN_ON_RIS_EDGE);
/* configure the clock for receiver */$ p, `2 G* _9 J% G( ]' o
McASPRxClkCfg(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_EXTERNAL, 0, 0);2 E& ^3 H/ e/ i7 N* V; A; P
McASPRxClkPolaritySet(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_POL_RIS_EDGE); 8 {/ R$ X* q' t+ ]4 |
McASPRxClkCheckConfig(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLKCHCK_DIV32,/ P! W, I. k  ?* f
0x00, 0xFF);
/* configure the clock for transmitter */+ d+ K* o, f6 _* {3 {6 g3 o
McASPTxClkCfg(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_INTERNAL, 11, 1);3 k& g  C! }& O: i
McASPTxClkPolaritySet(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_POL_FALL_EDGE);
# G# w+ b9 J  iMcASPTxClkCheckConfig(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLKCHCK_DIV32," n' g8 h' n& E2 i5 b- O* |
0x00, 0xFF);
# Z! D0 Q/ o' ?1 a3 b8 p% @
2 {" L/ M/ r4 o( [- D2 ~$ ^/* Enable synchronization of RX and TX sections */ . a  c; v) q& R* o& Z& K
McASPTxRxClkSyncEnable(SOC_MCASP_0_CTRL_REGS);
/* Enable the transmitter/receiver slots. I2S uses 2 slots */& K7 d% j8 Q5 N- t
McASPRxTimeSlotSet(SOC_MCASP_0_CTRL_REGS, I2S_SLOTS);3 h  L* |& N6 x' S5 f
McASPTxTimeSlotSet(SOC_MCASP_0_CTRL_REGS, I2S_SLOTS);
/*
6 R9 m: h" o( L- I% f** Set the serializers, Currently only one serializer is set as; b- C! r; z5 _2 c* Q1 N
** transmitter and one serializer as receiver.
8 A0 w$ Q; ]& ^*/( T: n! b8 X; X; Z
McASPSerializerRxSet(SOC_MCASP_0_CTRL_REGS, MCASP_XSER_RX);
) W& }2 }% |9 F/ F3 ^/ ]( `McASPSerializerTxSet(SOC_MCASP_0_CTRL_REGS, MCASP_XSER_TX);
/*( z8 n) i8 U6 o: {3 S$ v# p0 @
** Configure the McASP pins
0 O- |% Y0 B% R, {- ]** Input - Frame Sync, Clock and Serializer Rx7 I5 V* z# ]- N" b) q! D
** Output - Serializer Tx is connected to the input of the codec . @$ J% g+ [' C6 d
*/" d4 \) o, Z, W9 s% `  V( w: w
McASPPinMcASPSet(SOC_MCASP_0_CTRL_REGS, 0xFFFFFFFF);
& V0 ?8 _: ]1 d( L0 h$ ?( U' W  fMcASPPinDirOutputSet(SOC_MCASP_0_CTRL_REGS,MCASP_PIN_AXR(MCASP_XSER_TX));
: H- @3 ~  A# L( V. fMcASPPinDirInputSet(SOC_MCASP_0_CTRL_REGS, MCASP_PIN_AFSX6 @6 O- ]8 a% T( p1 U" @( d
| MCASP_PIN_ACLKX
; E" R/ E& \, L" @$ V( S5 d, Q| MCASP_PIN_AHCLKX' C! j4 S8 K4 v# s) F# _
| MCASP_PIN_AXR(MCASP_XSER_RX));
/* Enable error interrupts for McASP */" E% t9 _8 z0 n; R5 D: l2 W$ j7 U
McASPTxIntEnable(SOC_MCASP_0_CTRL_REGS, MCASP_TX_DMAERROR
6 W4 I1 J; j9 G. \/ o: E| MCASP_TX_CLKFAIL $ Y7 }) ^* }- f0 N0 R! i4 @
| MCASP_TX_SYNCERROR
8 G. G/ q4 {8 ~' `7 H8 G1 ~$ w4 ^  @. _0 I| MCASP_TX_UNDERRUN);
McASPRxIntEnable(SOC_MCASP_0_CTRL_REGS, MCASP_RX_DMAERROR
+ M- X' O  |/ J" ]| MCASP_RX_CLKFAIL
: o( M! n1 F- d' N9 Y| MCASP_RX_SYNCERROR
, l) s. B& Z. o4 b| MCASP_RX_OVERRUN);
" m6 g. Z" A% @/ b  V+ P; t}
static void I2SDataTxRxActivate(void)
2 l. K6 q- ]* O{! C% U! L( _5 r& L2 I7 V& F% p. {
/* Start the clocks */( D' p' ?  q$ j; w* a* Q& [6 h
McASPRxClkStart(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_EXTERNAL);
" c& G4 V( c5 M& \5 F, UMcASPTxClkStart(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_INTERNAL);
/* Enable EDMA for the transfer *// h! c+ D8 c4 G+ Q6 D" O3 C9 L7 N+ c
EDMA3EnableTransfer(SOC_EDMA30CC_0_REGS, EDMA3_CHA_MCASP0_RX,
0 e# e% A3 k) Y8 G9 s. e! l. s! {6 V% MEDMA3_TRIG_MODE_EVENT);
; M9 U( ^. ]  v0 u' [EDMA3EnableTransfer(SOC_EDMA30CC_0_REGS,
- U$ k8 ]% Q/ Z  B* Q; Z- ~- S, R4 gEDMA3_CHA_MCASP0_TX, EDMA3_TRIG_MODE_EVENT);
/* Activate the serializers */
0 ^+ R# ~% Y% x" F( y; g  iMcASPRxSerActivate(SOC_MCASP_0_CTRL_REGS);! p' `# w1 q7 H$ v  M3 F- L
McASPTxSerActivate(SOC_MCASP_0_CTRL_REGS);
/* make sure that the XDATA bit is cleared to zero */
7 q5 w+ S5 t9 K  ]3 R; Zwhile(McASPTxStatusGet(SOC_MCASP_0_CTRL_REGS) & MCASP_TX_STAT_DATAREADY);
/* Activate the state machines */
. q, q, h; m2 I& F! T$ O8 I( UMcASPRxEnable(SOC_MCASP_0_CTRL_REGS);
/ X! Q5 |6 I  [McASPTxEnable(SOC_MCASP_0_CTRL_REGS);2 w8 `: T; W0 I4 j8 c! H
}

4 Y  m; I' J4 Y' r* g+ n
请问:问题出在哪了,时钟按照这样配是否有错。
另外我看XDATA一直是0,接收的rxbuf0,1,2里有一般全是FFFF一半全是0.
* Q* X8 y5 s0 c$ u, y
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