MCASP自环配置。 - OMAP-L138 - 嵌入式开发者社区 - 51ele.net
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[未解决] MCASP自环配置。

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发表于 2018-11-7 13:28:07 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
我项目上用OMAPL138的板子MCASP的引脚都是链接的FPGA,所以在FPGA这端设置的MCASP自环。把axr0接收到的通过axr1发回去。
部分代码如下
input mcasp_afsx,
' _% G0 W; w, b7 C& q2 t' {, Einput mcasp_ahclkx,7 i/ r" I! y# |
input mcasp_aclkx,1 N# {0 y* g# M: r
input axr0,
: v8 i# t! ?1 [* R+ f1 U# ~
# _, H3 M! }0 ?# n* |! ]: loutput mcasp_afsr,
- Y* s2 Z8 _  N9 t! I7 U+ r: x* Toutput mcasp_ahclkr,
/ b8 [4 W' {3 w& L) a( p! M+ @6 aoutput mcasp_aclkr,
2 a! y# l' S; ~6 toutput axr1,  y" V4 Y+ Q4 D% }: s& h8 H- o
assign mcasp_afsr = mcasp_afsx;
& @) i& g3 h8 p( }9 v, Qassign mcasp_aclkr = mcasp_aclkx;
' G5 ]* F5 H1 m" p  t( ~& r' j5 X3 Wassign mcasp_ahclkr = mcasp_ahclkx;
' C( v2 k( s7 Bassign axr1 = axr0;

" [. v% ?+ d2 \! J
& ]( v- c1 _7 a: q% @
在OMAPL138这端,通过axr0接口发固定的数,axr1接收。
在配置MACASP的时候,发送全部取内部时钟,接收全部取外部时钟。
一直循环发送,但是接收不到。在FPGA端也没有看到时钟和信号的波形。
部分代码如下,关于edma3的部分未做变化。
6 U9 I# O8 l7 _- l3 k! [
static void McASPI2SConfigure(void)3 c8 q, C4 B9 m1 K
{
, [+ O& ~# Z% V! c8 U6 bMcASPRxReset(SOC_MCASP_0_CTRL_REGS);' \4 s$ c. H$ Y# s3 p* b3 u
McASPTxReset(SOC_MCASP_0_CTRL_REGS);
/* Enable the FIFOs for DMA transfer */
5 ^' J0 F/ W6 i  d9 IMcASPReadFifoEnable(SOC_MCASP_0_FIFO_REGS, 1, 1);
7 M/ `7 G( w! x0 h2 KMcASPWriteFifoEnable(SOC_MCASP_0_FIFO_REGS, 1, 1);
/* Set I2S format in the transmitter/receiver format units */
' j3 ]5 m3 Q: Z3 }* O) G: A2 h# hMcASPRxFmtI2SSet(SOC_MCASP_0_CTRL_REGS, WORD_SIZE, SLOT_SIZE,$ `9 }' e; s: ?( m, f+ y( t" c( M
MCASP_RX_MODE_DMA);* T- l) u7 T) D7 U0 l/ j
McASPTxFmtI2SSet(SOC_MCASP_0_CTRL_REGS, WORD_SIZE, SLOT_SIZE,
) s( ?1 f5 s* \/ k" y. OMCASP_TX_MODE_DMA);
/* Configure the frame sync. I2S shall work in TDM format with 2 slots */1 w6 _/ s) n0 D8 U/ w7 {
McASPRxFrameSyncCfg(SOC_MCASP_0_CTRL_REGS, 2, MCASP_RX_FS_WIDTH_WORD,
- }% v1 Q# Y8 R* F& j* k: @- m" QMCASP_RX_FS_EXT_BEGIN_ON_FALL_EDGE);
6 V9 ^3 R/ I( E: m6 h, o, z3 P& NMcASPTxFrameSyncCfg(SOC_MCASP_0_CTRL_REGS, 2, MCASP_TX_FS_WIDTH_WORD, 4 S3 H' I+ x( M5 @% ]: |# {
MCASP_TX_FS_INT_BEGIN_ON_RIS_EDGE);
/* configure the clock for receiver */9 }$ {7 z# ?, ]( z2 W) a  A
McASPRxClkCfg(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_EXTERNAL, 0, 0);
2 s# p3 h5 i8 PMcASPRxClkPolaritySet(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_POL_RIS_EDGE); ; _1 y. P% Z& _2 h
McASPRxClkCheckConfig(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLKCHCK_DIV32,
8 |3 f4 f- ]6 u* z0x00, 0xFF);
/* configure the clock for transmitter *// ?: c( R7 @( B3 w
McASPTxClkCfg(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_INTERNAL, 11, 1);8 c& J8 P: i/ ^! n4 r4 V
McASPTxClkPolaritySet(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_POL_FALL_EDGE); / y3 r: ~) G* D/ U$ ]5 @; p+ y
McASPTxClkCheckConfig(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLKCHCK_DIV32,
4 Y! R) t# c/ Y- Q! u0x00, 0xFF);" P9 M, J  _5 R& C  i
: V% N$ R; Y+ T3 W9 y
/* Enable synchronization of RX and TX sections */ ( `" M' \* }7 c# i- \+ d
McASPTxRxClkSyncEnable(SOC_MCASP_0_CTRL_REGS);
/* Enable the transmitter/receiver slots. I2S uses 2 slots */1 C' S! t9 V/ d; d( ]6 V
McASPRxTimeSlotSet(SOC_MCASP_0_CTRL_REGS, I2S_SLOTS);
* u& P# R* r' i9 DMcASPTxTimeSlotSet(SOC_MCASP_0_CTRL_REGS, I2S_SLOTS);
/*) V- I, X/ i. J# H$ t
** Set the serializers, Currently only one serializer is set as
) @/ G& G8 j4 o% M$ s2 q, s** transmitter and one serializer as receiver.
+ e5 H* q) n5 r/ J) T1 ]0 x) L*/3 w7 [7 S* ], y4 D) l+ y
McASPSerializerRxSet(SOC_MCASP_0_CTRL_REGS, MCASP_XSER_RX);
% @% c; s( h) B" c$ CMcASPSerializerTxSet(SOC_MCASP_0_CTRL_REGS, MCASP_XSER_TX);
/*  k$ h  R* C/ B/ c2 b  F& n
** Configure the McASP pins
2 Z$ L2 G3 ?2 ]1 V! W** Input - Frame Sync, Clock and Serializer Rx( I- R0 p* o# d" s0 p: `" O! B1 \) |
** Output - Serializer Tx is connected to the input of the codec . q+ `8 }7 i- P' v/ z3 O( G3 [! p
*/6 h. K5 g5 S# Q% F9 V
McASPPinMcASPSet(SOC_MCASP_0_CTRL_REGS, 0xFFFFFFFF);7 N1 k0 U9 M) u% f# S4 y
McASPPinDirOutputSet(SOC_MCASP_0_CTRL_REGS,MCASP_PIN_AXR(MCASP_XSER_TX));: G. ?" L/ E' B
McASPPinDirInputSet(SOC_MCASP_0_CTRL_REGS, MCASP_PIN_AFSX% @+ J4 A$ ?. @' y, n
| MCASP_PIN_ACLKX- @+ ^; `3 f' _9 |0 U1 |# T' D8 J
| MCASP_PIN_AHCLKX
3 W* ]+ ]5 z0 }| MCASP_PIN_AXR(MCASP_XSER_RX));
/* Enable error interrupts for McASP */$ U' c, K* C- J% i% d
McASPTxIntEnable(SOC_MCASP_0_CTRL_REGS, MCASP_TX_DMAERROR # j. S5 h. \7 H
| MCASP_TX_CLKFAIL ! u- l/ s0 U: [  U
| MCASP_TX_SYNCERROR4 Q' A+ h6 I3 j. v: Y3 x2 N8 `; W
| MCASP_TX_UNDERRUN);
McASPRxIntEnable(SOC_MCASP_0_CTRL_REGS, MCASP_RX_DMAERROR
( \  Y! l4 F6 d$ u| MCASP_RX_CLKFAIL& H2 l, ~- e; B. M4 `- v
| MCASP_RX_SYNCERROR % a. S: n  }4 q2 q( Y
| MCASP_RX_OVERRUN);
; H4 {, W: j6 J3 T" _( \}
static void I2SDataTxRxActivate(void)- a/ m! P: `7 Y
{! A+ h9 m' h9 G  O$ w
/* Start the clocks */: G9 x! @0 K0 K5 ?% ?, e+ F. l
McASPRxClkStart(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_EXTERNAL);
. L! R# M, }2 W5 \3 QMcASPTxClkStart(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_INTERNAL);
/* Enable EDMA for the transfer */
' I0 W- F/ ^- X2 s6 ^5 s  `  K- @EDMA3EnableTransfer(SOC_EDMA30CC_0_REGS, EDMA3_CHA_MCASP0_RX,
3 S' j; R7 f# K2 U; Q/ y6 NEDMA3_TRIG_MODE_EVENT);; H- j2 ]0 I) S+ P
EDMA3EnableTransfer(SOC_EDMA30CC_0_REGS, ) o6 R6 u2 J6 ^: @) s
EDMA3_CHA_MCASP0_TX, EDMA3_TRIG_MODE_EVENT);
/* Activate the serializers */
. x% H1 W& G, Y2 U7 n) U1 O9 j) K) uMcASPRxSerActivate(SOC_MCASP_0_CTRL_REGS);
" _3 b9 K9 [5 _McASPTxSerActivate(SOC_MCASP_0_CTRL_REGS);
/* make sure that the XDATA bit is cleared to zero */
1 L% {: }5 B& O1 ^. Qwhile(McASPTxStatusGet(SOC_MCASP_0_CTRL_REGS) & MCASP_TX_STAT_DATAREADY);
/* Activate the state machines */; ?6 h$ C" g" E2 G2 b
McASPRxEnable(SOC_MCASP_0_CTRL_REGS);: R, j& @  a5 p/ B
McASPTxEnable(SOC_MCASP_0_CTRL_REGS);& }9 f) o3 K5 m
}

/ ^# t; t+ W9 M0 `0 X$ T( B' w
请问:问题出在哪了,时钟按照这样配是否有错。
另外我看XDATA一直是0,接收的rxbuf0,1,2里有一般全是FFFF一半全是0.

0 w1 U8 }1 L0 q2 x' _  t& b
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