MCASP自环配置。 - OMAP-L138 - 嵌入式开发者社区 - 51ele.net
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[未解决] MCASP自环配置。

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发表于 2018-11-7 13:28:07 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
我项目上用OMAPL138的板子MCASP的引脚都是链接的FPGA,所以在FPGA这端设置的MCASP自环。把axr0接收到的通过axr1发回去。
部分代码如下
input mcasp_afsx," [0 z4 K4 ~$ B* J* c, p% k
input mcasp_ahclkx,8 @. w$ Z* p5 ^# [! Y( a3 k
input mcasp_aclkx," k7 I) Z) h! I) P
input axr0,& y% K' ^& G( `1 h' D+ x

$ B% Z) }8 l1 d) H  }output mcasp_afsr,0 _7 s3 b) z; W2 Y0 T* d2 ]- m
output mcasp_ahclkr,( b% e' F, X: P$ ?! ]# a( L
output mcasp_aclkr,
7 [$ g! ]% t3 w+ Joutput axr1,( ?2 @8 s( y( ]2 A
assign mcasp_afsr = mcasp_afsx;
! g1 x) b5 d- l. r. R- L6 oassign mcasp_aclkr = mcasp_aclkx;
9 P1 a- x5 a# n' f1 Eassign mcasp_ahclkr = mcasp_ahclkx;
4 p: B; Y) U) r- M: o/ Vassign axr1 = axr0;

( ?* O; D' f2 y. W' \* n+ Y! d5 C) h( U4 Q1 w
在OMAPL138这端,通过axr0接口发固定的数,axr1接收。
在配置MACASP的时候,发送全部取内部时钟,接收全部取外部时钟。
一直循环发送,但是接收不到。在FPGA端也没有看到时钟和信号的波形。
部分代码如下,关于edma3的部分未做变化。
/ w, Y- N' `3 B6 P$ J
static void McASPI2SConfigure(void)
+ W1 h% K% \0 E/ l8 t9 ?{9 G: E+ a$ ?  _; M
McASPRxReset(SOC_MCASP_0_CTRL_REGS);
% Z( h' z0 z9 C7 A" [0 C4 Y6 ^McASPTxReset(SOC_MCASP_0_CTRL_REGS);
/* Enable the FIFOs for DMA transfer */
' d; {  n% V* W, j7 I- rMcASPReadFifoEnable(SOC_MCASP_0_FIFO_REGS, 1, 1);
2 M" Z5 n2 h9 n) ?McASPWriteFifoEnable(SOC_MCASP_0_FIFO_REGS, 1, 1);
/* Set I2S format in the transmitter/receiver format units */; M- X: L0 A+ `1 t/ _. p0 ~
McASPRxFmtI2SSet(SOC_MCASP_0_CTRL_REGS, WORD_SIZE, SLOT_SIZE,- O' \3 d- w: o$ k3 Z/ x! T
MCASP_RX_MODE_DMA);
" |' R) Y& @8 j' F6 jMcASPTxFmtI2SSet(SOC_MCASP_0_CTRL_REGS, WORD_SIZE, SLOT_SIZE,7 M- }" {7 A6 E
MCASP_TX_MODE_DMA);
/* Configure the frame sync. I2S shall work in TDM format with 2 slots */; `8 [  e# ]/ A: I6 K
McASPRxFrameSyncCfg(SOC_MCASP_0_CTRL_REGS, 2, MCASP_RX_FS_WIDTH_WORD,
) J: X' M4 x) m: j0 ?MCASP_RX_FS_EXT_BEGIN_ON_FALL_EDGE);, A/ v3 A- C, }9 K
McASPTxFrameSyncCfg(SOC_MCASP_0_CTRL_REGS, 2, MCASP_TX_FS_WIDTH_WORD, ' ?8 }! e* o3 F3 P
MCASP_TX_FS_INT_BEGIN_ON_RIS_EDGE);
/* configure the clock for receiver */  t" K/ G+ k2 I, e' ^
McASPRxClkCfg(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_EXTERNAL, 0, 0);+ j1 p4 T+ o5 B3 o& @# l3 [
McASPRxClkPolaritySet(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_POL_RIS_EDGE);
+ {' X# D3 z' {McASPRxClkCheckConfig(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLKCHCK_DIV32,
- L6 i, t5 m6 }7 L' }4 v( ]' a8 |0x00, 0xFF);
/* configure the clock for transmitter */8 c. C7 Y; J" [. P* ^
McASPTxClkCfg(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_INTERNAL, 11, 1);  W& r0 g& e$ P- N& l
McASPTxClkPolaritySet(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_POL_FALL_EDGE); ! h' ?0 O& g* @2 r
McASPTxClkCheckConfig(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLKCHCK_DIV32,
; Y9 |! Q% K" y0x00, 0xFF);4 B: U( ^( C( U! L+ r2 R
! ^" p/ G  q( B4 i8 c4 m
/* Enable synchronization of RX and TX sections */ 0 [) p. j8 X( g4 R
McASPTxRxClkSyncEnable(SOC_MCASP_0_CTRL_REGS);
/* Enable the transmitter/receiver slots. I2S uses 2 slots */, L3 z  o* W# Y
McASPRxTimeSlotSet(SOC_MCASP_0_CTRL_REGS, I2S_SLOTS);
: E1 ^5 q3 F7 g1 r6 ], mMcASPTxTimeSlotSet(SOC_MCASP_0_CTRL_REGS, I2S_SLOTS);
/*' P# f* t5 p' K
** Set the serializers, Currently only one serializer is set as2 ?5 Z" a1 o0 B, s( V3 T. ?6 Q
** transmitter and one serializer as receiver.4 u- W0 I0 ~. Q' T8 h
*/
8 R* \/ ^) d# a& g6 uMcASPSerializerRxSet(SOC_MCASP_0_CTRL_REGS, MCASP_XSER_RX);5 d3 l, m! ~2 \6 B9 V6 h
McASPSerializerTxSet(SOC_MCASP_0_CTRL_REGS, MCASP_XSER_TX);
/*
0 P6 D6 Q! j! @* Z** Configure the McASP pins % W- q- \# J! L
** Input - Frame Sync, Clock and Serializer Rx" ^( k! b# I1 j6 w% q; D: Z; j' v
** Output - Serializer Tx is connected to the input of the codec   T4 B* o3 T: h0 d1 e/ Q7 n" g
*/( i2 z. F8 l& f* _
McASPPinMcASPSet(SOC_MCASP_0_CTRL_REGS, 0xFFFFFFFF);4 {- f1 j( F2 G8 r  l- Y7 P
McASPPinDirOutputSet(SOC_MCASP_0_CTRL_REGS,MCASP_PIN_AXR(MCASP_XSER_TX));
6 b' Y7 H- ?$ t. |, U7 ~McASPPinDirInputSet(SOC_MCASP_0_CTRL_REGS, MCASP_PIN_AFSX: s6 p* p( @1 T' |& ^! g! b. b
| MCASP_PIN_ACLKX
" y3 H1 b1 F% `& |6 H| MCASP_PIN_AHCLKX
- e6 q# G& \' M$ Z| MCASP_PIN_AXR(MCASP_XSER_RX));
/* Enable error interrupts for McASP */
# W2 V3 p: J% S% ^" yMcASPTxIntEnable(SOC_MCASP_0_CTRL_REGS, MCASP_TX_DMAERROR ! w% s' T/ [: w5 k8 U* \4 F
| MCASP_TX_CLKFAIL / R1 W# p9 d7 W/ i8 a5 w4 E
| MCASP_TX_SYNCERROR
( b2 f' T% O7 e. L2 v# L| MCASP_TX_UNDERRUN);
McASPRxIntEnable(SOC_MCASP_0_CTRL_REGS, MCASP_RX_DMAERROR $ U% ~- [7 C9 q6 l* B# |$ R
| MCASP_RX_CLKFAIL) Q$ r  v& K  i$ E/ y1 }% V
| MCASP_RX_SYNCERROR ! q2 I( X$ z( v% ?7 C/ q. E1 r' M
| MCASP_RX_OVERRUN);
7 ~0 M9 X) Z* Q9 ]- h}
static void I2SDataTxRxActivate(void)0 `" o( ^' x. r8 d- y" q% v  _6 Z9 ]- g! J
{+ i6 g* K8 K/ T2 J+ V" Y7 F
/* Start the clocks */, q  V& S9 G4 ]5 U
McASPRxClkStart(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_EXTERNAL);+ K. G9 N7 y( X, E3 {
McASPTxClkStart(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_INTERNAL);
/* Enable EDMA for the transfer */
/ m. A* N  X+ ~* d* x4 oEDMA3EnableTransfer(SOC_EDMA30CC_0_REGS, EDMA3_CHA_MCASP0_RX,
: ?8 d+ f! @/ C- K! KEDMA3_TRIG_MODE_EVENT);0 q! I6 R" ?7 E& X* [; R
EDMA3EnableTransfer(SOC_EDMA30CC_0_REGS, / s( b! l% X6 b
EDMA3_CHA_MCASP0_TX, EDMA3_TRIG_MODE_EVENT);
/* Activate the serializers */, q9 u+ h) i8 w6 H) k) d5 y
McASPRxSerActivate(SOC_MCASP_0_CTRL_REGS);
% [3 a4 ?; I; J$ q5 o3 gMcASPTxSerActivate(SOC_MCASP_0_CTRL_REGS);
/* make sure that the XDATA bit is cleared to zero */
( A: ]& S( F# j) e9 n6 Xwhile(McASPTxStatusGet(SOC_MCASP_0_CTRL_REGS) & MCASP_TX_STAT_DATAREADY);
/* Activate the state machines */
+ ~( C1 D. p1 D0 JMcASPRxEnable(SOC_MCASP_0_CTRL_REGS);
, Z: i9 H% F1 |1 W: R3 dMcASPTxEnable(SOC_MCASP_0_CTRL_REGS);
+ y/ g( g7 ~& p* B" N: ?- D. V}

: N! G2 J9 y: i# L; R2 X& ]1 ~
请问:问题出在哪了,时钟按照这样配是否有错。
另外我看XDATA一直是0,接收的rxbuf0,1,2里有一般全是FFFF一半全是0.

2 _2 i- r7 u$ b2 d
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