MCASP自环配置。 - OMAP-L138 - 嵌入式开发者社区 - 51ele.net
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[未解决] MCASP自环配置。

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发表于 2018-11-7 13:28:07 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
我项目上用OMAPL138的板子MCASP的引脚都是链接的FPGA,所以在FPGA这端设置的MCASP自环。把axr0接收到的通过axr1发回去。
部分代码如下
input mcasp_afsx,; y$ E' c, a" L8 b! [
input mcasp_ahclkx,) w3 E* y/ }" A$ b
input mcasp_aclkx,7 H! q+ d) ?; d+ ]: S! `+ g1 ~
input axr0,% N8 P5 O9 B+ K4 ^, M, U. [* N) K
4 u; {1 D# E: L: [2 R+ c$ }5 Q8 q
output mcasp_afsr,
% T0 l, q% [/ ]! b* houtput mcasp_ahclkr,
8 Y/ z  m& [( p6 E5 X7 [output mcasp_aclkr,
. M3 g- G! k; j, u( S- Doutput axr1,
7 I: ^5 u  I. \. R, t% `" z
assign mcasp_afsr = mcasp_afsx;% M% l# E5 J  n9 n7 o% Y2 x
assign mcasp_aclkr = mcasp_aclkx;( Q% Y, k& g! a2 N
assign mcasp_ahclkr = mcasp_ahclkx;
- j8 N" t8 P3 @7 h$ B4 wassign axr1 = axr0;
9 e1 v7 t( Z* l4 h! g( S2 N

: I  d- v# F  P4 [8 F
在OMAPL138这端,通过axr0接口发固定的数,axr1接收。
在配置MACASP的时候,发送全部取内部时钟,接收全部取外部时钟。
一直循环发送,但是接收不到。在FPGA端也没有看到时钟和信号的波形。
部分代码如下,关于edma3的部分未做变化。
$ q7 e& P6 S7 `) M3 a+ \+ T. V
static void McASPI2SConfigure(void)
; x% N+ R( \7 i$ R6 \9 |{- K& W( K7 c% n7 D
McASPRxReset(SOC_MCASP_0_CTRL_REGS);
- j4 j) M( |) }! a- YMcASPTxReset(SOC_MCASP_0_CTRL_REGS);
/* Enable the FIFOs for DMA transfer */
( t) Z4 Y, P( _' kMcASPReadFifoEnable(SOC_MCASP_0_FIFO_REGS, 1, 1);! Z2 h( T5 N- I3 X
McASPWriteFifoEnable(SOC_MCASP_0_FIFO_REGS, 1, 1);
/* Set I2S format in the transmitter/receiver format units */$ C5 x* K" i( V, {
McASPRxFmtI2SSet(SOC_MCASP_0_CTRL_REGS, WORD_SIZE, SLOT_SIZE,
0 F/ |# d, R$ W$ [* cMCASP_RX_MODE_DMA);
2 U1 R% V  ^: r% P) bMcASPTxFmtI2SSet(SOC_MCASP_0_CTRL_REGS, WORD_SIZE, SLOT_SIZE,
' M/ b4 M' \: z+ b, A1 mMCASP_TX_MODE_DMA);
/* Configure the frame sync. I2S shall work in TDM format with 2 slots */
7 u' {2 T0 J6 R6 F& {0 tMcASPRxFrameSyncCfg(SOC_MCASP_0_CTRL_REGS, 2, MCASP_RX_FS_WIDTH_WORD, $ \3 h& K: X9 F8 o
MCASP_RX_FS_EXT_BEGIN_ON_FALL_EDGE);. u6 e, n/ |% q* h
McASPTxFrameSyncCfg(SOC_MCASP_0_CTRL_REGS, 2, MCASP_TX_FS_WIDTH_WORD, ( ^, F  b& w; C4 X9 r" I
MCASP_TX_FS_INT_BEGIN_ON_RIS_EDGE);
/* configure the clock for receiver */4 \2 [, ^/ i' |# L/ J
McASPRxClkCfg(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_EXTERNAL, 0, 0);
9 |) B+ k7 v% U, nMcASPRxClkPolaritySet(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_POL_RIS_EDGE);
% _  _; y* i, tMcASPRxClkCheckConfig(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLKCHCK_DIV32,! M5 Z  H# n2 I: D6 g
0x00, 0xFF);
/* configure the clock for transmitter */8 A: ^* H) @0 F, R+ L3 q! f
McASPTxClkCfg(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_INTERNAL, 11, 1);
: \! g7 X; O9 k3 t" rMcASPTxClkPolaritySet(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_POL_FALL_EDGE); 2 e+ u' a* B. x2 L4 G
McASPTxClkCheckConfig(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLKCHCK_DIV32,
1 r+ G5 q* k0 n* U0x00, 0xFF);" c, ?$ G; A3 l, s% y
' H1 H" z, w1 W6 y# \* ^# W
/* Enable synchronization of RX and TX sections */ # b6 |4 p2 O" X. y3 l8 K! I
McASPTxRxClkSyncEnable(SOC_MCASP_0_CTRL_REGS);
/* Enable the transmitter/receiver slots. I2S uses 2 slots */6 G2 s" }' e" i2 m
McASPRxTimeSlotSet(SOC_MCASP_0_CTRL_REGS, I2S_SLOTS);6 n# J5 }, R0 G9 L- a; b. e
McASPTxTimeSlotSet(SOC_MCASP_0_CTRL_REGS, I2S_SLOTS);
/*
. [* n5 G5 l( [% i** Set the serializers, Currently only one serializer is set as  M) z! l. E% G
** transmitter and one serializer as receiver.. _9 B' C) n- W) J6 q) B
*/0 W( Y, Y# t' B
McASPSerializerRxSet(SOC_MCASP_0_CTRL_REGS, MCASP_XSER_RX);
( ]( u: K7 W8 E' k8 lMcASPSerializerTxSet(SOC_MCASP_0_CTRL_REGS, MCASP_XSER_TX);
/*
& ^$ N7 w/ ^* A2 U/ n# H  D3 s4 z8 q** Configure the McASP pins
3 j5 c) B/ H9 k* n** Input - Frame Sync, Clock and Serializer Rx  y. c/ q  X- K+ |
** Output - Serializer Tx is connected to the input of the codec
2 H$ F% D% k  p* }, [: G* T*/
, _  X' t+ E- J% r; x9 _- y) xMcASPPinMcASPSet(SOC_MCASP_0_CTRL_REGS, 0xFFFFFFFF);/ D' s' C6 X1 P1 m' `- }
McASPPinDirOutputSet(SOC_MCASP_0_CTRL_REGS,MCASP_PIN_AXR(MCASP_XSER_TX));( Z5 I: Y1 e6 K2 _- Q* g
McASPPinDirInputSet(SOC_MCASP_0_CTRL_REGS, MCASP_PIN_AFSX
2 M" H  u, d1 Z) Z| MCASP_PIN_ACLKX
) k8 m9 P& z* z: e( ~1 H| MCASP_PIN_AHCLKX8 f) X) a* i/ Z/ y
| MCASP_PIN_AXR(MCASP_XSER_RX));
/* Enable error interrupts for McASP */
- x$ _, q! U' ^) T8 j' |1 @McASPTxIntEnable(SOC_MCASP_0_CTRL_REGS, MCASP_TX_DMAERROR # f5 k, k! N3 d! P+ c
| MCASP_TX_CLKFAIL / o, T4 }2 ?. j* ^& y# J
| MCASP_TX_SYNCERROR
  n+ K, h0 P% G" o) G| MCASP_TX_UNDERRUN);
McASPRxIntEnable(SOC_MCASP_0_CTRL_REGS, MCASP_RX_DMAERROR
: V8 _/ d, Y+ o1 @/ m: m| MCASP_RX_CLKFAIL
) B. q: b8 H$ F: O7 z2 w| MCASP_RX_SYNCERROR 0 o$ Q7 x; ^2 i2 H% c
| MCASP_RX_OVERRUN);9 E5 A0 [0 l' z1 f% p! D9 X$ M
}
static void I2SDataTxRxActivate(void)
! M7 q2 p# m. s6 f: u7 C{) [, B3 M5 K4 @
/* Start the clocks */
0 e: J0 e5 [, z" ^1 zMcASPRxClkStart(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_EXTERNAL);' w2 I7 {0 V& D7 w6 L3 U
McASPTxClkStart(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_INTERNAL);
/* Enable EDMA for the transfer */. a( _  a& }" f% H
EDMA3EnableTransfer(SOC_EDMA30CC_0_REGS, EDMA3_CHA_MCASP0_RX,& z2 E, L# A% e0 a8 T; y
EDMA3_TRIG_MODE_EVENT);7 k7 A* C9 ?+ J/ s
EDMA3EnableTransfer(SOC_EDMA30CC_0_REGS, - H+ ~1 Z) u) G- z+ ^
EDMA3_CHA_MCASP0_TX, EDMA3_TRIG_MODE_EVENT);
/* Activate the serializers */
, U! N) i6 v4 I1 lMcASPRxSerActivate(SOC_MCASP_0_CTRL_REGS);' {& I7 ^! k* ]) a. K6 p. P4 k
McASPTxSerActivate(SOC_MCASP_0_CTRL_REGS);
/* make sure that the XDATA bit is cleared to zero */
) S; [& a# b8 N# S! iwhile(McASPTxStatusGet(SOC_MCASP_0_CTRL_REGS) & MCASP_TX_STAT_DATAREADY);
/* Activate the state machines */9 V* g" c( ?2 f7 e: R
McASPRxEnable(SOC_MCASP_0_CTRL_REGS);& a8 k( x; S. _1 p* @' T
McASPTxEnable(SOC_MCASP_0_CTRL_REGS);' ?" p( o! C' {; a
}
9 x1 e4 n: d) P7 q/ P
请问:问题出在哪了,时钟按照这样配是否有错。
另外我看XDATA一直是0,接收的rxbuf0,1,2里有一般全是FFFF一半全是0.

' Q& x6 M) u4 |' x" T" X% k- Y) l7 W1 T
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