MCASP自环配置。 - OMAP-L138 - 嵌入式开发者社区 - 51ele.net
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[未解决] MCASP自环配置。

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发表于 2018-11-7 13:28:07 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
我项目上用OMAPL138的板子MCASP的引脚都是链接的FPGA,所以在FPGA这端设置的MCASP自环。把axr0接收到的通过axr1发回去。
部分代码如下
input mcasp_afsx,
) Y. s8 U5 D* S4 Qinput mcasp_ahclkx,6 ]1 z4 p) Y3 U+ `# b
input mcasp_aclkx,
/ A. R; e5 O5 A( d# |' vinput axr0,
( k* g) z7 E* ]$ Q" w; a6 ]
0 p( [/ n' L3 ^6 N# E5 M8 xoutput mcasp_afsr,: q5 z6 e7 R* m6 T' C: M
output mcasp_ahclkr,
9 D8 G/ [  J9 e; A& k* W$ `0 |output mcasp_aclkr,
& T# s8 h+ i' M3 G9 Noutput axr1,4 n8 w' Z8 v% |7 G% c) W
assign mcasp_afsr = mcasp_afsx;& P+ W# d7 t8 M) I9 Y* r* i
assign mcasp_aclkr = mcasp_aclkx;) e7 l, f' L0 f
assign mcasp_ahclkr = mcasp_ahclkx;
2 r1 g# a4 a. }4 K0 L  M, Q6 Xassign axr1 = axr0;
7 j3 o9 Q- e/ W! O4 r$ v

" F4 S, k% N; ~1 R: T
在OMAPL138这端,通过axr0接口发固定的数,axr1接收。
在配置MACASP的时候,发送全部取内部时钟,接收全部取外部时钟。
一直循环发送,但是接收不到。在FPGA端也没有看到时钟和信号的波形。
部分代码如下,关于edma3的部分未做变化。
) G5 r( b5 p7 S
static void McASPI2SConfigure(void), L" F, w" ?. @' V5 h, t, q  @! C
{5 Y1 E+ g# q7 o: p
McASPRxReset(SOC_MCASP_0_CTRL_REGS);
) ?. |* S3 e5 J/ d* ZMcASPTxReset(SOC_MCASP_0_CTRL_REGS);
/* Enable the FIFOs for DMA transfer */
, i7 W' k5 R' @McASPReadFifoEnable(SOC_MCASP_0_FIFO_REGS, 1, 1);4 k4 ^1 \( M( b) z: F3 F0 U9 ?
McASPWriteFifoEnable(SOC_MCASP_0_FIFO_REGS, 1, 1);
/* Set I2S format in the transmitter/receiver format units */# T9 h! y, X; g4 e8 O+ T7 v8 z
McASPRxFmtI2SSet(SOC_MCASP_0_CTRL_REGS, WORD_SIZE, SLOT_SIZE,
4 ~. d3 r/ n- FMCASP_RX_MODE_DMA);2 u6 v  l- o1 f6 S
McASPTxFmtI2SSet(SOC_MCASP_0_CTRL_REGS, WORD_SIZE, SLOT_SIZE,9 \! o8 w$ ~& ~! v- c% o/ k1 K
MCASP_TX_MODE_DMA);
/* Configure the frame sync. I2S shall work in TDM format with 2 slots */
. y" C2 F7 W/ B: ]McASPRxFrameSyncCfg(SOC_MCASP_0_CTRL_REGS, 2, MCASP_RX_FS_WIDTH_WORD,
2 b; w) r* d1 nMCASP_RX_FS_EXT_BEGIN_ON_FALL_EDGE);/ b/ _1 u4 {' `4 V
McASPTxFrameSyncCfg(SOC_MCASP_0_CTRL_REGS, 2, MCASP_TX_FS_WIDTH_WORD,
! O. [  ~" [, T7 g! O) c! qMCASP_TX_FS_INT_BEGIN_ON_RIS_EDGE);
/* configure the clock for receiver */
! G4 [4 I; I( ?1 k- E1 l" ?McASPRxClkCfg(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_EXTERNAL, 0, 0);  y, k8 ^2 N5 f8 l. g6 p% l
McASPRxClkPolaritySet(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_POL_RIS_EDGE); . ~/ T9 O( [5 b
McASPRxClkCheckConfig(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLKCHCK_DIV32,8 @) K: U4 `5 c# m4 x+ }% ]
0x00, 0xFF);
/* configure the clock for transmitter */5 N1 I1 ?. P2 G1 @; `9 l' H7 n- k
McASPTxClkCfg(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_INTERNAL, 11, 1);
# f# }' ^; J4 f0 I- U; @McASPTxClkPolaritySet(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_POL_FALL_EDGE);
1 q5 C* E6 N! t- y9 PMcASPTxClkCheckConfig(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLKCHCK_DIV32,6 o# J5 w7 A) w- ~# P6 l
0x00, 0xFF);0 X5 Y0 `% D8 B; {* z
7 n7 a! ~! p9 H8 w
/* Enable synchronization of RX and TX sections */
1 T6 ^: _& {& r" `8 T  OMcASPTxRxClkSyncEnable(SOC_MCASP_0_CTRL_REGS);
/* Enable the transmitter/receiver slots. I2S uses 2 slots */
" D0 R8 K! Z2 w; |McASPRxTimeSlotSet(SOC_MCASP_0_CTRL_REGS, I2S_SLOTS);
5 Z+ U4 x- \0 \/ @$ R5 BMcASPTxTimeSlotSet(SOC_MCASP_0_CTRL_REGS, I2S_SLOTS);
/*
: R  M( M2 B9 U* D, [6 q** Set the serializers, Currently only one serializer is set as
" z. y9 D/ ^# v" L2 K1 T3 y5 _** transmitter and one serializer as receiver.! b- V, B( X0 k" I6 O
*/
( X& j* Q0 h; ^) w. zMcASPSerializerRxSet(SOC_MCASP_0_CTRL_REGS, MCASP_XSER_RX);1 E/ F6 R$ g7 d) X
McASPSerializerTxSet(SOC_MCASP_0_CTRL_REGS, MCASP_XSER_TX);
/*5 |) b% m& t: s
** Configure the McASP pins 1 T. X4 J: w1 i6 {" R/ J" K8 f! c
** Input - Frame Sync, Clock and Serializer Rx
7 p: S: f: I( `; s** Output - Serializer Tx is connected to the input of the codec
+ [9 M4 `) n& G*/
! k5 R1 C7 E4 j3 GMcASPPinMcASPSet(SOC_MCASP_0_CTRL_REGS, 0xFFFFFFFF);
* x2 B6 v+ k. m5 X! ]) yMcASPPinDirOutputSet(SOC_MCASP_0_CTRL_REGS,MCASP_PIN_AXR(MCASP_XSER_TX));
0 }* R6 G7 E: SMcASPPinDirInputSet(SOC_MCASP_0_CTRL_REGS, MCASP_PIN_AFSX0 P- L! l5 G) J2 |( Z) z* D
| MCASP_PIN_ACLKX" G( \$ q/ D% n5 Q8 K
| MCASP_PIN_AHCLKX% @3 y( k) e5 c: I* `5 d
| MCASP_PIN_AXR(MCASP_XSER_RX));
/* Enable error interrupts for McASP */( B& F9 a+ X9 l4 Y0 n! V5 a& `
McASPTxIntEnable(SOC_MCASP_0_CTRL_REGS, MCASP_TX_DMAERROR $ |* {1 d( W& e( x" W, r3 e+ i
| MCASP_TX_CLKFAIL & H+ f7 \& ?2 i8 C' n1 R5 i
| MCASP_TX_SYNCERROR" @; O' P; G5 E: s! |2 J8 t
| MCASP_TX_UNDERRUN);
McASPRxIntEnable(SOC_MCASP_0_CTRL_REGS, MCASP_RX_DMAERROR , A5 c0 k( R: _/ H8 D5 u5 G2 C
| MCASP_RX_CLKFAIL
7 c+ w( I3 \3 `2 }1 K1 H| MCASP_RX_SYNCERROR
2 Y7 p' @$ M5 H, @1 n| MCASP_RX_OVERRUN);! M9 [) I$ J- f" J
}
static void I2SDataTxRxActivate(void)
& q% X! @- ^, X2 Y' y2 H8 D{
# [" w" W1 {- K3 r2 i7 D, Q/* Start the clocks */, R, N8 B) J# Q7 H/ ^  o
McASPRxClkStart(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_EXTERNAL);
9 u" Y2 A" `" A" qMcASPTxClkStart(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_INTERNAL);
/* Enable EDMA for the transfer */
1 W7 J" _+ G7 x. W3 R8 OEDMA3EnableTransfer(SOC_EDMA30CC_0_REGS, EDMA3_CHA_MCASP0_RX,, x1 T9 I3 C& L7 G) K7 V$ \
EDMA3_TRIG_MODE_EVENT);
$ y8 P. o4 J8 cEDMA3EnableTransfer(SOC_EDMA30CC_0_REGS, % t& q7 @; ^* ^' x1 z5 O2 {, _
EDMA3_CHA_MCASP0_TX, EDMA3_TRIG_MODE_EVENT);
/* Activate the serializers */& S! d1 p7 W2 n) J  L9 J
McASPRxSerActivate(SOC_MCASP_0_CTRL_REGS);
0 Y% C, _1 ^. I9 ]) B. C/ }McASPTxSerActivate(SOC_MCASP_0_CTRL_REGS);
/* make sure that the XDATA bit is cleared to zero */7 j' U. F' H$ I  `1 s- A$ y
while(McASPTxStatusGet(SOC_MCASP_0_CTRL_REGS) & MCASP_TX_STAT_DATAREADY);
/* Activate the state machines */: X7 u8 d  L  \
McASPRxEnable(SOC_MCASP_0_CTRL_REGS);3 G& M9 ]7 Y! K. g
McASPTxEnable(SOC_MCASP_0_CTRL_REGS);
3 u. x# X! l  t. F: s+ P}

' ^& z1 J" p1 q( P* C
请问:问题出在哪了,时钟按照这样配是否有错。
另外我看XDATA一直是0,接收的rxbuf0,1,2里有一般全是FFFF一半全是0.

% n$ g0 A. H3 v
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